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            EEPW首頁 >> 主題列表 >> chiplet sip

            Chiplet:豪門之間的性能競賽新戰(zhàn)場

            • 可能很多人已經(jīng)聽到過Chiplet這個詞,并且也通過各路大咖的報告和演講對Chiplet有了非常多的了解,甚至很多人將其視為延續(xù)“摩爾定律”的新希望。日前,Intel聯(lián)合AMD、Arm、高通、臺積電、三星、日月光、谷歌云、Meta、微軟等行業(yè)巨頭成立Chiplet標準聯(lián)盟,制定了通用Chiplet的高速互聯(lián)標準“Universal Chiplet Interconnect Express”(以下簡稱“UCIe”),旨在共同打造Chiplet互聯(lián)標準、推進開放生態(tài)。 其實不管你叫它“芯?!边€是“小
            • 關(guān)鍵字: Chiplet  UCIe  小芯片  

            芯原股份:將進一步推進Chiplet技術(shù)和項目產(chǎn)業(yè)化

            •   3月3日,芯原股份在發(fā)布的投資者關(guān)系活動記錄中稱,公司開始推出一系列面向快速發(fā)展市場的平臺化解決方案,其中就包括在2021年上半年芯片流片完成的高端應(yīng)用處理器平臺。這一高端應(yīng)用處理器平臺基于高性能總線架構(gòu)和全新的FLC終極內(nèi)存/緩存技術(shù),為廣泛的應(yīng)用處理器SoC產(chǎn)品提供一個全新的實現(xiàn)高性能、高效率和低功耗的計算平臺,并可顯著地降低系統(tǒng)總體成本,旨在面向國內(nèi)外廣泛的處理器市場,包括PC、自動駕駛、數(shù)據(jù)中心等領(lǐng)域。目前,芯原股份已與國內(nèi)外一些客戶進行接觸;另外,芯原股份還將在公司高端應(yīng)用處理器平臺的基礎(chǔ)上
            • 關(guān)鍵字: 芯原股份  chiplet  

            蘋果發(fā)布“合二為一”芯片,華為公布“芯片疊加”的專利

            • 昨日凌晨的蘋果春季發(fā)布會上,蘋果發(fā)布了最強的 “M1 Ultra”芯片。在大會上,蘋果公布了 M1 Ultra 芯片很多牛逼的參數(shù),比如:晶體管數(shù)量1140億顆;20核CPU(16 個高性能內(nèi)核和 4 個高效內(nèi)核);最高64核GPU;32核神經(jīng)網(wǎng)絡(luò)引擎;2.5TB/s數(shù)據(jù)傳輸速率;800GB/s內(nèi)存帶寬;最高128GB統(tǒng)一內(nèi)存。M1 Ultra 是 Apple 芯片的又一個游戲規(guī)則改變者,它將再次震撼 PC 行業(yè)。通過將兩個M1 Max 芯片與我們的 UltraFusion 封裝架構(gòu)相連接,我們能夠?qū)?A
            • 關(guān)鍵字: 蘋果  M1 Ultra  chiplet  

            Chiplet之間如何通信?臺積電是這樣干的

            • 最近日趨熱門的異構(gòu)和multi-die  2.5D封裝技術(shù)推動了一種新型的接口的產(chǎn)生,那就是超短距離(ultra-short reach :USR),其電氣特性與傳統(tǒng)的印刷電路板走線有很大不同。長而有損的連接需要使用SerDes IP的串行通信通道,而短距離接口則支持并行總線體系結(jié)構(gòu)。SerDes信號需要端接(50 ohm),以最大程度地減少反射并減少遠端串擾,從而增加功耗。2.5D封裝內(nèi)的電氣短路接口無需端接。相比于“recovering”嵌入在串行數(shù)據(jù)流中的時鐘,并具有相關(guān)的時鐘數(shù)
            • 關(guān)鍵字: 臺積電  chiplet  通信  

            AMD 官宣 3D Chiplet 架構(gòu):可實現(xiàn)“3D 垂直緩存”

            • 6 月 1 日消息 在今日召開的 2021 臺北國際電腦展(Computex 2021)上,AMD CEO 蘇姿豐發(fā)布了 3D Chiplet 架構(gòu),這項技術(shù)首先將應(yīng)用于實現(xiàn)“3D 垂直緩存”(3D Vertical Cache),將于今年年底前準備采用該技術(shù)生產(chǎn)一些高端產(chǎn)品。蘇姿豐表示,3D Chiplet 是 AMD 與臺積電合作的成果,該架構(gòu)將 chiplet 封裝技術(shù)與芯片堆疊技術(shù)相結(jié)合,設(shè)計出了銳龍 5000 系處理器原型。官方展示了該架構(gòu)的原理,3D Chiplet 將一個 64MB 的 7n
            • 關(guān)鍵字: AMD  chiplet  封裝  

            英特爾對chiplet未來的一些看法

            • 在英特爾2020年架構(gòu)日活動即將結(jié)束的時候,英特爾花了幾分鐘時間討論它認為某些產(chǎn)品的未來。英特爾客戶計算部門副總裁兼首席技術(shù)官Brijesh Tripathi提出了對2024年以上未來客戶端產(chǎn)品前景的展望。他表示,他們將以英特爾的7+制造工藝為中心,目標是啟用“Client 2.0”,這是一種通過更優(yōu)化的芯片開發(fā)策略來交付和實現(xiàn)沉浸式體驗的新方法。Chiplet(小芯片)并不是新事物,特別是隨著英特爾競爭對手最近發(fā)布的芯片,并且隨著我們進入更復(fù)雜的過程節(jié)點開發(fā),小芯片時代可以使芯片上市時間更快,給定產(chǎn)品的
            • 關(guān)鍵字: 英特爾  chiplet  封裝  

            「芯調(diào)查」Chiplet“樂高化”開啟 UCIe聯(lián)盟要打造芯片的DIY時代

            •   Chiplet(小芯片或芯粒)雖然受到工業(yè)界和學術(shù)界的追捧,之前只是“少數(shù)人的游戲”。但隨著UCIe產(chǎn)業(yè)聯(lián)盟的誕生,一切將成為過往。一個由頂級廠商所主導(dǎo)的Chiplet生態(tài)系統(tǒng)已經(jīng)開始打造,芯片工業(yè)發(fā)展的新未來開始浮出水面。因何結(jié)盟  UCIe(Universal Chiplet Interconnect Express)聯(lián)盟包括了英特爾、臺積電、三星、AMD、Arm、高通、日月光、Google Cloud、Meta、微軟等行業(yè)巨頭,旨在建立統(tǒng)一的die-to-die(裸片到裸片)互聯(lián)標準,打造一個開
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            Chiplet的真機遇和大挑戰(zhàn)

            •   全球主要芯片制造商們昨日宣布,他們正合作為Chiplet技術(shù)創(chuàng)建行業(yè)標準,參與該計劃的公司包括ASE、AMD、Arm、Intel、高通、三星電子和臺積電等,新的行業(yè)標準將被命名為UCIe,這一標準或?qū)鞢hiplet的再次變革?! mdia數(shù)據(jù)顯示,全球Chiplet市場到2024年預(yù)計可以達到58億美元,到2035年將成長至570億美元。AMD 2021年重磅宣布Chiplet以來,Chiplet的風潮不斷沖擊半導(dǎo)體行業(yè),而今Chiplet已經(jīng)擴大到半導(dǎo)體諸多公司?! hiplet是站在fab
            • 關(guān)鍵字: chiplet  AMD  英特爾  臺積電  

            微小化技術(shù)需求日漲 環(huán)旭電子以SiP創(chuàng)新技術(shù)持續(xù)發(fā)力可穿戴領(lǐng)域

            • 今年,環(huán)旭電子進入智能穿戴模組領(lǐng)域的第九年,并在先進封裝技術(shù)的開發(fā)方面又登上新臺階。雙面塑封和薄膜塑封是環(huán)旭電子最新開發(fā)的技術(shù),雙面塑封實現(xiàn)了模組的最優(yōu)化設(shè)計。薄膜塑封技術(shù)的引入,實現(xiàn)了信號連接導(dǎo)出區(qū)域的最小化設(shè)計,同時可以和其他塑封區(qū)域同時在基板的同一側(cè)實現(xiàn)同時作業(yè)。一直以來,手機是推動微小化技術(shù)的主要動力,如今微小化技術(shù)正在多項領(lǐng)域體現(xiàn)其優(yōu)勢,其中智能穿戴領(lǐng)域?qū)ξ⑿』夹g(shù)的需求越來越高。系統(tǒng)級封裝技術(shù)是為智能手表、藍牙耳機等新型智能穿戴電子產(chǎn)品提供高度集成化和微小化設(shè)計的關(guān)鍵技術(shù)。環(huán)旭電子不斷加強研發(fā)
            • 關(guān)鍵字: 環(huán)旭電子  SiP  可穿戴  

            Chiplet正當紅 —— 它為何引得芯片巨頭紛紛入局?

            • 近年來,AMD、英特爾、臺積電、英偉達等國際芯片巨頭均開始紛紛入局Chiplet。同時,隨著入局的企業(yè)越來越多,設(shè)計樣本也越來越多,開發(fā)成本也開始下降,大大加速了Chiplet生態(tài)發(fā)展。
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            Pickering Electronics 推出新款耐高壓 SIL/SIP 舌簧繼電器 線圈電阻更高,功耗更低

            • 英國Pickering Electronics 公司是小型化和高性能舌簧繼電器方面的領(lǐng)導(dǎo)廠商,擁有超過50年經(jīng)驗。近日它宣布推出 100HV 系列耐高壓單列直插 SIL/SIP 舌簧繼電器,提供最高3kV的額定截止電壓,且線圈電阻是之前產(chǎn)品的兩倍以上。高系列繼電器適合應(yīng)用于變壓器、電纜測試,或任何其他要求高電壓但低線圈功耗的自動測試設(shè)備。  Pickering Electronics公司的技術(shù)專家 Kevin Mallett 對新產(chǎn)品作了說明:“100HV系列繼電器非常適用于需要切換電源電壓的應(yīng)
            • 關(guān)鍵字: Pickering Electronic  SIL/SIP  舌簧繼電器  

            AMD推動高效能運算產(chǎn)業(yè)發(fā)展 首款3D chiplet應(yīng)用亮相

            • AMD展示了最新的運算與繪圖技術(shù)創(chuàng)新成果,以加速推動高效能運算產(chǎn)業(yè)體系的發(fā)展,涵蓋游戲、PC以及數(shù)據(jù)中心。AMD總裁暨執(zhí)行長蘇姿豐博士發(fā)表AMD在高效能運算的最新突破,揭示AMD全新3D chiplet技術(shù);與業(yè)界領(lǐng)導(dǎo)廠商特斯拉和三星合作,擴大了AMD運算與繪圖技術(shù)在汽車與手機市場的應(yīng)用;新款A(yù)MD Ryzen處理器瞄準狂熱級玩家與消費性PC;最新AMD第3代EPYC處理器所帶來領(lǐng)先的數(shù)據(jù)中心效能;以及為游戲玩家提供的一系列全新AMD繪圖技術(shù)。 AMD總裁暨執(zhí)行長蘇姿豐展示AMD全新3D chi
            • 關(guān)鍵字: AMD  3D chiplet  Ryzen  

            打造生態(tài)系 小芯片卷起半導(dǎo)體產(chǎn)業(yè)一池春水

            • 在過去數(shù)年的時間,半導(dǎo)體的2.5D異質(zhì)整合芯片的確解決了很多半導(dǎo)體產(chǎn)業(yè)發(fā)展上所遇到的挑戰(zhàn),包括舒緩摩爾定律的瓶頸,還有在降低一次性工程費用 ( Non-Recurring Engineering;NRE ) 的同時,還能提供高階處理能力,并且還能提高產(chǎn)量以及縮短產(chǎn)品上市時間。小芯片生態(tài)系統(tǒng)成形隨著半導(dǎo)體技術(shù)不斷的發(fā)展,在技術(shù)上其實已經(jīng)不太是個問題了。特別是近年來先進制程的開發(fā)不斷傳出新的捷報,在摩爾定律的瓶頸上似乎又被工程界不斷開發(fā)出新的道路。因此看今天的半導(dǎo)體發(fā)展,技術(shù)并不是個太大的難題,主要的問題在于
            • 關(guān)鍵字: 小芯片  Chiplet  摩爾定律  

            封裝與晶粒接口技術(shù)雙管齊下 小芯片發(fā)展加速

            • 當延續(xù)摩爾定律的開發(fā)重點,也就是單一芯片晶體管數(shù)量的世代更迭仍因技術(shù)受阻而放緩,未來芯片市場逐漸開始擁抱小芯片的設(shè)計思維,透過廣納目前供應(yīng)鏈成熟且靈活的先進制程技術(shù),刺激多方廠商展開更多合作,進一步加速從設(shè)計、制造、測試到上市的流程,讓更多高效節(jié)能的芯片與物聯(lián)網(wǎng)成真。要說目前市場上最主流的芯片設(shè)計,必非「系統(tǒng)單芯片(SoC)」莫屬。就這點,近年最廣為熱論的焦點就鎖定蘋果2020年推出基于Arm架構(gòu)的自制芯片M1,而日前盛大舉行的蘋果2021年首場全球新品發(fā)布會中,最新一代iMac更揭曉為繼MacBook之
            • 關(guān)鍵字: 小芯片  Chiplet  摩爾定律  

            小芯片Chiplet夯什么?挑戰(zhàn)摩爾定律天花板

            • 大人物(大數(shù)據(jù)、人工智能、物聯(lián)網(wǎng))時代來臨,高效能、低功耗、多功能高階制程芯片扮演重要角色,隨著功能增加,芯片面積也越來越大,想降低芯片成本,先進封裝技術(shù)不可或缺。棘手的是,先進封裝技術(shù)導(dǎo)入過程中,很可能因為良率不穩(wěn)定導(dǎo)致成本墊高。另一方面,新功能芯片模塊在面積變大之余也要克服摩爾定律(Moore’s Law)物理極限,在晶體管密度與效能間找到新的平衡。前述兩個問題,小芯片(Chiplet)有解!實驗研究院臺灣半導(dǎo)體研究中心(簡稱國研院半導(dǎo)體中心)副主任謝嘉民指出,過去的芯片效能提升多仰賴半導(dǎo)體制程改進,
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            chiplet sip介紹

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