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BittWare用FPGA實現(xiàn)I/O開關(guān)量大于5Gbps
- BittWare是混合(DSP和FPGA)電路板級方案供應(yīng)商，日前該公司采用ADI的TigerSHARC及Altera的FPGA技術(shù)，推出ATLANTiS Rev 2.0(新TigerSHARC使用的高級傳輸鏈路架構(gòu))、I/O切換和處理器件。 ATLANTiS采用FPGA實現(xiàn)，便于板外I/O通訊路由和處理，允許系統(tǒng)設(shè)計師們設(shè)置并動態(tài)連接。所有輸入和輸出均通過ATLANTiS進行路由，每簇通信量大于5GBps。ATLANTiS集成了DSP、PCI橋、PMC接口和I/O外設(shè)及板載F
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用FPGA控制CLC5958型A/D轉(zhuǎn)換器實現(xiàn)的高速PCI數(shù)據(jù)采集卡
- 詳細介紹CLC5958的內(nèi)部結(jié)構(gòu)和基本用法，提出一種基于FPGA和PCI總線的高速數(shù)據(jù)采集卡設(shè)計方案，并通過仿真驗證了該方案的可行性。
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采用FPGA的低功耗系統(tǒng)設(shè)計
- 結(jié)合采用低功耗元件和低功耗設(shè)計技術(shù)在目前比以往任何時候都更有價值。隨著元件集成更多功能，并越來越小型化，對低功耗的要求持續(xù)增長。當把可編程邏輯器件用于低功耗應(yīng)用時，限制設(shè)計的低功耗非常重要。本文將討論減小動態(tài)和靜態(tài)功耗的各種方法，并且給出一些例子說明如何使功耗最小化。 功耗的三個主要來源是啟動、待機和動態(tài)功耗。器件上電時產(chǎn)生的相關(guān)電流即是啟動電流；待機功耗又稱作靜態(tài)功耗，是電源開啟但I/O上沒有開關(guān)活動時器件的功耗；動態(tài)功耗是指器件正常工作時的功耗。 啟動電流因器件而異
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基于FPGA的毫米波多目標信號形成技術(shù)的研究
- 毫米波多目標信號發(fā)生器通過模擬的方法產(chǎn)生多種類型高精度的雷達多目標回波信號，在實際雷達系統(tǒng)前端不具備的條件下對雷達系統(tǒng)后級進行調(diào)試，便于制導武器的性能測試，大大加快新武器的研制進程。毫米波多目標信號產(chǎn)生的關(guān)鍵是要求回波信號距離分辨率極高，常規(guī)的多目標信號產(chǎn)生方法如使用數(shù)字延時線產(chǎn)生多目標之間的延時，其控制不靈活，并且有些延時線需要接ECL電源，使用不方便也增加了設(shè)計的復雜度。使用分立元件實現(xiàn)延時則使電路元件過多，電路的穩(wěn)定性及延時的精確性也會大大降低。本文介紹一種新的產(chǎn)生毫米波雷達模擬器的多目標信號的方法
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FPGA 設(shè)計的四種常用思想與技巧
- 本文討論的四種常用FPGA/CPLD設(shè)計思想與技巧：乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化，都是FPGA/CPLD 邏輯設(shè)計的內(nèi)在規(guī)律的體現(xiàn)，合理地采用這些設(shè)計思想能在FPGA/CPLD設(shè)計工作種取得事半功倍的效果。 FPGA/CPLD的設(shè)計思想與技巧是一個非常大的話題，由于篇幅所限，本文僅介紹一些常用的設(shè)計思想與技巧，包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導日后的設(shè)計工作，將取得事半功倍的效果！ 乒乓操作
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大型設(shè)計中FPGA的多時鐘策略
- 利用FPGA 實現(xiàn)大型設(shè)計時，可能需要FPGA 具有以多個時鐘運行的多重數(shù)據(jù)通路，這種多時鐘FPGA 設(shè)計必須特別小心，需要注意最大時鐘速率、抖動、最大時鐘數(shù)、異步時鐘設(shè)計和時鐘/數(shù)據(jù)關(guān)系。設(shè)計過程中最重要的一步是確定要用多少個不同的時鐘，以及如何進行布線，本文將對這些設(shè)計策略深入闡述。 FPGA 設(shè)計的第一步是決定需要什么樣的時鐘速率，設(shè)計中最快的時鐘將確定FPGA 必須能處理的時鐘速率。最快時鐘速率由設(shè)計中兩個觸發(fā)器之間一個信號的傳輸時間P 來決定，如果P 大于時鐘周期T，則當信號在一個觸發(fā)
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自適應(yīng)算術(shù)編碼的FPGA實現(xiàn)
- 算術(shù)編碼是一種無失真的編碼方法，能有效地壓縮信源冗余度，屬于熵編碼的一種。算術(shù)編碼的一個重要特點就是可以按分數(shù)比特逼近信源熵，突破了Haffman編碼每個符號只不過能按整數(shù)個比特逼近信源熵的限制。對信源進行算術(shù)編碼，往往需要兩個過程，第一個過程是建立信源概率表，第二個過程是對信源發(fā)出的符號序列進行掃描編碼。而自適應(yīng)算術(shù)編碼在對符號序列進行掃描的過程中，可一次完成上述兩個過程，即根據(jù)恰當?shù)母怕使烙嬆Ｐ秃彤斍胺栃蛄兄懈鞣柍霈F(xiàn)的頻率，自適應(yīng)地調(diào)整各符號的概率估計值，同時完成編碼。盡管從編碼效率上看不如已
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白光LED 電荷泵電路板布局指南
- 大多數(shù)白光LED 電荷泵IC 的印刷電路板(PCB)布局非常簡單，但對于大電流電荷泵或引腳數(shù)較多的電荷泵(如MAX1576)來說，線路板布局需要遵循一些規(guī)則。本文給出了一個PCB 布局實例，并討論了相關(guān)的設(shè)計規(guī)則。 對于引腳數(shù)較多的白光LED 驅(qū)動器或大電流電荷泵，在設(shè)計印刷電路板(PCB)時需要注意一些事項，本應(yīng)用筆記以MAX1576 為例討論了相關(guān)的設(shè)計指南和布板規(guī)則。 對于MAX1576 白光LED 電荷泵，在線路板布局中需要遵循以下規(guī)則： 1.所有的GND 和PGND 引
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基于FPGA和USB的高速數(shù)據(jù)傳輸、記錄及顯示系統(tǒng)
- 提出了一種基于FPGA和USB的高速數(shù)據(jù)傳輸、記錄及顯示系統(tǒng)的設(shè)計方案，并對其中的低電壓差分信號（LVDS）傳輸方式、FPGA功能模塊以及USB傳輸模塊等進行了介紹。
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方正科技加大投資主攻PCB產(chǎn)業(yè)
- 方正科技日前舉辦中報業(yè)績說明會。方正科技總裁祁東風表示，公司近日發(fā)布了關(guān)于PCB產(chǎn)業(yè)的研究成果，并遍邀全國各大投資機構(gòu)的行業(yè)分析師，前往珠海生產(chǎn)基地實地調(diào)研，投資者不僅全面了解了方正科技PCB產(chǎn)品的生產(chǎn)流程和工藝設(shè)備，還詳細聽取了公司關(guān)于PCB產(chǎn)業(yè)的投資進度和發(fā)展規(guī)劃，并對公司拉長產(chǎn)業(yè)鏈條、進軍上游產(chǎn)業(yè)的發(fā)展戰(zhàn)略有了更加深入的了解。 2003年，方正科技通過收購珠海多層電路板有限公司，順利進入了PCB（印刷電路板）行業(yè)，并且公司將PCB業(yè)務(wù)確立為公司的戰(zhàn)略性業(yè)務(wù)單元。對眾多投資者尤其是社會
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基于C的設(shè)計方式簡化FPGA/協(xié)處理器混合平臺軟硬件協(xié)同設(shè)計
- 基于C的設(shè)計方式簡化FPGA/協(xié)處理器混合平臺軟硬件協(xié)同設(shè)計 在最近幾年中日益流行在高性能嵌入式應(yīng)用中使用現(xiàn)場可編程門陣列（FPGA）。FPGA已經(jīng)被證明有能力處理各種不同的任務(wù)，從相對簡單的控制功能到更加復雜的算法操作。雖然FPGA在某些功能上比設(shè)計專用ASIC硬件具有時間和成本上的優(yōu)勢，但在面向軟件應(yīng)用中FPGA比傳統(tǒng)處理器和DSP的優(yōu)勢并沒有體現(xiàn)出來。這很大程度上是由于過去割裂了硬件和軟件開發(fā)工具和方法之間的關(guān)系。 然而最近FPGA在面向軟件設(shè)計工具方面的發(fā)展，及器件容量的持續(xù)增
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嵌入系統(tǒng)標準：避免追求高性能而產(chǎn)生的問題
- 嵌入系統(tǒng)標準：避免追求高性能而產(chǎn)生的問題電路板制造商正在升級自己的產(chǎn)品，為的是打入高性能嵌入系統(tǒng)市場?！ ∫c 有了高速結(jié)構(gòu)技術(shù)附件，共享總線體系結(jié)構(gòu)并繼續(xù)支持今天的高性能嵌入系統(tǒng)。 大多數(shù)高性能嵌入系統(tǒng)都是專有的，或是基于PCI、VME、CompactPCI以及Advanced-TCA電路板標準的?！ OTS（商用現(xiàn)成）產(chǎn)品使設(shè)計師能用較高的續(xù)生費用來換取開發(fā)費用的節(jié)省和開發(fā)周期的縮短。 可供選擇的 COTS電路 板級規(guī)范的升級預(yù)示著可能會出現(xiàn)業(yè)界分裂問題和產(chǎn)品互操作問題。 嵌入式系統(tǒng)設(shè)計師們
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