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cpld／fpga 文章進入cpld／fpga技術(shù)社區(qū)

FPGA芯片APA150及其應(yīng)用

文章介紹了APA150的主要特點、內(nèi)部結(jié)構(gòu)、主要性能參數(shù)，給出了APA150在通信系統(tǒng)設(shè)計中的應(yīng)用實例。
關(guān)鍵字： FPGA APA 150 芯片

基于FPGA的快速傅立葉變換

在對FFT（快速傅立葉變換）算法進行研究的基礎(chǔ)上，描述了用FPGA實現(xiàn)FFT的方法，并對其中的整體結(jié)構(gòu)、蝶形單元及性能等進行了分析。
關(guān)鍵字： FPGA 傅立葉變換

異步FIFO結(jié)構(gòu)及FPGA設(shè)計

首先介紹異步FIFO的概念、應(yīng)用及其結(jié)構(gòu)，然后分析實現(xiàn)異步FIFO的難點問題及其解決辦法；在傳統(tǒng)設(shè)計的基礎(chǔ)上提出一種新穎的電路結(jié)構(gòu)并對其進行綜合仿真和FPGA實現(xiàn)。
關(guān)鍵字： FIFO FPGA

3-DES算法的FPGA高速實現(xiàn)

介紹3-DES算法的概要；以Xilinx公司SPARTANII結(jié)構(gòu)的XC2S100為例，闡述用FPGA高速實現(xiàn)3-DES算法的設(shè)計要點及關(guān)鍵部分的設(shè)計。
關(guān)鍵字： FPGA DES 算法高速實現(xiàn)

基于CPLD/FPGA的半整數(shù)分頻器的設(shè)計

簡要介紹了CPLD/FPGA器件的特點和應(yīng)用范圍，并以分頻比為2.5的半整數(shù)分頻器的設(shè)計為例，介紹了在MAX+plus II開發(fā)軟件下，利用VHDL硬件描述語言以及原理圖的輸入方式來設(shè)計數(shù)字邏輯電路的過程和方法。
關(guān)鍵字： CPLD FPGA 整數(shù) 分頻器

零功耗超快速CPLD器件ispMACH4000Z及其應(yīng)用

介紹了萊迪思半導(dǎo)體公司推出的零功耗超快速復(fù)雜中編程邏輯器件ispMACH4000Z的特征、結(jié)構(gòu)和原理。
關(guān)鍵字： ispMACH 4000Z CPLD 4000

用CPLD實現(xiàn)單片機讀寫模塊

介紹實現(xiàn)單片機與Xilinx公司XC9500系列可編程邏輯器件的讀寫邏輯功能模塊的接口設(shè)計，以及Xilinx公司的XC9500系列可編程邏輯器件的開發(fā)流程。
關(guān)鍵字： CPLD 單片機讀寫模塊

基于FPGA的總線型LVDS通信系統(tǒng)設(shè)計

本文介紹一種基于總線型LVDS的通信系統(tǒng)方案，以及利用FPGA芯片實現(xiàn)系統(tǒng)核心模塊的設(shè)計方法。
關(guān)鍵字： FPGA LVDS 總線通信

用CPLD控制曼徹斯特編解碼器

討論如何使用CPLD實現(xiàn)單片機與曼徹斯特編解碼器的接口。
關(guān)鍵字： CPLD 曼徹斯特編解碼器

基于FPGA的多路模擬量、數(shù)字量采集與處理系統(tǒng)

提出一種基于FPGA技術(shù)的多路模擬量、數(shù)字量采集與處理系統(tǒng)的設(shè)計方案，分析整個系統(tǒng)的結(jié)構(gòu)，并討論FPGA內(nèi)部硬件資源的劃分和軟件的設(shè)計方案等。
關(guān)鍵字： FPGA 多路模擬量數(shù)字量采集

固定幾何結(jié)構(gòu)的FFT算法及其FPGA實現(xiàn)

固定幾何結(jié)構(gòu)的FFT算法及其FPGA實現(xiàn)。
關(guān)鍵字： FPGA FFT 幾何算法

CPLD器件在時間統(tǒng)一系統(tǒng)中的應(yīng)用

本文介紹一種利用CPLD器件實現(xiàn)的可編程的性能良好的IRIG-B碼源。
關(guān)鍵字： CPLD 器件系統(tǒng) 中的應(yīng)用

基于FPGA的高速高精度頻率測量的研究

本文介紹的測頻方法，不僅消除了直接測頻方法中對測量頻率需要采用分段測試的局際，而且在整個測試頻段內(nèi)能夠保持高精度不變。
關(guān)鍵字： FPGA 高精度頻率量的研究

CPLD在多路高速同步數(shù)據(jù)采集系統(tǒng)中的應(yīng)用

采用VHDL語言設(shè)計，用CPLD控制模/數(shù)轉(zhuǎn)換電路，完成多路模擬輸入的高速同步數(shù)/模轉(zhuǎn)，具有容錯和自檢能力。
關(guān)鍵字： CPLD 多路同步數(shù)據(jù)采集系統(tǒng)

I2C器件接口IP核的CPLD設(shè)計

根據(jù)單片機I2C串行擴展的特點，在EDA軟件MaxplusII的環(huán)境下，利用AHDL語言，建立IP核。
關(guān)鍵字： CPLD I2C 器件接口

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利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設(shè)計的方法
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