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            如何采用FPGA方案實(shí)現(xiàn)數(shù)字顯示系統(tǒng)設(shè)計(jì)

            • 系統(tǒng)級(jí)芯片(SoC)解決方案被譽(yù)為半導(dǎo)體業(yè)最重要的發(fā)展之一,目前,從數(shù)字手機(jī)和數(shù)字電視等消費(fèi)類(lèi)電子產(chǎn)品到高端通信LAN/WAN設(shè)備中,這一器件隨處可見(jiàn)。過(guò)去,為了創(chuàng)建此類(lèi)嵌入式系統(tǒng),設(shè)計(jì)工程師不得不在處理器、邏輯
            • 關(guān)鍵字: FPGA  方案  數(shù)字顯示  系統(tǒng)設(shè)計(jì)    

            FPGA為車(chē)用微控制器提升設(shè)計(jì)靈活性

            • 在汽車(chē)電子中廣為采用的微控制器(MCU)正快速面臨時(shí)間和成本的壓力。使用MCU的主要優(yōu)勢(shì)一直以來(lái)都是lsquo;創(chuàng)造具有高性?xún)r(jià)比的高階系統(tǒng)整合rsquo;。然而,在此一優(yōu)勢(shì)之下,有一些與元件本身相關(guān)的潛在成本是超乎于其
            • 關(guān)鍵字: FPGA  車(chē)用  微控制器    

            基于LabVIEW的FPGA模塊FIFO深度設(shè)定實(shí)現(xiàn)

            • 為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來(lái)的數(shù)據(jù)不連續(xù)問(wèn)題,結(jié)合LabVIEWFPGA的編程特點(diǎn)和DMA FIFO的工作原理,提出了一種設(shè)定FIFO深度的方法。對(duì)FIFO不同深度的實(shí)驗(yàn)表明,采用該方法設(shè)定的FIFO深度能夠
            • 關(guān)鍵字: LabVIEW  FPGA  FIFO  模塊    

            基于FPGA分布式算法的低通FIR濾波器的設(shè)計(jì)與實(shí)現(xiàn)

            • 0 引言

              傳統(tǒng)數(shù)字濾波器硬件的實(shí)現(xiàn)主要采用專(zhuān)用集成電路(ASIC)和數(shù)字信號(hào)處理器(DSP)來(lái)實(shí)現(xiàn)。FPGA內(nèi)部的功能塊中采用了SRAM的查找表(lo-ok up table,LUT)結(jié)構(gòu),這種結(jié)構(gòu)特別適用于并行處理結(jié)構(gòu),相對(duì)于傳統(tǒng)方法來(lái)
            • 關(guān)鍵字: FPGA  FIR  分布式算法  低通    

            基于FPGA的數(shù)字頻率合成器設(shè)計(jì)與實(shí)現(xiàn)

            • 摘要:為了產(chǎn)生穩(wěn)定激勵(lì)信號(hào)的目的,采用Verilog硬件語(yǔ)言在FPGA上實(shí)現(xiàn)了數(shù)字頻率合成器的設(shè)計(jì),該設(shè)計(jì)包括累加器、波形存儲(chǔ)器、AD轉(zhuǎn)換、低通濾波器等;對(duì)累加器、波形存儲(chǔ)器都進(jìn)行了仿真,并下載到FPGA中,經(jīng)A/D轉(zhuǎn)換
            • 關(guān)鍵字: FPGA  數(shù)字頻率合成器    

            基于FPGA的自適應(yīng)數(shù)字傳感器設(shè)計(jì)

            • 摘要:高量程加速度傳感器在小信號(hào)的激勵(lì)下輸出在10 mV以?xún)?nèi),傳統(tǒng)測(cè)試系統(tǒng)的噪聲可能覆蓋如此小的電壓信號(hào),使高量程的加速度傳感器無(wú)法測(cè)試小的加速度信號(hào)。針對(duì)這一問(wèn)題提出了基于自動(dòng)增益切換控制理論的自適應(yīng)數(shù)字
            • 關(guān)鍵字: FPGA  數(shù)字  傳感器設(shè)計(jì)    

            利用Maxim外設(shè)模塊加速FPGA原型設(shè)計(jì)、顯著降低成本

            • Maxim Integrated Products (NASDAQ: MXIM)推出能夠直接插入符合Digilent? Pmod?標(biāo)準(zhǔn)的任意FPGA/CPU擴(kuò)展端口的15個(gè)外設(shè)模塊套裝。簡(jiǎn)單的連接操作和便利的軟件集成可加速原型開(kāi)發(fā)進(jìn)度,實(shí)現(xiàn)從概念至設(shè)計(jì)方案的快速移植。這套模塊的價(jià)格極具競(jìng)爭(zhēng)力,即使在預(yù)算最緊張的情況下,也可以采用先進(jìn)的高性能IC進(jìn)行方案測(cè)試。
            • 關(guān)鍵字: Maxim  FPGA  

            賽靈思推出符合PCI- E 3.0標(biāo)準(zhǔn)的集成模塊

            • All Programmable FPGA、SoC和3D IC的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )宣布推出針對(duì)采用Virtex?-7 FPGA 集成模塊設(shè)計(jì)的全新解決方案, 該集成模塊可支持PCI Express (簡(jiǎn)稱(chēng)PCI-E) 3.0 x8標(biāo)準(zhǔn)和 DDR3 外部存儲(chǔ)器,能為開(kāi)發(fā)人員提供立即啟動(dòng)基于PCI-E 3.0的設(shè)計(jì)所需的全部構(gòu)建模塊。
            • 關(guān)鍵字: 賽靈思  FPGA  Virtex-7  

            基于FPGA+嵌入式處理器的違章車(chē)輛視頻檢測(cè)系統(tǒng)

            • 基于FPGA+嵌入式處理器的違章車(chē)輛視頻檢測(cè)系統(tǒng),0 引 言隨著我國(guó)經(jīng)濟(jì)的發(fā)展,機(jī)動(dòng)車(chē)輛不斷地增長(zhǎng),現(xiàn)有道路等硬件設(shè)施的增長(zhǎng)已經(jīng)滿足不了日益膨脹的交通問(wèn)題,智能交通系統(tǒng)(Intelligent Transportation System,ITS)越來(lái)越受重視。所謂智能交通系統(tǒng)(ITS)就是將先
            • 關(guān)鍵字: 車(chē)輛  視頻  檢測(cè)系統(tǒng)  違章  處理器  FPGA  嵌入式  基于  

            基于FPGA的TFTLCD快檢信號(hào)源的實(shí)現(xiàn)

            • 0 引言目前,液晶顯示行業(yè)得到迅速的發(fā)展,但由于液晶模塊的生產(chǎn)不可能達(dá)到100%的成品率,或多或少地存在缺陷,目前在TFT模塊的生產(chǎn)工藝中就有可能產(chǎn)生點(diǎn)缺陷和線缺陷等。為了及早對(duì)產(chǎn)品的質(zhì)量進(jìn)行檢測(cè),液晶測(cè)試儀器成為
            • 關(guān)鍵字: TFTLCD  FPGA  信號(hào)源    

            基于高速串行BCD碼除法的數(shù)字頻率計(jì)的設(shè)計(jì)

            賽靈思異構(gòu)3D FPGA難在哪兒

            • 不久前,All Programmable技術(shù)和器件的企業(yè)——賽靈思公司(Xilinx)正式發(fā)貨 Virtex-7 H580T FPGA—全球首款3D異構(gòu)All Programmable產(chǎn)品。 Virtex-7 HT采用賽靈思的堆疊硅片互聯(lián) (SSI)技術(shù),是提供業(yè)界帶寬最高的FPGA,可提供多達(dá)16個(gè)28 Gbps收發(fā)器和72個(gè)13.1 Gbps收發(fā)器,也是能滿足關(guān)鍵Nx100G和400G線路卡應(yīng)用功能要求的單芯片解決方案。 為此,本刊訪問(wèn)了該公司負(fù)責(zé)人,澄
            • 關(guān)鍵字: Xilinx  賽靈思  3D  FPGA  all programmable  異構(gòu)  

            一種基于ARM和FPGA的可重構(gòu)MAC協(xié)議設(shè)計(jì)

            • 一種基于ARM和FPGA的可重構(gòu)MAC協(xié)議設(shè)計(jì),摘要:為了在實(shí)際信道條件下研究Ad Hoc網(wǎng)絡(luò)MAC協(xié)議,克服商業(yè)網(wǎng)卡芯片和理論仿真等帶來(lái)的局限性,搭建了基于ARM和FPGA相結(jié)合的硬件平臺(tái),設(shè)計(jì)與實(shí)現(xiàn)了基于CSMA/CA的可重構(gòu)MAC協(xié)議,并進(jìn)行了仿真測(cè)試,驗(yàn)證了該協(xié)議設(shè)
            • 關(guān)鍵字: 協(xié)議  設(shè)計(jì)  MAC  重構(gòu)  ARM  FPGA  基于  

            用Synplify Premier加快FPGA設(shè)計(jì)時(shí)序收斂

            • 傳統(tǒng)的綜合技術(shù)越來(lái)越不能滿足當(dāng)今采用 90 納米及以下工藝節(jié)點(diǎn)實(shí)現(xiàn)的非常大且復(fù)雜的 FPGA 設(shè)計(jì)的需求了。問(wèn)題是傳統(tǒng)的 FPGA 綜合引擎是基于源自 ASIC 的方法,如底層規(guī)劃、區(qū)域內(nèi)優(yōu)化 (IPO,In-place Optimization) 以
            • 關(guān)鍵字: Synplify  Premier  FPGA  時(shí)序收斂    

            基于FPGA的IRIG-B(DC)碼解碼

            • 摘要:在分析了IRIG-B(DC)碼碼型特點(diǎn)的基礎(chǔ)上,提出了一種IRIG-B(DC)時(shí)間碼解碼的設(shè)計(jì)方法。該方法由少量外圍電路與一片現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)芯片組成,來(lái)實(shí)現(xiàn)對(duì)IRG-B(DC)碼的解碼、1 PPS信號(hào)輸出、實(shí)時(shí)時(shí)間顯示以
            • 關(guān)鍵字: IRIG-B  FPGA  DC  解碼    
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