- 對FPGA這種特殊芯片產(chǎn)品的認(rèn)識開始于10年前對Altera公司的認(rèn)識。Altera公司獨特的嚴(yán)謹(jǐn)氣質(zhì)與FPGA這種芯片非常契合。多年來跟蹤報道Altera在FPGA技術(shù)上的不斷創(chuàng)新,加之后來有機會結(jié)識賽靈思公司,兩家業(yè)內(nèi)翹楚的針鋒相對與惺惺相惜,使我對FPGA整個體系架構(gòu)的演進(jìn)過程有了比較全面的理解。前段時間,有機會與Altera公司CTO、資深副總裁Misha Burich先生交流FPGA業(yè)界發(fā)展趨勢,使得自己對FPGA技術(shù)發(fā)展的理解愈加清晰和深刻。
FPGA體系架構(gòu)演進(jìn)
FPGA興起
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Altera FPGA
- 本文介紹了ATA5830主要特性,方框圖以及3V和5V的典型應(yīng)用電路.ATA5830是通用高度集成低功耗UHF ASK/FSK RF單片收發(fā)器,包括了RF部分,數(shù)字基帶和AVR 微控制器內(nèi)核,內(nèi)核是采用增強RISC架構(gòu)的低功耗CMOS 8位MCU.收發(fā)器工作
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RF 收發(fā) 方案 FSK ASK ATA5830 功耗 UHF 基于
- 1 引言DDR2(Double DataRate2)SDRAM是由JEDEC(電子設(shè)備工程聯(lián)合委員會)制定的新生代內(nèi)存技術(shù)標(biāo)準(zhǔn),它與上一代DDR內(nèi)存技術(shù)標(biāo)準(zhǔn)最大的不同:雖然采用 時鐘的上升/下降沿同時傳輸數(shù)據(jù)的基本方式,但DDR2卻擁有2倍的DDR
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Spartan Xilinx FPGA DDR2
- X-fest 2012全球系列研討會北京站于7月10日舉辦,創(chuàng)下了單場活動吸引上千名業(yè)內(nèi)人士參加的新記錄。X-fest是為期一天的全球性培訓(xùn)活動,由安富利公司 (NYSE: AVT) 旗下安富利電子元件亞洲 (Avnet Electronics Marketing )主辦,深受FPGA、ARM MCU、DSP和嵌入式系統(tǒng)開發(fā)人員歡迎。
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安富利 X-fest FPGA
- 1、控制系統(tǒng)概述隨著工業(yè)的發(fā)展,三坐標(biāo)測量機越來越顯示出其重要作用。而電機控制系統(tǒng)對三坐標(biāo)測量機的運行有著非常重要的作用。由于FPGA可以現(xiàn)場可編程,可以實現(xiàn)專用集成電路,能滿足片上系統(tǒng)設(shè)計(SOC)的要求,使
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FPGA 三坐標(biāo)測量機 電機控制系統(tǒng)
- 256 級灰度顯示 - 基于FPGA的OLED真彩色顯示設(shè)計,摘要利用FPGA 控制模塊,設(shè)計了OLED 真彩色動態(tài)圖像驅(qū)動控制電路。介紹采用FPGA 實現(xiàn)OLED 外圍控制電路和256 級灰度的方法,并分析電路中模塊的作用及整個電路的工作過程。電路系統(tǒng)采用基于Altera 公司的FPGA技術(shù)進(jìn)行
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顯示 彩色 設(shè)計 OLED FPGA 基于 級灰度
- 工程師分析實例,帶你走近Xilinx FPGA設(shè)計,一.概述 本文主要幫助大家熟悉利用ISE進(jìn)行Xilinx 公司FPGA 代碼開發(fā)的基本流程。主要是幫助初學(xué)者了解和初步掌握 ISE 的使用,不需要 FPGA 的開發(fā)基礎(chǔ),所以對每個步驟并不進(jìn)行深入的討論?! ”疚慕榻B的內(nèi)容從新
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FPGA 設(shè)計 Xilinx 走近 分析 實例 工程師
- 采用FPGA與SRAM的大容量數(shù)據(jù)存儲的設(shè)計,1 前言 針對FPGA中內(nèi)部BlockRAM有限的缺點,提出了將FPGA與外部SRAM相結(jié)合來改進(jìn)設(shè)計的方法,并給出了部分VHDL程序?! ? 硬件設(shè)計 這里將主要討論以Xilinx公司的FPGA(XC2S600E-6fg456)和ISSI公司的SRAM(IS61LV
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存儲 設(shè)計 數(shù)據(jù) 大容量 FPGA SRAM 采用
- 采用上位機與FPGA開發(fā)板的光纖通道接口適配器設(shè)計,隨著存儲技術(shù)的迅速發(fā)展,存儲容量得到了迅速的增長,存儲系統(tǒng)的數(shù)據(jù)傳輸速度成為了主要的瓶頸。光纖的傳輸具有其速度上的優(yōu)勢,然而,在光纖傳輸要受到光纖通道接口的限制,因此光纖通道應(yīng)用于高速數(shù)據(jù)傳輸?shù)囊粋€關(guān)
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接口 適配器 設(shè)計 通道 光纖 上位 FPGA 開發(fā) 采用
- 利用Java良好的移植特性的FPGA可編程嵌入式系統(tǒng),傳統(tǒng)的嵌入式產(chǎn)品只能實現(xiàn)某種特定的功能,不能滿足用戶可變的豐富多彩的應(yīng)用需求。為解決這個問題,本文設(shè)計并實現(xiàn)了一種使用Java作為軟件平臺的基于FPGA的可編程嵌入式系統(tǒng),以實現(xiàn)系統(tǒng)對多種本地應(yīng)用和網(wǎng)絡(luò)的支持
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可編程 嵌入式 系統(tǒng) FPGA 特性 Java 良好 移植 利用
- FPGA全局時鐘資源相關(guān)Xilinx器件原語及使用,FPGA全局時鐘資源一般使用全銅層工藝實現(xiàn),并設(shè)計了專用時鐘緩沖與驅(qū)動結(jié)構(gòu),從而使全局時鐘到達(dá)芯片內(nèi)部的所有可配置單元(CLB)、I/O單元(IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應(yīng)復(fù)雜設(shè)
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Xilinx 器件 使用 相關(guān) 資源 全局 時鐘 FPGA
- FPGA/EPLD的自上而下設(shè)計方法及其優(yōu)缺點介紹,FPGA/EPLD的自上而下(Top-Down)設(shè)計方法: 傳統(tǒng)的設(shè)計手段是采用原理圖輸入的方式進(jìn)行的,如圖1所示。通過調(diào)用FPGA/EPLD廠商所提供的相應(yīng)物理元件庫,在電路原理圖中繪制所設(shè)計的系統(tǒng),然后通過網(wǎng)表轉(zhuǎn)換產(chǎn)生某一特
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缺點 介紹 及其 方法 自上而下 設(shè)計 FPGA/EPLD
- Altera公司(NASDAQ: ALTR)日前宣布,推出40-Gbps以太網(wǎng)(40GbE)和100-Gbps以太網(wǎng)(100GbE)知識產(chǎn)權(quán)(IP)內(nèi)核產(chǎn)品。這些內(nèi)核能夠高效的構(gòu)建需要大吞吐量標(biāo)準(zhǔn)以太網(wǎng)連接的系統(tǒng),包括,芯片至光模塊、芯片至芯片以及背板應(yīng)用等。
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Altera FPGA
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