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基于單片機(jī)與FPGA可調(diào)延時(shí)模塊的設(shè)計(jì)
- 系統(tǒng)結(jié)構(gòu)框圖如圖1。其硬件結(jié)構(gòu)比較簡單，主要由單片機(jī)P89C51RD、RS-232/TTL接口電路MAX232和可編程邏輯器件FPGA三部分組成。單片機(jī)P89C51RD2是上位PC機(jī)和FPGA的連接紐帶，它通過并口發(fā)送數(shù)據(jù)給FPGA，另一邊通過RS-2
- 關(guān)鍵字： FPGA 單片機(jī) 可調(diào)延時(shí)模塊
FPGA驅(qū)動(dòng)LED靜態(tài)顯示和動(dòng)態(tài)顯示的VHDL程序
- 例1：FPGA驅(qū)動(dòng)LED靜態(tài)顯示 --文件名：decoder.vhd --功能：譯碼輸出模塊，LED為共陽接法 --最后修改日期：2004.3.24 library IEEE; use IEEE.STD_LOGIC_1164.ALL; use IEEE.STD_LOGIC_ARITH.ALL;
- 關(guān)鍵字： FPGA VHDL LED 驅(qū)動(dòng)
一種基于FPGA的UART 電路實(shí)現(xiàn)
- 1 引 言 UART 即通用異步收發(fā)器，他廣泛使用串行數(shù)據(jù)傳輸協(xié)議。UART 功能包括微處理器接口、用于數(shù)據(jù)傳輸?shù)木彌_器（Buffer）、幀產(chǎn)生、奇偶校驗(yàn)、并串轉(zhuǎn)換，用于數(shù)據(jù)接收的緩沖器、幀產(chǎn)生、奇偶校驗(yàn)、串并轉(zhuǎn)換等。
- 關(guān)鍵字： FPGA UART 電路實(shí)現(xiàn)
基于FPGA的LVDS高速數(shù)據(jù)通信卡設(shè)計(jì)
- 摘要 基于FPGA、PCI9054、SDRAM和DDS設(shè)計(jì)了用于某遙測信號模擬源的專用板卡。PCI9054實(shí)現(xiàn)與上位機(jī)的數(shù)據(jù)交互，F(xiàn)PGA實(shí)現(xiàn)PCI本地接口轉(zhuǎn)換、數(shù)據(jù)接收發(fā)送控制及DDS芯片的配置。通過WDM驅(qū)動(dòng)程序設(shè)計(jì)及MFC交互界面設(shè)計(jì)，最
- 關(guān)鍵字： 數(shù)據(jù)通信 設(shè)計(jì) 高速 LVDS FPGA
FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì)
- FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì),隨著可編程邏輯器件的不斷進(jìn)步和發(fā)展，F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測系統(tǒng)中信號采集模塊控制器的 IP核，是采用硬件描述語言來實(shí)現(xiàn)的。首先它是以ADS8364芯片為控制對象，結(jié)合
- 關(guān)鍵字： IP 設(shè)計(jì) 控制器 數(shù)據(jù)采集 高速 通道 FPGA
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