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            EEPW首頁(yè) >> 主題列表 >> fpga soc

            在SoC上集成車(chē)載信息娛樂(lè)和儀表子系統(tǒng)

            • 電子設(shè)計(jì)自動(dòng)化技術(shù)的領(lǐng)導(dǎo)廠(chǎng)商 Mentor Graphics近日發(fā)布一份題為《在新興異構(gòu)SoCs上集成AUTOSAR、車(chē)載信息娛樂(lè)和儀表子系統(tǒng)》的研究報(bào)告。全文內(nèi)容如
            • 關(guān)鍵字: SoC  集成車(chē)載  信息娛樂(lè)  儀表  

            基于FPGA的生物芯片掃描儀位置檢測(cè)

            • 引言生物芯片是20世紀(jì)末隨ldquo;人類(lèi)基因組計(jì)劃rdquo;的研究和發(fā)展而產(chǎn)生的一項(xiàng)高新技術(shù),是人們高效地大規(guī)模獲取生物信息的有效手段。目前大部分生
            • 關(guān)鍵字: 測(cè)量  FPGA  

            基于FPGA的高壓變頻器中性點(diǎn)偏移技術(shù)的算法實(shí)現(xiàn)

            • 0 引言在高壓變頻器正常運(yùn)行過(guò)程中,如果功率單元出現(xiàn)故障,一般的實(shí)現(xiàn)方法是將此故障功率單元旁通,同時(shí)讓其它兩相相應(yīng)的功率單元也同時(shí)旁通,這樣使
            • 關(guān)鍵字: 控制  FPGA  

            高速手勢(shì)識(shí)別系統(tǒng)解決方案

            • 1設(shè)計(jì)摘要目前,研究自然化的人機(jī)交互是當(dāng)今計(jì)算機(jī)科學(xué)技術(shù)領(lǐng)域的主要研究熱點(diǎn)之一,手勢(shì)輸入作為一種自然、豐富、直接的交互手段在人機(jī)交互技術(shù)中占有
            • 關(guān)鍵字: 計(jì)算機(jī)  FPGA  

            FPGA/EPLD的自上而下(Top-Down)設(shè)計(jì)方法解析

            • FPGA/EPLD的自上而下(Top-Down)設(shè)計(jì)方法:傳統(tǒng)的設(shè)計(jì)手段是采用原理圖輸入的方式進(jìn)行的,通過(guò)調(diào)用FPGA/EPLD廠(chǎng)商所提供的相應(yīng)物理元件庫(kù),在電路原理圖
            • 關(guān)鍵字: FPGA  EPLD  自上而下  

            利用FPGA實(shí)現(xiàn)的一種機(jī)載高清視頻處理模塊

            • 現(xiàn)代飛機(jī)座艙顯示技術(shù)的發(fā)展日新月異,需要顯示各種傳感器信息的數(shù)據(jù)已經(jīng)達(dá)到海量規(guī)模。飛行員在不同飛行時(shí)段獲得的信息也越來(lái)越多,為了使飛行員能夠
            • 關(guān)鍵字: 視頻  FPGA  

            “FPGA+CPU” 并行處理大行其道

            • 深亞微米時(shí)代,傳統(tǒng)材料、結(jié)構(gòu)乃至工藝都在趨于極限狀態(tài),摩爾定律也已有些捉襟見(jiàn)肘。而步入深亞納米時(shí)代,晶體管的尺寸就將接近單個(gè)原子,無(wú)法再往下
            • 關(guān)鍵字: FPGA  CPU  嵌入式  并行處理  

            基于FPGA消除噪聲干擾方法詳解

            • 許多高速數(shù)據(jù)采集應(yīng)用,如激光雷達(dá)或光纖測(cè)試等,都需要從嘈雜的環(huán)境中采集小的重復(fù)信號(hào),因此對(duì)于數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)來(lái)說(shuō),最大的挑戰(zhàn)就是如何最大限
            • 關(guān)鍵字: 噪聲  FPGA  信號(hào)平均  

            高云半導(dǎo)體公司發(fā)布基于晨熙家族FPGA的RISC-V微處理器 早期使用者計(jì)劃

            •   中國(guó)廣州,2018年8月16日,國(guó)內(nèi)領(lǐng)先的可編程邏輯器件供應(yīng)商——廣東高云半導(dǎo)體科技股份有限公司(如下簡(jiǎn)稱(chēng)“高云半導(dǎo)體”),今日宣布發(fā)布基于高云半導(dǎo)體FPGA的RISC-V微處理器早期使用者計(jì)劃,該計(jì)劃是基于晨熙家族 GW2A 系列FPGA芯片的包括系統(tǒng)級(jí)參考設(shè)計(jì)的FPGA編程BIT文件、GW2A開(kāi)發(fā)板等的完整解決方案,其中系統(tǒng)級(jí)參考設(shè)計(jì)包括RISC-V MCU內(nèi)核、AHB & APB總線(xiàn)、存儲(chǔ)器控制單元及若干外設(shè)?! ISC-V作為指令集體系結(jié)構(gòu)(ISA)的開(kāi)放規(guī)范,RISC-V ISA設(shè)
            • 關(guān)鍵字: 高云  FPGA  RISC-V  

            值得一看!高手分享FPGA設(shè)計(jì)中的一些經(jīng)驗(yàn)

            • 這里我談?wù)勎业囊恍┙?jīng)驗(yàn)和大家分享,希望能對(duì) IC 設(shè)計(jì)的新手有一定的幫助,能使得他們能少走一些彎路!在 IC 工業(yè)中有許多不同的領(lǐng)域, IC 設(shè)計(jì)者的特征
            • 關(guān)鍵字: FPGA  IC設(shè)計(jì)  經(jīng)驗(yàn)  

            微控制器配對(duì)FPGA來(lái)提高系統(tǒng)效率

            • FPGA已經(jīng)變得如此成本效益的,它們?cè)絹?lái)越多地與微控制器配合使用,以提高整個(gè)系統(tǒng)的效率。使用包括添加額外的功能在電路板空間最小,增加功率高效處理
            • 關(guān)鍵字: FPGA  微控制器  

            基于FPGA實(shí)現(xiàn)的音頻接口轉(zhuǎn)換電路

            • I2S總線(xiàn)是一種用于音頻設(shè)備間傳輸數(shù)據(jù)的串行總線(xiàn)標(biāo)準(zhǔn),該總線(xiàn)采用獨(dú)立的時(shí)鐘線(xiàn)與數(shù)據(jù)線(xiàn),避免了時(shí)差誘發(fā)的失真。隨著多媒體的廣泛應(yīng)用,該總線(xiàn)已被應(yīng)用
            • 關(guān)鍵字: FPGA  接口轉(zhuǎn)換  PCI  

            結(jié)合FPGA與結(jié)構(gòu)化ASIC進(jìn)行設(shè)計(jì)

            • 由于結(jié)構(gòu)化ASIC具有單位成本低、功耗低、性能高和轉(zhuǎn)換快(fast turnaound)等特點(diǎn),越來(lái)越多的先進(jìn)系統(tǒng)設(shè)計(jì)工程師正在考慮予以采用。在結(jié)構(gòu)化ASIC中,像
            • 關(guān)鍵字: FPGA  

            【詳解】FPGA:機(jī)器深度學(xué)習(xí)的未來(lái)?

            • 最近幾年數(shù)據(jù)量和可訪(fǎng)問(wèn)性的迅速增長(zhǎng),使得人工智能的算法設(shè)計(jì)理念發(fā)生了轉(zhuǎn)變。人工建立算法的做法被計(jì)算機(jī)從大量數(shù)據(jù)中自動(dòng)習(xí)得可組合系統(tǒng)的能力所取
            • 關(guān)鍵字: FPGA  

            FPGA擊敗GPU和GPP,成為深度學(xué)習(xí)的未來(lái)?

            • 最近幾年,深度學(xué)習(xí)成為計(jì)算機(jī)視覺(jué)、語(yǔ)音識(shí)別、自然語(yǔ)言處理等關(guān)鍵領(lǐng)域中所最常使用的技術(shù),被業(yè)界大為關(guān)注。然而,深度學(xué)習(xí)模型需要極為大量的數(shù)據(jù)和
            • 關(guān)鍵字: FPGA  GPU  GPP  深度學(xué)習(xí)  
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            fpga soc介紹

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