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基于DSP的數(shù)據(jù)采集系統(tǒng)開發(fā)與實(shí)現(xiàn)
- 為了解決自動(dòng)檢測和控制系統(tǒng)中數(shù)據(jù)采集速度慢的問題，提出運(yùn)用基于DSP的軟件平臺(tái)一CCS和TI公司TMS320系列F2812芯片開發(fā)一種快速數(shù)據(jù)采集系統(tǒng)，研究了該系統(tǒng)硬件平臺(tái)的搭建和相關(guān)應(yīng)用程序的開發(fā)。將其運(yùn)用于旋轉(zhuǎn)機(jī)械狀態(tài)監(jiān)測及故障診斷領(lǐng)域中有關(guān)轉(zhuǎn)速信號、多路同步軸徑向振動(dòng)信號、軸向位移信號、若干開關(guān)量信號、溫度、壓力、流量等參數(shù)的信號采集，取得了良好的效果。
- 關(guān)鍵字： DSP 數(shù)據(jù)采集 系統(tǒng)開發(fā)
基于FIFO的DDC與DSP高速數(shù)據(jù)傳輸實(shí)現(xiàn)
- 軟件無線電數(shù)字中頻接收機(jī)通常采用可編程數(shù)字下變頻器DDC和DSP的實(shí)現(xiàn)方案。中頻模擬信號通過A/D數(shù)字化，送入DDC混頻、抽取濾波處理，DSP接收到的是DDC輸出的低速零中頻信號，其后的解調(diào)、譯碼、信號識(shí)別等算法都可以
- 關(guān)鍵字： 數(shù)據(jù)傳輸 實(shí)現(xiàn) 高速 DSP FIFO DDC 基于 FIFO DDC DSP
Altium 推出 Altera Cyclone III FPGA 新型子板
- 日前，Altium 宣布推出另一款面向桌面 NanoBoard 可重構(gòu)硬件開發(fā)平臺(tái)的全新子板，進(jìn)一步幫助電子設(shè)計(jì)人員輕松利用可編程硬件的優(yōu)勢。 這款最新插入式子板采用 780 BGA 封裝，內(nèi)置 Altera 的低成本 Cyclone® III EP3C40 FPGA。該子板包含可充分滿足應(yīng)用需求的各種板載存儲(chǔ)器以及用來存儲(chǔ)電路板識(shí)別數(shù)據(jù)與相關(guān)信息的 1-Wire 存儲(chǔ)器器件。 電子產(chǎn)品設(shè)計(jì)人員可充分利用桌面 NanoBoard 的高靈活性以及可對 FPGA 進(jìn)行再編程的特性，快速
- 關(guān)鍵字： Altium FPGA
Altera發(fā)售業(yè)界密度最高的收發(fā)器FPGA
- Altera公司(NASDAQ: ALTR)今天宣布，開始提供業(yè)界密度最高的收發(fā)器FPGA芯片。作為Altera® Stratix® IV GX FPGA系列中發(fā)售的第二個(gè)型號器件，EP4SGX530比市場上最大的收發(fā)器FPGA大60％。該器件提供530K邏輯單元(LE)，48個(gè)工作速率高達(dá)8.5 Gbps的收發(fā)器，20.3 Mbits RAM以及1,040個(gè)嵌入式乘法器。Stratix IV GX器件面向通信、廣播、測試、醫(yī)療和軍事市場等多種應(yīng)用領(lǐng)域。 Agilent邏輯和協(xié)議
- 關(guān)鍵字： Altera，F(xiàn)PGA，收發(fā)器
基于FPGA的無線通信收發(fā)模塊設(shè)計(jì)方案
- 1 前言 近年來，隨著半導(dǎo)體工藝技術(shù)和設(shè)計(jì)方法的迅速發(fā)展，系統(tǒng)級芯片SOC的設(shè)計(jì)得以高速發(fā)展，這已成為業(yè)界熱點(diǎn)。但是，由于SOC產(chǎn)品設(shè)計(jì)具有開發(fā)周期相對較長、高成本和高風(fēng)險(xiǎn)等特點(diǎn)，對市場的變化非常敏感，這使
- 關(guān)鍵字： 設(shè)計(jì) 方案 模塊 收發(fā) FPGA 無線通信 基于 FPGA 無線通信收發(fā)模塊 設(shè)計(jì)方案 摩爾斯碼
基于FPGA的高速數(shù)據(jù)中繼器設(shè)計(jì)的研究
- 1 前言 高速以太網(wǎng)可以滿足新的容量需求，解決了低帶寬接入、高帶寬傳輸?shù)钠款i問題，擴(kuò)大了應(yīng)用范圍，并與以前的所有以太網(wǎng)兼容。全雙工的以太網(wǎng)協(xié)議并無傳輸距離的限制，只是在實(shí)際應(yīng)用中，物理層技術(shù)限制了最
- 關(guān)鍵字： FPGA 高速數(shù)據(jù) 中繼器
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