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            EEPW首頁(yè) >> 主題列表 >> vhdl-cpld

            基于CPLD/DSP的賽車(chē)全電防滑剎車(chē)控制器設(shè)計(jì)

            • 1 引言賽車(chē)剎車(chē)系統(tǒng)是賽車(chē)系統(tǒng)上具有相對(duì)獨(dú)立功能的子系統(tǒng),其作用是承受賽車(chē)的靜態(tài)重量、動(dòng)態(tài)沖擊載荷以及吸收賽車(chē)剎車(chē)時(shí)的動(dòng)能,實(shí)現(xiàn)賽車(chē)的制動(dòng)與控制。其性能的好壞直接影響到賽車(chē)的快速反應(yīng)、安全制動(dòng)和生存能力,進(jìn)
            • 關(guān)鍵字: CPLD  DSP  防滑  剎車(chē)控制器    

            利用單片機(jī)和CPLD實(shí)現(xiàn)直接數(shù)字頻率合成(DDS)

            • 直接數(shù)字頻率合成(DDS)技術(shù)是美國(guó)學(xué)者J.Tierncy,C.M.Rader和B.Gold在1971年首次提出的。這是一種全數(shù)字技術(shù),該技術(shù)從相位概念出發(fā)直接合成所需要的波形。同傳統(tǒng)的頻率合成技術(shù)相比,DDS技術(shù)具有很多優(yōu)點(diǎn):頻率切
            • 關(guān)鍵字: 頻率  合成  DDS  數(shù)字  直接  單片機(jī)  CPLD  實(shí)現(xiàn)  利用  

            MCS-51單片機(jī)與PLD 可編程器件接口設(shè)計(jì)

            • 摘要:采用Lattice公司的PLD器件ISPLSI1032,基于VHDL描述語(yǔ)言設(shè)計(jì)了一種MCS-51單片機(jī)與PLD可編程邏輯器件的接 ...
            • 關(guān)鍵字: 單片機(jī)  PLD  EDA  VHDL  

            數(shù)控系統(tǒng)中基于CPLD的步進(jìn)電機(jī)驅(qū)動(dòng)模塊的設(shè)計(jì)

            • 摘要:介紹一種采用大規(guī)??删幊踢壿嬈骷﨏PLD來(lái)控制步進(jìn)電機(jī)的方法,對(duì)電機(jī)的控制方式為四相八拍。通過(guò)對(duì)CPLD進(jìn)行編程,從而對(duì)電機(jī)達(dá)到啟動(dòng),停止,正轉(zhuǎn),反轉(zhuǎn)的控制。采用的編程語(yǔ)言為VHDL語(yǔ)言,使用的編程環(huán)境為MA
            • 關(guān)鍵字: CPLD  數(shù)控系統(tǒng)  步進(jìn)電機(jī)  驅(qū)動(dòng)模塊    

            用CPLD實(shí)現(xiàn)單片機(jī)與ISA總線(xiàn)并行通信

            • 摘要:用ALTERA公司MAX7000系列CPLD芯片實(shí)現(xiàn)單片機(jī)與PC104 ISA總線(xiàn)接口之間的并行通信,給出系統(tǒng)設(shè)計(jì)方法及程序 ...
            • 關(guān)鍵字: CPLD  ISA總線(xiàn)  并行通信  

            基于VHDL的DRAM控制器設(shè)計(jì)

            • 基于VHDL的DRAM控制器設(shè)計(jì), 80C186XL16位嵌入式微處理器是Intel公司在嵌入式微處理器市場(chǎng)的上導(dǎo)產(chǎn)品之一,已廣泛應(yīng)用于電腦終端、程控交換和工控等領(lǐng)域。在該嵌入式微處理器片內(nèi),集成有DRAM RCU單元,即DRAM刷新控制單元。RCU單元可以自動(dòng)產(chǎn)生
            • 關(guān)鍵字: 設(shè)計(jì)  控制器  DRAM  VHDL  基于  

            基于CPLD的ST-BUS總線(xiàn)收發(fā)模塊設(shè)計(jì)與實(shí)現(xiàn)

            • 引言 現(xiàn)代電信系統(tǒng)已發(fā)展為一個(gè)龐大的綜合化數(shù)字網(wǎng)絡(luò),除了提供傳統(tǒng)電話(huà)服務(wù)外,也提供多種數(shù)據(jù)接入服務(wù),其典型應(yīng)用是為其它專(zhuān)用通信系統(tǒng)提供數(shù)據(jù)中繼服務(wù)。因E1信號(hào)接入方式簡(jiǎn)單,一般電信交換機(jī)都會(huì)預(yù)留部分E1接入
            • 關(guān)鍵字: ST-BUS  CPLD  總線(xiàn)  收發(fā)    

            用CPLD創(chuàng)建具有彈性指令集的微控制器

            • 從消費(fèi)類(lèi)產(chǎn)品到通信產(chǎn)品,微處理器都有著非常廣泛的應(yīng)用。目前流行的8位微處理器不僅能夠完成高運(yùn)算量的任務(wù),而且成本很低,因此取得了巨大成功。微處理器非常擅長(zhǎng)于有序處理和各種非實(shí)時(shí)的任務(wù),典型的工作速度在2
            • 關(guān)鍵字: CPLD  彈性  指令集  微控制器    

            用CPLD實(shí)現(xiàn)DSP與背板VME總線(xiàn)之間的連接

            • 1 引言CPLD是一種用戶(hù)可以根據(jù)自行需要而自己能夠設(shè)計(jì)構(gòu)造其邏輯功能的數(shù)字集成電路系統(tǒng),實(shí)現(xiàn)了硬件設(shè)計(jì)的軟件化。CPLD具有豐富的可編程I/O引腳,具有在系統(tǒng)可編程( In System programmability)、使用方便靈活的的特
            • 關(guān)鍵字: CPLD  DSP  VME  背板    

            CPLD與16C554在航空發(fā)動(dòng)機(jī)參數(shù)采集器中的應(yīng)用

            • 0 引 言

              隨著航空工業(yè)和計(jì)算機(jī)工業(yè)的飛速發(fā)展,傳統(tǒng)的機(jī)械式儀表已經(jīng)逐漸被數(shù)字顯示儀表所替代,嵌入式系統(tǒng)越來(lái)越多地應(yīng)用于航空儀表之中。航空發(fā)動(dòng)機(jī)是飛機(jī)上最重要的部件之一,需要測(cè)量的數(shù)據(jù)較多,而其各項(xiàng)參數(shù)
            • 關(guān)鍵字: 16C554  CPLD  航空發(fā)動(dòng)機(jī)  參數(shù)采集器    

            基于VHDL的通信編碼波形的設(shè)計(jì)與仿真

            • 引言信號(hào)傳輸一般可分為兩大部分:編碼與解碼。其中編碼要求根據(jù)所傳輸信號(hào)特點(diǎn)選擇合適的編碼方式。由于不同的信號(hào)在不同的環(huán)境中進(jìn)行傳輸,受到的干擾是不同的,而選擇合適的編碼方法可以最大限度的避免干擾,使通
            • 關(guān)鍵字: 設(shè)計(jì)  仿真  波形  編碼  VHDL  通信  基于  

            裝入CPLD/FPGA的步進(jìn)電機(jī)運(yùn)動(dòng)控制器與驅(qū)動(dòng)器

            • 本設(shè)計(jì)實(shí)例進(jìn)一步拓展了以前將步進(jìn)電機(jī)驅(qū)動(dòng)器集成到CPLD中的設(shè)計(jì)(參考文獻(xiàn)1)。本實(shí)例不僅集成了驅(qū)動(dòng)器,而且還集成了一個(gè)簡(jiǎn)單的單軸步進(jìn)電機(jī)運(yùn)動(dòng)控制器。根據(jù)CPLD大小,可以將多個(gè)運(yùn)動(dòng)控制器設(shè)計(jì)到單一設(shè)備中。例如
            • 關(guān)鍵字: 控制器  驅(qū)動(dòng)器  運(yùn)動(dòng)  電機(jī)  CPLD/FPGA  步進(jìn)  裝入  

            基于CPLD/FPGA的VHDL電路優(yōu)化設(shè)計(jì)

            • 基于CPLD/FPGA的VHDL電路優(yōu)化設(shè)計(jì),VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語(yǔ)言,是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)展起來(lái)的。它是一種面向設(shè)計(jì)、多層次的硬件描述語(yǔ)言,是集行為描述、RTL
            • 關(guān)鍵字: 優(yōu)化  設(shè)計(jì)  電路  VHDL  CPLD/FPGA  基于  

            基于DSP CPLD信號(hào)采集系統(tǒng)通訊接口設(shè)計(jì)

            • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
            • 關(guān)鍵字: DSP  信號(hào)采集系統(tǒng)  CPLD  

            基于EP1C6Q240C8和VHDL的定時(shí)器的方案設(shè)計(jì)

            • 本設(shè)計(jì)采用可編程芯片和VHDL語(yǔ)言進(jìn)行軟硬件設(shè)計(jì),不但可使硬件大為簡(jiǎn)化,而且穩(wěn)定性也有明顯提高。由于可編程芯片的頻率精度可達(dá)到50 MHz,因而計(jì)時(shí)精度很高。本設(shè)計(jì)采用逐位設(shè)定預(yù)置時(shí)間,其最長(zhǎng)時(shí)間設(shè)定可長(zhǎng)達(dá)99小
            • 關(guān)鍵字: 240C  Q240  VHDL  240    
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