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      EEPW首頁 >> 主題列表 >> spartan-dsp

      FPGA設計工具視點

      • 作為一個負責FPGA企業(yè)市場營銷團隊工作的人,我不得不說,由于在工藝技術方面的顯著成就以及硅芯片設計領域的獨創(chuàng)性,FPGA正不斷實現其支持片上系統(tǒng)設計的承諾。隨著每一代新產品的推出,FPGA在系統(tǒng)中具有越來來越多的功能,可作為協處理器、DSP 引擎以及通信平臺等,在某些應用領域甚至還可用作完整的片上系統(tǒng)。
      • 關鍵字: 設計工具  DSP  FPGA  ASSP  

      目標設計平臺使基于FPGA的系統(tǒng)開發(fā)易如反

      • 賽靈思公司在正式發(fā)布新一代旗艦產品高性能Virtex-6和低成本Spartan-6 FPGA時,首次提出了“目標設計平臺”的新概念。賽靈思目標設計平臺包含五個關鍵部分:Virtex-6和Spartan-6 FPGA器件、支持和集成業(yè)界成熟設計方法的設計環(huán)境、采用業(yè)界標準FPGA多層連接器的可擴展板和套件、提供接口的IP內核和強大的參考設計。
      • 關鍵字: 目標設計平臺  系統(tǒng)開發(fā)  FPGA  Virtex-6  Spartan-6  

      幾種DSP與外接存儲器的連接方法

      • 存儲器接口分為ROM接口和RAM接口兩種。ROM包括EPROM和FLASH,而RAM主要是指SRAM。TMS320C5409具有32K字的片內RAM和16K字的掩膜ROM。但是在DSP應用的很多場合,尤其是帶信號存儲的DSP應用來說,TMS320C5409的片內存儲資源是遠遠不夠用的。因此,設計一個TMS320C5409硬件系統(tǒng)一般應該包括其與EPROM/FLASH和SRAM的接口設計,以存放程序和數據。本文介紹TMS320C5409與存儲器的接口設計方案。
      • 關鍵字: 存儲器  DSP  連接  

      mcu,DSP,PLD/EDA的介紹/比較/分析

      基于C5509A的功放閉環(huán)數字控制系統(tǒng)(圖)

      • 隨著通信系統(tǒng)的發(fā)展,要求通信具有更高的傳輸可靠性、更強的抗干擾能力。在無線信號發(fā)射過程中,射頻信號必須經功放放大,再經天線發(fā)射出去,信號經功放后的幅度和穩(wěn)定性對通信的可靠性和抗干擾起著關鍵作用。攻放輸出信號的幅度越大通信可靠性越穩(wěn)定,接收的準確性和可靠性就越高。在發(fā)射端,功放輸出功率控制一方面需要保證功放的安全可靠,另一方面又要盡可能使功放輸出功率最大。因此,對功放的輸出功率控制就顯得十分重要,早期的功放控制一般采用模擬等方法實現。
      • 關鍵字: C5509A  DSP  功放  閉環(huán)  數字控制  

      基于DSP的數碼相機中的MPEG-4 壓縮

      • 雖然數碼相機 (DSC) 投入市場僅幾年時間,但已經使消費類電子成像業(yè)發(fā)生了翻天覆地的變化。目前,全球售出的相機中大約有三分之一是數碼相機,而且其份額還在穩(wěn)步上升。
      • 關鍵字: DSP  數碼  MPEG-4  壓縮  

      用FPGA實現FIR濾波器

      • 你接到要求用FPGA實現FIR濾波器的任務時,也許會想起在學校里所學的FIR基礎知識,但是下一步該做什么呢?哪些參數是重要的?做這個設計的最佳方法是什么?還有這個設計應該怎樣在FPGA中實現?現在有大量的低成本IP核和工具來幫助你進行設計,因為FIR是用FPGA實現的最普通的功能。
      • 關鍵字: FIR濾波器  DSP  LUT  FPGA  

      MAX706S在DSP系統(tǒng)中的應用

      • 對于實際的DSP應用系統(tǒng)特別是產品化的DSP系統(tǒng)而言,可靠性是一個不容忽視的問題。由于DSP系統(tǒng)的時鐘頻率比較高,因此在運行時極有可能發(fā)生干擾和被干擾的現象,嚴重時系統(tǒng)可能會出現死機。為了克服這種情況,除了在軟件上作一些保護措施外,硬件上也必須作相應的處理。硬件上最有效的保護措施就是采用具有監(jiān)視(Watchdog)功能的自動復位電路。各大公司生產了多種微處理器監(jiān)控器,用來監(jiān)測微處理器的運行狀態(tài),一旦微處理器失控就強行復位微處理器,引導程序重新運行。
      • 關鍵字: MAX706S  DSP  監(jiān)控電路  

      動量輪模擬器的設計

      • 在衛(wèi)星姿態(tài)和軌道控制計算機(AOCC)分系統(tǒng)的設計和室內聯調階段,為方便系統(tǒng)調試,需設計動量輪模擬器,模擬執(zhí)行機構動量輪所決定的衛(wèi)星姿態(tài)和控制效果,代替真實部件進行分系統(tǒng)的開環(huán)和閉環(huán)試驗。
      • 關鍵字: 動量輪  模擬器  DSP  

      利用FPGA和多通道光模塊組合長距離傳送高速數據

      • 目前基于銅電纜的高速串口能夠以數千兆位速率進行數據傳送,并可通過使用多個并行通道達成超過100Gbps的數據傳輸率,不過傳送的距離卻受到限制,一個可以改善傳輸距離的作法是使用光互連來取代銅電纜,Alt
      • 關鍵字: DSP  LGA  FPGA  DDM  

      基于FPGA+DSP的智能車全景視覺系統(tǒng)

      • 為實現智能車全景視覺系統(tǒng)的應用研究平臺,設計了一種基于FPGA+雙DSP的實時6通道數字圖像采集與處理系統(tǒng)。該系統(tǒng)由兩片FPGA與兩個DSP組成。第一個FPGA進行多通道視覺圖像采集的同步控制、邏輯處理,第二片FPGA輔助DSP進行海量圖像數據的高速并行處理。
      • 關鍵字: 全景視覺系統(tǒng)  FPGA+DSP  數字圖像采集與處理系統(tǒng)  

      基于FPGA和多DSP的高速視覺測量系統(tǒng)的研究

      • 針對高速視覺測量系統(tǒng)數據處理速度快、數據處理量大的特點,將FPGA技術與DSP技術相結合,研究了一種基于FPGA和多DSP的多通道并行處理的高速視覺測量系統(tǒng)。詳細介紹了FPGA技術與多DSP技術在數字圖像處理過程中的不同應用、高速視覺測量系統(tǒng)的總體結構以及各部分的工作原理。
      • 關鍵字: 高速視覺測量系統(tǒng)  DSP  FPGA  

      基于DSP的嵌入式導航計算機系統(tǒng)中CPLD器件軟件更新的實現

      • 針對嵌入式導航計算機系統(tǒng)中CPLD器件軟件更新需求,提出了通過串行方式基于DSP的CPLD軟件更新方案,通過DSP的I/O口模擬CPLD的JTAG時序邏輯,將由串口接收到的CPLD配置信息文件,移入到其內部邏輯中,從而實現軟件更新。分析研究了實現該方案需解決的硬件和軟件中的關鍵問題,設計實現了提出的CPLD器件軟件更新方案,并在實際的導航計算機系統(tǒng)中進行了驗證和應用。
      • 關鍵字: CPLD器件軟件更新  DSP  JTAG  

      FPGA與DSP協同處理系統(tǒng)設計之:典型實例-整數DCT變換的設計與實現

      • 本節(jié)旨在設計實現了視頻壓縮標準H.264算法中的整數DCT變換部分,幫助讀者了解并行流水設計技巧在算法優(yōu)化中的作用。
      • 關鍵字: DSP  協同處理  FPGA  整數DCT變換  H.264  

      FPGA與DSP協同處理系統(tǒng)設計之:典型實例-FPGA片上硬件乘法器的使用

      • 在FPGA+DSP系統(tǒng)設計系統(tǒng)中,FPGA經常作為DSP的協處理器來輔助完成一些計算任務。而這些計算工作中最消耗時間的就是乘法運算,因此本實例的主要內容就是幫助讀者學會調用硬件乘法IP核。
      • 關鍵字: DSP  協同處理  FPGA  硬件乘法器  
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      spartan-dsp介紹

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