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基于FPGA的LCD測(cè)試用信號(hào)發(fā)生器設(shè)計(jì)
- 摘要：在檢測(cè)液晶屏特性和質(zhì)量時(shí)，需要控制液晶屏顯示一些標(biāo)準(zhǔn)信號(hào)。已有的一些信號(hào)產(chǎn)生設(shè)備產(chǎn)生的是AV信號(hào)、VGA信號(hào)或YPhPr信號(hào)等模擬制式的信號(hào)。模擬制式的信號(hào)需要經(jīng)過(guò)圖形處理器(GPU)轉(zhuǎn)換成數(shù)字LVDS信號(hào)，然后輸
- 關(guān)鍵字： FPGA LCD 測(cè)試 信號(hào)發(fā)生器
基于FPGA的數(shù)字穩(wěn)定校正單元的實(shí)現(xiàn)
- 摘要：為了實(shí)現(xiàn)對(duì)非相干雷達(dá)的接收相參處理，基于數(shù)字穩(wěn)定校正(DSU)的原理，采用ALTERA公司的StratixⅡ系列芯片和VHDL編程語(yǔ)言，設(shè)計(jì)了一種基于FPGA的DSU硬件實(shí)現(xiàn)方法。實(shí)驗(yàn)結(jié)果表明基于FPGA的DSU方法可以提高程序的
- 關(guān)鍵字： FPGA 數(shù)字穩(wěn)定校正
嵌入式與邊界設(shè)備提供了測(cè)試機(jī)會(huì)
- 有兩類應(yīng)用提出了設(shè)計(jì)與測(cè)試挑戰(zhàn)，雖然它們并不要求最高的帶寬、數(shù)據(jù)速率和存儲(chǔ)器深度。據(jù)Agilent技術(shù)公...
- 關(guān)鍵字： 嵌入式系統(tǒng) 測(cè)試與測(cè)量 FPGA
Altera發(fā)售業(yè)界最快、具有背板功能收發(fā)器的Stratix V FPGA
- 2012年8月1號(hào)，北京——Altera公司(Nasdaq: ALTR)今天宣布，開(kāi)始批量發(fā)售FPGA業(yè)界性能最好、具有背板功能的收發(fā)器。Altera的Stratix® V FPGA是業(yè)界唯一能夠提供14.1 Gbps收發(fā)器帶寬的FPGA，也是唯一支持最新一代光纖通道協(xié)議(16GFC)的FPGA。背板、交換機(jī)、數(shù)據(jù)中心、云計(jì)算應(yīng)用、測(cè)試測(cè)量系統(tǒng)以及存儲(chǔ)區(qū)域網(wǎng)的開(kāi)發(fā)人員采用Altera最新一
- 關(guān)鍵字： Altera FPGA
基于FPGA的34位串行編碼信號(hào)設(shè)計(jì)與實(shí)現(xiàn)
- 摘要：為實(shí)現(xiàn)某專用接口裝置的接口功能檢測(cè)，文中詳細(xì)地介紹了一種34位串行碼的編碼方式，并基于FPGA芯片設(shè)計(jì)了該類型編碼的接收、發(fā)送電路。重點(diǎn)分析了電路各模塊的設(shè)計(jì)思路。電路采用SOPC模塊作為中心控制器，設(shè)計(jì)
- 關(guān)鍵字： FPGA 串行 編碼 信號(hào)設(shè)計(jì)
基于FPGA部分動(dòng)態(tài)可重構(gòu)的信號(hào)解調(diào)系統(tǒng)的實(shí)現(xiàn)
- 摘要：針對(duì)調(diào)制樣式在不同環(huán)境下的變化，采用了FPGA部分動(dòng)態(tài)可重構(gòu)的新方法，通過(guò)對(duì)不同調(diào)制樣式信號(hào)的解調(diào)模塊的動(dòng)態(tài)加載，來(lái)實(shí)現(xiàn)了不同環(huán)境下針對(duì)不同調(diào)制樣式的解調(diào)這種方式比傳統(tǒng)的設(shè)計(jì)方式具有更高的靈活性、可
- 關(guān)鍵字： FPGA 部分動(dòng)態(tài)可重構(gòu) 信號(hào)解調(diào)系統(tǒng)
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