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可編程ASIC器件主從式結(jié)構(gòu)開發(fā)系統(tǒng)的設(shè)計(jì)
- 可編程ASIC器件主從式結(jié)構(gòu)開發(fā)系統(tǒng)的設(shè)計(jì),1 引言當(dāng)前在EDA領(lǐng)域，只要具備臺(tái)式或筆記本電腦并裝有工具軟件，就可以方便地對(duì)可編程ASIC（CPLD/FPGA）進(jìn)行設(shè)計(jì)開發(fā)，在系統(tǒng)可編程（ISP）器件為我們提供了這種便利條件。ISP方式雖然可以用一根下載電纜代替了編程
- 關(guān)鍵字： 開發(fā) 系統(tǒng) 設(shè)計(jì) 結(jié)構(gòu) 主從 ASIC 器件 可編程
基于CPLD器件設(shè)計(jì)的單穩(wěn)態(tài)電路
- 基于CPLD器件設(shè)計(jì)的單穩(wěn)態(tài)電路,隨著電子技術(shù)特別是數(shù)字集成電路技術(shù)的迅猛發(fā)展，市面上出現(xiàn)了FPGA、CPLD等大規(guī)模數(shù)字集成電路，并且其工作速度和產(chǎn)品質(zhì)量不斷提高。利用大規(guī)模數(shù)字集成電路實(shí)現(xiàn)常規(guī)的單穩(wěn)態(tài)集成電路所實(shí)現(xiàn)的功能，容易滿足寬度、精
- 關(guān)鍵字： 穩(wěn)態(tài) 電路 設(shè)計(jì) 器件 CPLD 基于
采用可編程邏輯器件和A/D轉(zhuǎn)換器的高速數(shù)據(jù)采集卡的設(shè)計(jì)方案
- 采用可編程邏輯器件和A/D轉(zhuǎn)換器的高速數(shù)據(jù)采集卡的設(shè)計(jì)方案, 用于PC的采集系統(tǒng)以前大多有用ISA總線結(jié)構(gòu)，這種結(jié)構(gòu)的最大缺點(diǎn)是傳輸速率低，無法實(shí)現(xiàn)高速數(shù)據(jù)的實(shí)時(shí)傳輸。而PCI總線則以其卓越的性能受到了廣泛的應(yīng)用。32位PCI總線的最大傳輸數(shù)據(jù)速率可達(dá)132MB/s，64位PCI總線的
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