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為什么大量的人會覺得FPGA難學(xué)？這些道理你都知道嗎？
- 問：本人零基礎(chǔ)，想學(xué)FPGA，求有經(jīng)驗的人說說，我應(yīng)該從哪入手，應(yīng)該看什么教程，應(yīng)該用什么學(xué)習(xí)板和開發(fā)板，看什么書等，希望有經(jīng)驗的好心人能夠給我一些引導(dǎo)?！ ∪绻胨俪?，那就上網(wǎng)看視頻吧，這樣主要是面對應(yīng)用的，一個小時內(nèi)讓你的板子運行起來。早期起來的快，活學(xué)活用，就是后期沒有系統(tǒng)理論支持，會有些吃力，特別是大項目，那完全是個悲劇。國內(nèi)做的可以的，我知道的就是周立功了，艾米電子也可以吧。這兩家都有學(xué)習(xí)板，不過后者的教程抄襲的前者的。前者功底深厚些，資金不緊張就買前者
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關(guān)于pcb線寬和電流的經(jīng)驗公式
- 關(guān)于pcb線寬和電流的經(jīng)驗公式，關(guān)系表和軟件網(wǎng)上有很多，在實際的PCB板設(shè)計中，需要綜合考慮PCB板的大小，通過電流，選擇一個合適的線寬?！ CB線寬與電流關(guān)系 計算方法如下： 先計算Track的截面積，大部分PCB的銅箔厚度為35um(不確定的話可以問PCB廠家)它乘上線寬就是截面積，注意換算成平方毫米?！ ∮幸粋€電流密度經(jīng)驗值，為15~25安培/平方毫米。把它稱上截面積就得到通流容量。 I=KT0.44A0.75 K為修正系數(shù)，一般覆銅線在內(nèi)層時取0.024，在外層時取0.048 T為
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PCB設(shè)計規(guī)范其實就是“怎么擺”和“怎么連”
- PCB設(shè)計紛繁復(fù)雜，各種意料之外的因素頻頻來影響整體方案的達(dá)成，如何能馴服性格各異的零散部件?怎樣才能畫出一份整齊、高效、可靠的PCB圖?今天讓我們來盤點一下?！ CB設(shè)計看似復(fù)雜，既要考慮各種信號的走向又要顧慮到能量的傳遞，干擾與發(fā)熱帶來的苦惱也時時如影隨形。但實際上總結(jié)歸納起來非常清晰，可以從兩個方面去入手： 說得直白一些就是：“怎么擺”和“怎么連”?！ ÷犉饋硎遣皇欠浅asy?讓我們先來梳理下“怎么擺”： 1、遵照“先大后小，先難后易”的布置原則，即重要的單元電路、核心元器件應(yīng)當(dāng)優(yōu)先布局
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從易到難總結(jié)幾種FPGA時序約束方法
- 從最近一段時間工作和學(xué)習(xí)的成果中，我總結(jié)了如下幾種進(jìn)行時序約束的方法。按照從易到難的順序排列如下： 1. 核心頻率約束 這是最基本的，所以標(biāo)號為0?！ ?. 核心頻率約束+時序例外約束 時序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay。但這還不是最完整的時序約束。如果僅有這些約束的話，說明設(shè)計者的思路還局限在FPGA芯片內(nèi)部?！ ?. 核心頻率約束+時序例外約束+I/O約束 I/O約束包括引腳分配位置、空閑引腳驅(qū)動方式、外部走線延時(Inpu
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匯總PCB畫原理圖的十大注意事項
- (1)畫原理圖的時候管腳的標(biāo)注一定要用網(wǎng)絡(luò) NET不要用文本TEXT，否則導(dǎo)PCB的時候會出問題 (2)畫完原理圖的時候一定要讓所有的元件都有封裝，否則導(dǎo)PCB的時候會找不到元件 有的元件在庫里找不到是要自己畫的，其實實際中還是自己畫好，最后有一個自己的庫，那才叫方便呢。畫的過程是啟動FILE/NEW——》選擇SCH LIB——》這就進(jìn)入了零件編輯庫——》畫完后在該元件上又鍵TOOLS—RENAME COMPONENT可重命名元件?！ ≡庋b的畫法跟這個也一樣，但是選擇的是PCB LIB，元件的
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從原理圖到PCB設(shè)計流程，你一定要知道
- 6大PCB設(shè)計技巧，開關(guān)電源設(shè)計一定用得上! 在任何開關(guān)電源設(shè)計中，PCB板的物理設(shè)計都是最后一個環(huán)節(jié)，如果設(shè)計方法不當(dāng)，PCB可能會輻射過多的電磁干擾，造成電源工作不穩(wěn)定，以下針對各個步驟中所需注意的事項進(jìn)行分析?！ ?從原理圖到PCB設(shè)計流程 建立元件參數(shù)——>輸入原理網(wǎng)表->設(shè)計參數(shù)設(shè)置->手工布局->手工布線->驗證設(shè)計——>復(fù)查->CAM輸出?！ ?參數(shù)設(shè)置 相鄰導(dǎo)線間距必須能滿足電氣安全要求，而且為了便于操作和生產(chǎn)，間距也應(yīng)盡量寬些。最小間距
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