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fsp:fpga-pcb 文章進(jìn)入fsp:fpga-pcb技術(shù)社區(qū)

高速PCB可控性與電磁兼容性設(shè)計(jì)

第一篇 PCB布線在PCB設(shè)計(jì)中，布線是完成產(chǎn)品設(shè)計(jì)的重要步驟，可以說前面的準(zhǔn)備工作都是為它而做的，在整個(gè)PCB中，以布線的設(shè)計(jì)過程限定最高，技巧最細(xì)、工作量最大。PCB布線有單面布線、雙面布線及多層布線。布線的
關(guān)鍵字：設(shè)計(jì) 電磁兼容可控性 PCB 高速

PCB、IC設(shè)計(jì)、NB將扮Q4領(lǐng)頭羊

　　歷經(jīng)八月國際經(jīng)濟(jì)市場風(fēng)暴，市場帶著趨避保守的氣氛進(jìn)入Q4，話雖如此，只要國際經(jīng)濟(jì)情勢能回穩(wěn)，Q4仍能為電子產(chǎn)業(yè)帶來已往的好表現(xiàn)，特別是PCB、IC設(shè)計(jì)與NB產(chǎn)業(yè)將扮演領(lǐng)頭羊、火車頭的角色。　
關(guān)鍵字： PCB IC設(shè)計(jì)

PCB行業(yè)自我救贖實(shí)行單獨(dú)環(huán)保標(biāo)準(zhǔn)

　　目前，我國印制電路板(PCB)產(chǎn)量位居世界第一，產(chǎn)品質(zhì)量及技術(shù)水平也得到很大提升。然而要使PCB行業(yè)實(shí)現(xiàn)可持續(xù)發(fā)展，企業(yè)必須在節(jié)能減排、清潔生產(chǎn)上下工夫。日前在江蘇大豐召開的“2011年環(huán)保技術(shù)研討會”上，業(yè)內(nèi)專家從技術(shù)、標(biāo)準(zhǔn)等角度對治理PCB行業(yè)的“三廢”給出了建議。　
關(guān)鍵字： PCB CCL

直擴(kuò)系統(tǒng)PN碼捕獲和跟蹤的FPGA實(shí)現(xiàn)

摘要：在數(shù)字匹配濾波器和超前滯后鑒相環(huán)路的理論基礎(chǔ)上，采用VHDL編程，在FPGA芯片上實(shí)現(xiàn)PN碼捕獲和跟蹤的電路。詳細(xì)討論了各電路模塊的設(shè)計(jì)實(shí)現(xiàn)方法。完成電路的仿真驗(yàn)證，給出了仿真波形。結(jié)果表明電路工作正?？?/li>
關(guān)鍵字： FPGA 直擴(kuò)系統(tǒng) PN碼

基于FPGA的電梯控制系統(tǒng)設(shè)計(jì)

摘要：介紹了基于FPGA的四層電梯控制系統(tǒng)的設(shè)計(jì)。該系統(tǒng)采用Altera公司的CycloneⅡ系列FPGA芯片EP2C5T144作為主控制芯片，采用Verilog-HDL編程描述，實(shí)現(xiàn)對電梯的智能控制，經(jīng)仿真驗(yàn)證，完成所要求功能。該設(shè)計(jì)采用模
關(guān)鍵字： FPGA 電梯控制系統(tǒng)設(shè)計(jì)

用LabVIEW FPGA模塊實(shí)現(xiàn)不同時(shí)鐘域的數(shù)據(jù)連續(xù)傳輸

摘要：為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來的數(shù)據(jù)不連續(xù)問題，結(jié)合LabVIEWFPGA的編程特點(diǎn)和DMA FIFO的工作原理，提出了一種設(shè)定FIFO深度的方法。對FIFO不同深度的實(shí)驗(yàn)表明，采用該方法設(shè)定的FIFO深
關(guān)鍵字： LabVIEW FPGA 模塊傳輸

基于FPGA的高速自適應(yīng)格型濾波器的實(shí)現(xiàn)

摘要：針對高速高靈敏度數(shù)字信號處理時(shí)對于自適應(yīng)濾波器的數(shù)值特性和實(shí)時(shí)性的要求，在一種自適應(yīng)格型聯(lián)合濾波器的基礎(chǔ)上提出算法改進(jìn)，采用馳豫超前流水線技術(shù)和時(shí)序重構(gòu)技術(shù)，在損失較小濾波性能的情況下，在FPGA中
關(guān)鍵字： FPGA 濾波器

cpld fpga 區(qū)別

系統(tǒng)的比較,與大家共享：盡管ＦＰＧＡ和ＣＰＬＤ都是可編程ＡＳＩＣ器件,有很多共同特點(diǎn),但由于ＣＰＬＤ和ＦＰＧＡ結(jié)構(gòu)上的差異,具有各自的特點(diǎn):①ＣＰＬＤ更適 ...
關(guān)鍵字： cpld fpga

用一個(gè)時(shí)鐘在FPGA中計(jì)算直方圖

直方圖對數(shù)字?jǐn)?shù)據(jù)的分析通常是一種有用的工具。不過，要從一個(gè)直方圖獲得可靠的結(jié)果，必須獲得大量數(shù)據(jù)，通常是要...
關(guān)鍵字： FPGA

基于FPGA的UART接口開發(fā)方案

由于FPGA的功能日益強(qiáng)大，開發(fā)周期短、可重復(fù)編程等優(yōu)點(diǎn)也越來越明顯，可以在FPGA芯片上集成UART功能模塊，從...
關(guān)鍵字： FPGA UART接口

基于FPGA的UART接口模塊設(shè)計(jì)

基于FPGA的UART接口模塊設(shè)計(jì),UART（UniversalAnynchronousReceiverTransmitter,通用異步接收發(fā)送器）是廣泛應(yīng)用的串行數(shù)據(jù)傳輸協(xié)議之一，其應(yīng)用范圍遍及計(jì)算機(jī)外設(shè)、工控自動化等場合。雖然USB傳輸協(xié)議比UART協(xié)議有更高的性能，但電路復(fù)雜開發(fā)難
關(guān)鍵字：模塊設(shè)計(jì) 接口 UART FPGA 基于

一種基于FPGA的高速誤碼測試儀的設(shè)計(jì)

摘要：誤碼測試儀是檢測通信系統(tǒng)可靠性的重要設(shè)備。傳統(tǒng)的誤碼測試儀基于CPLD和CPU協(xié)同工作，不僅結(jié)構(gòu)復(fù)雜，價(jià)格昂貴，而且不方便攜帶。基于FPGA的高速誤碼測試儀，采用FPGA來完成控制和測試模塊的一體化設(shè)計(jì)，提高了
關(guān)鍵字： FPGA 誤碼測試儀的設(shè)計(jì)

基于FPGA的FIR濾波器的性能研究

摘要：目前FIR濾波器的一般設(shè)計(jì)方法比較繁瑣，開發(fā)周期長，如果采用設(shè)計(jì)好的FIR濾波器的IP核，則開發(fā)效率大為提高。本方案基于Altera公司的CycloneⅡ系列芯片EP2C8Q208C8N，首先利用MATLAB中的濾波器函數(shù)fir2得出需產(chǎn)
關(guān)鍵字： FPGA FIR 濾波器性能

基于FPGA的幅值可調(diào)信號發(fā)生器設(shè)計(jì)

摘要：針對信號發(fā)生器時(shí)輸出頻率精度高和幅值可調(diào)的要求，采用直接數(shù)字頻率合成(DDS)技術(shù)，提出一種基于FPGA的幅值、頻率均可調(diào)的、高分辨率、高穩(wěn)定度的信號發(fā)生器設(shè)計(jì)方案。采用AT89S52單片機(jī)為控制器，控制FPGA產(chǎn)
關(guān)鍵字： FPGA 幅值信號發(fā)生器

基于FPGA的QDPSK調(diào)制器的設(shè)計(jì)與實(shí)現(xiàn)

摘要：介紹了QDPSK信號的優(yōu)點(diǎn)，并分析了其實(shí)現(xiàn)原理，提出一種QDPSK高性能數(shù)字調(diào)制器的FPGA實(shí)現(xiàn)方案。采用自頂向下的設(shè)計(jì)思想，將系統(tǒng)分成串／并變換器、差分編碼器、邏輯選相電路、四相載波發(fā)生器等4大模塊，用原理圖
關(guān)鍵字： QDPSK FPGA 調(diào)制器

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