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            EEPW首頁 >> 主題列表 >> fsp:fpga-pcb

            為軟件工程師揭開 FPGA 的神秘面紗

            • 隨著產(chǎn)品設(shè)計復(fù)雜性的增加,需要使用集成組件(如ASSP)來滿足設(shè)計上的要求。幾年前,工程師會針對處理器、存儲器和外設(shè)選擇單獨的組件,然后通過分立邏輯器件將這些元素拼合到一起。后來,他們會搜索ASSP處理系統(tǒng)目
            • 關(guān)鍵字: FPGA  軟件工程師    

            基于DSP和FPGA的機載總線接口板研究

            • 基于DSP和FPGA的機載總線接口板研究,目前國內(nèi)對民用飛機機載數(shù)據(jù)總線ARINC429接口板的設(shè)計一般都是基于HARRIS公司的HS3282芯片完成的,它的缺點是路數(shù)有限、非常不靈活。因此對ARINC429總線接口板的研制,實現(xiàn)多通道ARINC429總線數(shù)據(jù)的接收和發(fā)送,成為
            • 關(guān)鍵字: 接口  研究  總線  機載  DSP  FPGA  基于  

            淺析FPGA將在4G系統(tǒng)中地位非淺

            • 除了語音連接之外,數(shù)字蜂窩無線網(wǎng)絡(luò)(如GSM和增強的GSM-EDGE)現(xiàn)在可以提供更高的數(shù)據(jù)傳輸速率,理論上可達到384 ...
            • 關(guān)鍵字: FPGA  4G  

            利用視覺系統(tǒng)來防止PCB缺陷的產(chǎn)生

            • 1、前言  在現(xiàn)代電子產(chǎn)品世界中,PCB(印刷電路板)是組成電子產(chǎn)品的重要環(huán)節(jié),很難想象在一臺電子設(shè)備中有不采用PCB的,所以PCB的質(zhì)量如何將對電子產(chǎn)品能否長期正??煽抗ぷ鲙矸浅4蟮挠绊?。提高 PCB的質(zhì)量是電子
            • 關(guān)鍵字: PCB  視覺系統(tǒng)  防止  缺陷    

            基于FPGA的系統(tǒng)易測試性的研究

            • 基于FPGA的系統(tǒng)易測試性的研究,引 言
                現(xiàn)代科技對系統(tǒng)的可靠性提出了更高的要求,而FPGA技術(shù)在電子系統(tǒng)中應(yīng)用已經(jīng)非常廣泛,因此FPGA易測試性就變得很重要。要獲得的FPGA內(nèi)部信號十分有限、FPGA封裝和印刷電路板(PCB)電氣噪聲,這一切使得設(shè)計
            • 關(guān)鍵字: 研究  測試  系統(tǒng)  FPGA  基于  

            基于FPGA的串口屏方案應(yīng)用

            • 本文主要介紹一個基于串口屏、M0單片機、微打模塊、讀卡模塊的充電樁應(yīng)用方案。此方案模擬了真實充電樁的絕大部分功能,通過使用本方案,設(shè)備制造商便能在短周期內(nèi)完成整個充電樁的設(shè)計,迅速占領(lǐng)市場并取得成功。
            • 關(guān)鍵字: FPGA  單片機  TinyM0-CAN  201109  

            使用Xilinx公司的Spartan-6 FPGA作DDR芯片測試

            • 使用Xilinx公司的Spartan-6 FPGA系列芯片所提供的MCB,在生成控制模塊時設(shè)置不同參數(shù),可以輕而易舉的實現(xiàn)對不同型號的DDR存儲芯片的測試,數(shù)據(jù)率可高達800Mb/s以上。由于時間利用率比使用計算機主板測試DDR芯片高得多,所以可以極大地節(jié)約測試時間。
            • 關(guān)鍵字: Xilinx  FPGA  DDR  201109  

            Altera推出業(yè)界第一款Serial RapidIO Gen2解決方案

            • 2011年9月27號,北京——Altera公司 (NASDAQ: ALTR) 今天宣布,開始提供業(yè)界第一款基于Serial RapidIO Gen2 FPGA的解決方案,進一步提高下一代3G和4G無線基站的帶寬,鏈路更加靈活。Altera成功的實現(xiàn)了Stratix IV GX FPGA中的RapidIO MegaCore 功能IP內(nèi)核與集成器件技術(shù)公司 (IDT) Serial RapidIO Gen 2交換機的互操作性。Altera成熟的Serial RapidIO Gen2解決方案為高性能通信系統(tǒng)中
            • 關(guān)鍵字: Altera  FPGA  

            基于FPGA的信號發(fā)生器設(shè)計

            • 基于FPGA的信號發(fā)生器設(shè)計,以FPGA 芯片為載體, 通過QuartusII 的LPM_ROM 模塊和VHDL 語言為核心設(shè)計一個多功能信號發(fā)生器,根據(jù)輸入信號的選擇可以輸出遞增鋸齒波、遞減鋸齒波、三角波、階梯波和方波等5 種信號,通過QuartusII 軟件進行波形仿
            • 關(guān)鍵字: 設(shè)計  信號發(fā)生器  FPGA  基于  

            LabVIEW FPGA模塊實現(xiàn)FIFO深度設(shè)定

            • 為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來的數(shù)據(jù)不連續(xù)問題,結(jié)合LabVIEWFPGA的編程特點和DMA FIFO的工作原理,提出了一種設(shè)定FIFO深度的方法。對FIFO不同深度的實驗表明,采用該方法設(shè)定的FIFO深度能夠
            • 關(guān)鍵字: LabVIEW  FPGA  FIFO  模塊    

            FPGA與GPS_OEM板的UART設(shè)計

            • 本文提出了一種基于FPGA的嵌入式UART模塊化設(shè)計方法,通過UART實現(xiàn)了FPGA與GPS_OEM板之間的數(shù)據(jù)通信。基于VHDL語言,通過有限狀態(tài)機,將UART模塊集成到FPGA上,給出了系統(tǒng)的功能仿真結(jié)果,驗證了系統(tǒng)設(shè)計的正確性,增強了設(shè)計的靈活性。
            • 關(guān)鍵字: FPGA  UART  201109  

            基于MCU+FPGA的航空總線接口板測試平臺設(shè)計

            • 設(shè)計的航空總線接口板測試平臺滿足通用設(shè)備CAN總線、RS485差分電平異步總線及LVDS差分電平異步總線數(shù)據(jù)傳輸要求。通過對各模塊功能分析,在仿真軟件中通過功能仿真驗證,并在工程應(yīng)用中得到驗證。此設(shè)計通過RS232接口連接上位機實現(xiàn)數(shù)據(jù)收發(fā),并能對CAN總線及高速異步總線參數(shù)進行動態(tài)配置。
            • 關(guān)鍵字: CAN  FPGA  MCU  201109  

            SDRAM接口時序和PCB布線長度的分析

            • 隨著系統(tǒng)復(fù)雜度的提高,SDRAM的運行速度也越來越快,對PCB布線帶來了影響,僅僅使用一些經(jīng)驗法則來設(shè)計SDRAM走線并不能完全保證系統(tǒng)的穩(wěn)定。不同的芯片有不同的時序要求,對走線的要求也是有差別,需要從理論上分析SDRAM時序和PCB走線長度之間的關(guān)系。
            • 關(guān)鍵字: SDRAM  PCB  201109  

            DSP和FPGA構(gòu)成的感應(yīng)發(fā)電機勵磁控制系統(tǒng)

            FPGA低功耗設(shè)計的小提示

            • FPGA的功耗高度依賴于用戶的設(shè)計,沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低,如同其它多數(shù)事物一樣,降低功耗的...
            • 關(guān)鍵字: 低功耗  FPGA  
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            fsp:fpga-pcb介紹

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            歡迎您創(chuàng)建該詞條,闡述對fsp:fpga-pcb的理解,并與今后在此搜索fsp:fpga-pcb的朋友們分享。    創(chuàng)建詞條

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