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【E課題】PWM“死區(qū)”的概念及基本原理
- 死區(qū)就是在上半橋關(guān)斷后，延遲一段時間再打開下半橋或在下半橋關(guān)斷后，延遲一段時間再打開上半橋，從而避免功率元件燒毀?！ WM脈寬調(diào)制 在電力電子中，最常用的就是整流和逆變。這就需要用到整流橋和逆變橋。以兩電平為例，每個橋臂上有兩個電力電子器件，比如igbt。這兩個igbt不能同時導(dǎo)通，否則就會出現(xiàn)短路的情況。因此，設(shè)計帶死區(qū)的PWM波可以防止上下兩個器件同時導(dǎo)通。也就是說，當一個器件導(dǎo)通后關(guān)閉，再經(jīng)過一段死區(qū)，這時才能讓另一個導(dǎo)通?！ ∷绤^(qū),簡單解釋 通常,大功率電機、變頻器等，末端都是由大功率管
- 關(guān)鍵字： PWM IGBT
【詳解】FPGA：深度學(xué)習(xí)的未來？
- 摘要 最近幾年數(shù)據(jù)量和可訪問性的迅速增長，使得人工智能的算法設(shè)計理念發(fā)生了轉(zhuǎn)變。人工建立算法的做法被計算機從大量數(shù)據(jù)中自動習(xí)得可組合系統(tǒng)的能力所取代，使得計算機視覺、語音識別、自然語言處理等關(guān)鍵領(lǐng)域都出現(xiàn)了重大突破。深度學(xué)習(xí)是這些領(lǐng)域中所最常使用的技術(shù)，也被業(yè)界大為關(guān)注。然而，深度學(xué)習(xí)模型需要極為大量的數(shù)據(jù)和計算能力，只有更好的硬件加速條件，才能滿足現(xiàn)有數(shù)據(jù)和模型規(guī)模繼續(xù)擴大的需求?，F(xiàn)有的解決方案使用圖形處理單元(GPU)集群作為通用計算圖形處理單元(GPGPU)，但現(xiàn)場可編程門陣列(FPGA)提供
- 關(guān)鍵字： FPGA GPU
工程師經(jīng)驗：電路設(shè)計的14個誤區(qū)
- 自動布線必然要占用更大的PCB面積，同時產(chǎn)生比手動布線多好多倍的過孔，在批量很大的產(chǎn)品中，PCB廠家降價所考慮的因素除了商務(wù)因素外，就是線寬和過孔數(shù)量，它們分別影響到PCB的成品率和鉆頭的消耗數(shù)量，節(jié)約了供應(yīng)商的成本... 現(xiàn)象一：這板子的PCB設(shè)計要求不高，就用細一點的線，自動布吧 點評：自動布線必然要占用更大的PCB面積，同時產(chǎn)生比手動布線多好多倍的過孔，在批量很大的產(chǎn)品中，PCB廠家降價所考慮的因素除了商務(wù)因素外，就是線寬和過孔數(shù)量，它們分別影響到PCB的成品率和鉆頭的消耗數(shù)量，節(jié)約
- 關(guān)鍵字： 電路 PCB FPGA
基于FPGA的VGA顯示系統(tǒng)的設(shè)計與實現(xiàn)
- 針對VGA(視頻圖形陣列)接口顯示器的檢測需求，設(shè)計了一種基于Altera FPGA的VGA顯示系統(tǒng)。詳細介紹了VGA顯示的原理，采用硬件描述語言Verilog完成了VGA顯示所需的驅(qū)動時序和圖像存儲相關(guān)模塊的設(shè)計，并對整個系統(tǒng)進行了綜合仿真，驗證了設(shè)計的正確性。仿真與測試結(jié)果表明，該設(shè)計可以在簡單的情況下實現(xiàn)圖像或字符顯示，節(jié)約了硬件成本，還可以滿足不同顯示標準的需要。
- 關(guān)鍵字： VGA 圖像顯示 FPGA 設(shè)計實現(xiàn) 201603
AGM耗時3年成功逆襲 成FPGA市場上最大黑馬
- 2015年國內(nèi)的半導(dǎo)體行業(yè)可謂風(fēng)生水起，國家意志主導(dǎo)的大基金大開大合，紫光為首的國內(nèi)大佬在國外并購頻頻，以海思為首的國內(nèi)IC設(shè)計公司開始在國際市場上擁有話語權(quán)，而在一向由美國四大公司控盤的FPGA領(lǐng)域，中國公司也躍躍欲試，京微雅格、高云、同創(chuàng)國芯等國內(nèi)企業(yè)瞄準了軍工、宇航、機器人等領(lǐng)域，意圖進軍高端FPGA領(lǐng)域，Intel收購行業(yè)內(nèi)最大公司Altera，意圖整合數(shù)據(jù)中心FPGA芯片市場，而在這個大佬云集的行業(yè)，一家名不見經(jīng)傳的國內(nèi)企業(yè)，卻在悄悄地蠶食Altera和Lattice的中低端FPGA市場份額
- 關(guān)鍵字： AGM FPGA
萊迪思半導(dǎo)體不斷加強適用于低功耗、小尺寸FPGA的設(shè)計工具套件
- 萊迪思半導(dǎo)體公司，客制化智能互連解決方案市場的領(lǐng)先供應(yīng)商，今日宣布Lattice Diamond?設(shè)計工具套件的最新升級版——3.7版本，現(xiàn)已上市。該版本支持更多的萊迪思器件并包含性能增強，可幫助客戶以盡可能最小的尺寸、功耗和成本基于萊迪思FPGA設(shè)計解決方案?！ attice Diamond設(shè)計軟件是一套完整的FPGA設(shè)計工具，具備易于使用的界面、高效的設(shè)計流程、卓越的設(shè)計探索等特性。3.7版本主要的全新特性包括對于ECP5?和MachXO2?/MachXO3? FP
- 關(guān)鍵字： 萊迪思 FPGA
萊迪思半導(dǎo)體為ECP5 FPGA產(chǎn)品系列添加新成員
- 萊迪思半導(dǎo)體公司，客制化智能互連解決方案市場的領(lǐng)先供應(yīng)商，今日宣布低功耗、小尺寸，用于互連和加速應(yīng)用的ECP5™ FPGA產(chǎn)品系列迎來了新成員。本次新增的產(chǎn)品與ECP5 FPGA的引腳完全兼容，使得OEM廠商能夠?qū)崿F(xiàn)無縫升級，滿足工業(yè)、通信和消費電子等市場上不斷變化的接口需求。 ECP5-5G 萊迪思的ECP5-5G產(chǎn)品系列獨家支持5G SERDES和高達85K LUT，并采用小尺寸10x10 mm封裝。ECP5-5G器件支持多種5G協(xié)議，包括PCI Express Gen 2
- 關(guān)鍵字： 萊迪思 FPGA
Xilinx 發(fā)布數(shù)據(jù)中心生態(tài)系統(tǒng)投資計劃致力于進一步壯大云計算及NFV加速解決方案
- 賽靈思公司(Xilinx, Inc.)今天宣布一項新的數(shù)據(jù)中心生態(tài)系統(tǒng)投資計劃，并由賽靈思旗下的投資機構(gòu)“Xilinx 技術(shù)投資 (Xilinx Technology Ventures)”全權(quán)執(zhí)行。該計劃主要用于技術(shù)投資，以豐富賽靈思的數(shù)據(jù)中心產(chǎn)品與服務(wù)，并促進行業(yè)創(chuàng)新，加速產(chǎn)品上市進程及降低總擁有成本。新計劃專門針對新興工作負載應(yīng)用解決方案，如機器學(xué)習(xí)、圖像及視頻處理、數(shù)據(jù)分析、存儲數(shù)據(jù)庫加速以及網(wǎng)絡(luò)加速等。 作為該計劃的一部分，賽靈思近期完成了數(shù)據(jù)中心生態(tài)系統(tǒng)的首次投
- 關(guān)鍵字： Xilinx FPGA
如何更好的設(shè)計PWM DC-DC系統(tǒng)？
- 在直流電路當中，使用的較多的技術(shù)非DC-DC莫屬，它能夠使電壓值的電能轉(zhuǎn)變?yōu)榱硪粋€電壓值電能。電源設(shè)計當中的DC-DC變換器模塊就是基于這種技術(shù)，它能夠簡化電路的設(shè)計，并且縮短產(chǎn)品的研制周期。與PWM結(jié)合之后，DC-DC就能更好的對模擬電路進行控制。那么如何能更好的完成PWM DC-DC系統(tǒng)的設(shè)計呢? PWM DC-DC的組成核心電路共分兩大部分，分別是ramp/pulse oscillator和error amplifier.ramp/pulse oscillator的難點在于造出一個具有高線
- 關(guān)鍵字： PWM DC-DC
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