fpga+dsp 文章進(jìn)入fpga+dsp技術(shù)社區(qū)

基于FPGA的誤碼測試儀

2004年4月A版摘要：本文提出了一種基于FPGA的誤碼測試方案，并在FPGA上實現(xiàn)了其功能。該方案不僅納入了“同步保護(hù)”的思想，同時對誤碼率量級的判斷也提出了一種簡化而又可行的方法。關(guān)鍵詞：誤碼測試；FPGA；m序列；同步　　在數(shù)字通信系統(tǒng)中，為了檢測系統(tǒng)的性能，通常使用誤碼分析儀對其誤碼性能進(jìn)行測量。誤碼分析儀給工程實際應(yīng)用帶來了極大的便利，比如它有豐富的測試接口和測試內(nèi)容，并能將結(jié)果直觀、準(zhǔn)確的顯示出來。但是它的價格昂貴，并且通常需要另加外部輔助長線驅(qū)動電路才能與某些系統(tǒng)接
關(guān)鍵字： FPGA 嵌入式

2004年，賽靈思成立20周年慶典

　　2004年，賽靈思成立20周年慶典。通過表彰員工、用戶、股東、合作伙伴和當(dāng)?shù)厣鐓^(qū)，公司慶祝了它的20歲生日。
關(guān)鍵字：賽靈思 FPGA

基于DSP的自適應(yīng)數(shù)字抗噪聲模塊

摘要：本文介紹了一種基于專用DSP芯片，采用獨特的軟件抗噪聲算法的數(shù)字抗噪聲模塊，實現(xiàn)了在120分貝噪聲環(huán)境中話音的清晰度不小于98。此模塊已成功應(yīng)用于我國機載通信設(shè)備中。關(guān)鍵詞：數(shù)字信號處理(DSP)；噪聲概述國內(nèi)目前第三代抗噪聲產(chǎn)品是利用動態(tài)降噪(DNR)技術(shù)。DNR技術(shù)是通過變化的話音峰值動態(tài)地調(diào)節(jié)輸出話音開關(guān)，從而達(dá)到降噪的目的。它雖然是目前較好的一種抗噪聲模擬處理技術(shù)，但也存在一些局限性，包括輕符音掉字和強音噪聲拖尾；降噪效果偏重于低頻；降噪完全采用硬件電路實現(xiàn)，調(diào)試和維修比較麻煩等
關(guān)鍵字：數(shù)字信號處理(DSP) 噪聲模塊

橢圓曲線加密的硬件實現(xiàn)

摘要：橢圓曲線加密是一種目前已知的所有公鑰密碼體制中能夠提供最高比特強度的一種公鑰體制。在FPGA實現(xiàn)橢圓曲線加密系統(tǒng)時，基于GF(2)的多項式有限域中的乘法、求逆運算是其中的兩大難點。本文提供了一種橢圓曲線加密的FPGA實現(xiàn)的結(jié)構(gòu)，著重討論了基于GF(2)的多項式有限域中的乘法、求逆運算的實現(xiàn)，并與軟件實現(xiàn)的性能進(jìn)行了比較。關(guān)鍵詞： FPGA；多項式有限域；橢圓曲線加密系統(tǒng)加密的安全性從數(shù)論的角度來說，任何公鑰密碼系統(tǒng)都建立在一個NP(無法處理的問題)的基礎(chǔ)上，即對于特定的問題，沒有辦法找到一個
關(guān)鍵字： FPGA 多項式有限域橢圓曲線加密系統(tǒng)

WCDMA速率適配算法的FPGA實現(xiàn)

摘要：為了支持多媒體業(yè)務(wù)的傳輸，第三代移動通信WCDMA系統(tǒng)采用了獨特的編碼復(fù)接方案，同時也加大了系統(tǒng)復(fù)雜度，并引入了較長的處理時延。速率適配算法是業(yè)務(wù)復(fù)用方案的核心算法。本文具體提出了在FPGA中進(jìn)行模塊合并、產(chǎn)生鑿孔圖樣進(jìn)行比特積攢搬移的實現(xiàn)方案，縮短了處理延時，大大提高了系統(tǒng)的處理能力。關(guān)鍵詞：編碼復(fù)接；速率適配；FPGA；鑿孔圖樣；保留比特搬移引言隨著因特網(wǎng)爆炸性的增長以及各種無線業(yè)務(wù)需求的增加，傳統(tǒng)的無線通信網(wǎng)已經(jīng)越來越無法適應(yīng)人們的需要。因此，以大容量、高數(shù)據(jù)率和承載多媒體業(yè)務(wù)為目的的
關(guān)鍵字： FPGA 保留比特搬移編碼復(fù)接速率適配鑿孔圖樣

virterx技術(shù)白皮書

平臺FPGA的興起隨著Virtex系列在片上系統(tǒng)（SoC）應(yīng)用中的廣泛應(yīng)用,賽靈思（Xilinx）公司引入了平臺FPGA（Platform FPGA）的概念。作為領(lǐng)先的可編程邏輯供應(yīng)商，賽靈思公司利用其基于Virtex的支持可編程邏輯、I/O和計算處理的多功能器件，幫助業(yè)界涉足并確立了基于FPGA的SoC設(shè)計方法。通過實現(xiàn)大量基于FPGA的RISC處理器和處理器內(nèi)核，賽靈思在這方面已經(jīng)證實了自己的實力。最早的例子是于1991年實現(xiàn)Philip Freidin的RISC4005/R16 FPGA處理器。Vi
關(guān)鍵字： FPGA Xilinx

FPGA實現(xiàn)的FIR算法在汽車動態(tài)稱重儀表中的應(yīng)用

摘要：本文介紹了用FPGA實現(xiàn)的FIR算法，并對這種算法應(yīng)用于汽車動態(tài)稱重儀表中的結(jié)果做了分析。實踐證明此算法用于動態(tài)稱重具有良好的效果。關(guān)鍵詞： FPGA；FIR；動態(tài)稱重引言車輛在動態(tài)稱重時，作用在平臺上的力除真實軸重外，還有許多因素產(chǎn)生的干擾力，如：車速、車輛自身諧振、路面激勵、輪胎驅(qū)動力等，給動態(tài)稱重實現(xiàn)高精度測量造成很大困難。若在消除干擾的過程中采用模擬方法濾波，參數(shù)則不能過大，否則將產(chǎn)生過大的延遲導(dǎo)致不能實現(xiàn)實時處理，從而造成濾波后的信號仍然含有相當(dāng)一部分的噪聲。所以必須采用數(shù)字濾波消
關(guān)鍵字： FIR FPGA 動態(tài)稱重

英特爾成功開發(fā)480Mbps之UWB收發(fā)器

日前(4月7日～8日)在甫結(jié)束的日本2004年英特爾IDF論壇中，英特爾首度展示了480Mbps的UWB無線傳輸，打破該公司在去年實現(xiàn)的252Mbps紀(jì)錄。據(jù)日經(jīng)BP社消息，英特爾是采用FPGA設(shè)計LSI收發(fā)器，這代表著可以使用CMOS技術(shù)，以低成本生無線USB收發(fā)器，無線傳輸技術(shù)是多頻帶OFDM（版本0.8），所用頻率3GHz～5GHz，使用3個528MHz的頻帶
關(guān)鍵字：英特爾 FPGA Wisair

2004年，SEED成功推出SEED-DTK系列教學(xué)實驗箱

　　2004年，SEED成功推出SEED-DTK系列教學(xué)實驗箱，獨特的創(chuàng)意成功開創(chuàng)DSP教學(xué)新概念。
關(guān)鍵字： SEED DSP

全數(shù)字鎖相環(huán)的設(shè)計

摘要：本文在說明全數(shù)字鎖相環(huán)的基礎(chǔ)上，提出了一種利用FPGA設(shè)計一階全數(shù)字鎖相環(huán)的方法，并給出了關(guān)鍵部件的RTL可綜合代碼，并結(jié)合本設(shè)計的一些仿真波形詳細(xì)描述了數(shù)字鎖相環(huán)的工作過程，最后對一些有關(guān)的問題進(jìn)行了討論。關(guān)鍵詞：全數(shù)字鎖相環(huán)；DPLL；FSK；FPGA 引言鎖相環(huán)(PLL)技術(shù)在眾多領(lǐng)域得到了廣泛的應(yīng)用。如信號處理，調(diào)制解調(diào)，時鐘同步，倍頻，頻率綜合等都應(yīng)用到了鎖相環(huán)技術(shù)。傳統(tǒng)的鎖相環(huán)由模擬電路實現(xiàn)，而全數(shù)字鎖相環(huán)(DPLL)與傳統(tǒng)的模擬電路實現(xiàn)的PLL相比，具有精度高且不受溫度和電壓影響，環(huán)路
關(guān)鍵字： DPLL FPGA FSK 全數(shù)字鎖相環(huán)

2003年，SEED-DEC系列DSP模板面市

　　2003年，SEED-DEC系列DSP模板面市，一種功能、接口齊全DSP模板為行業(yè)客戶應(yīng)用提供最大空間。
關(guān)鍵字： SEED DSP

2003年，Wim Roelandts 成為賽靈思董事會主席

　　2003年，Wim Roelandts 成為董事會主席。Bernie Vonderschmitt 離職：公司的最后一個創(chuàng)始人為我們留下了寶貴的財富。
關(guān)鍵字：賽靈思 FPGA

2003年，賽靈思推出 Spartan-3 系列產(chǎn)品

　　2003年，推出 Spartan-3 系列產(chǎn)品。世界上首款 90nm FPGA 也是世界上成本最低的 FPGA。Spartan-3 技術(shù)讓我們領(lǐng)先競爭者一大步，并使我們處于領(lǐng)先高級半導(dǎo)體制造商的地位。
關(guān)鍵字：賽靈思 FPGA Spartan-3

利用Matlab和Simulink對DSP進(jìn)行系統(tǒng)級的設(shè)計方法

摘要：本文介紹了利用Matlab和 Simulink中 Developer's Kit for TI DSP工具對DSP進(jìn)行系統(tǒng)級設(shè)計的方法。關(guān)鍵詞：DSP；Matlab；TI；CCS；IDE引言傳統(tǒng)的DSP設(shè)計開發(fā)流程分為兩個部分：開發(fā)設(shè)計和產(chǎn)品實現(xiàn)。在開發(fā)設(shè)計部分完成算法開發(fā)和方案設(shè)計，產(chǎn)品的實現(xiàn)用來驗證開發(fā)設(shè)計的正確性，通常是在不同的部門相互獨立地完成。這樣的開發(fā)流程存在許多問題，如相互之間的協(xié)作，系統(tǒng)范圍內(nèi)的算法測試，系統(tǒng)設(shè)計的錯誤不能被及時發(fā)現(xiàn)等。利用Matlab和Simulink系統(tǒng)級的設(shè)計方
關(guān)鍵字： CCS DSP IDE Matlab TI