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DSP/BIOS中的IO設(shè)備驅(qū)動編程技術(shù)
- DSP/BIOS中的IO設(shè)備驅(qū)動編程技術(shù),介紹了DSP/BIOS中I/O設(shè)備驅(qū)動程序的編寫,并給出了一個在TMS320C5402 DSK上開發(fā)語音處理程序的實例。 關(guān)鍵詞:數(shù)字信號處理器(DSP) 實時操作系統(tǒng) I/O設(shè)備驅(qū)動 應(yīng)用程序接口(API)近年來,隨著信息技術(shù)的飛速發(fā)展
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數(shù)字信號處理器(DSP) 實時操作系統(tǒng) I/O設(shè)備驅(qū)動 應(yīng)用程序接口(API)
近年來
隨著信息技術(shù)的飛速發(fā)展 DSP在航空、航天、雷達、通信、消費類電子設(shè)備等方面都得到了廣泛應(yīng)用 同時 DSP的運算能力也越大越強大 TI公司新推出的TMS320C6400系列的運算能力可以達到8800MIPS。這些都要求開發(fā)DSP的應(yīng)用程序要縮短開發(fā)時間 增加軟件的可編護性和可重用性。語音壓縮、語音識別、圖像處理等方面的應(yīng)用要求DSP的開發(fā)盡可能簡單 還要求代碼的執(zhí)行效率高。DSP/BIOS是T
FPGA實現(xiàn)的任意波形發(fā)生器的設(shè)計
- 運用DDS原理,進行任意波形發(fā)生器的設(shè)計,使得任意波形發(fā)生器兼顧DDS的優(yōu)點。設(shè)計中通過實現(xiàn)DDS模塊與單片機接口的控制部分將頻率控制字由單片輸入到輸入寄存器模塊,由相位累加器模塊對輸入頻率控制字進行累加運算,輸出作為雙口RAM的讀地址線,讀數(shù)據(jù)線上即輸出了波形幅度量化數(shù)據(jù)。其中雙口RAM的內(nèi)容由單片機進行更新,從而實現(xiàn)任意波形的發(fā)生。本設(shè)計中的相位累加器采用了8級流水線結(jié)構(gòu)借助前5級的超前進位的方法,使得編譯的最高工作頻率由317.97MHz提高到336.7 MHz,實現(xiàn)了任意波形的發(fā)生,節(jié)約了成本,提
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面向?qū)ΨQ體系結(jié)構(gòu)的FPGA仿真模型研究
- 緩慢的軟件模擬器給體系結(jié)構(gòu)研究帶來了極大不便,F(xiàn)PGA硬件仿真的模擬速度很快,但仿真系統(tǒng)的規(guī)模嚴重受限于FPGA的容量。較大規(guī)模的體系結(jié)構(gòu)系統(tǒng)仿真采用多片F(xiàn)PGA互連,不僅增加了設(shè)計的復(fù)雜性,也增加成本。因此提出一種面向?qū)ΨQ體系結(jié)構(gòu)的FPGA仿真模型。經(jīng)仿真系統(tǒng)評估,其仿真系統(tǒng)能夠增大FPGA芯片的仿真規(guī)模,減少仿真系統(tǒng)對FPGA資源的需求,有效支持在有限的FPGA資源上進行大規(guī)模對稱體系結(jié)構(gòu)仿真研究。
- 關(guān)鍵字: FPGA 對稱 仿真 模型研究
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