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            FPGA研發(fā)之道(23)-控制(上)

            •   本質(zhì)上說,F(xiàn)PGA的模塊設計就是將輸入轉(zhuǎn)化成想要得到的輸出結(jié)果。而除了某些簡單模塊,即在當拍內(nèi)完成,即將輸入進行邏輯操作后,再輸出。(如簡單加法器等)。其余大部分的設計需要通過時序邏輯和組合邏輯混合實現(xiàn),時序邏輯帶來就是延遲起效的問題,舉例說,如實現(xiàn)某個信號(start)起效后,接下來五個周期需要分別進行五種操作,分別是op0,op1,op2,op3,op4 等等。如何進行控制,這就是每個工程師要面對的問題。   對于簡單控制,分別可以采用計數(shù)和移位寄存器的方式來解決問題。而對于較為復雜的控制,則需
            • 關鍵字: FPGA  狀態(tài)機  計數(shù)器  

            FPGA研發(fā)之道(22)-交換矩陣

            •   如果在FPGA設計中,需要多端口,大數(shù)據(jù)量的交換,那么交換矩陣則是一個不錯的實現(xiàn)方案。交換矩陣使用的目的主要有幾個,一,靈活的端口轉(zhuǎn)發(fā)。通過交換矩陣靈活實現(xiàn)數(shù)據(jù)流的靈活交換,減少外部負責控制。 二,高效的轉(zhuǎn)發(fā)效率,交換矩陣能夠?qū)崿F(xiàn)通常單一總線不能達到的轉(zhuǎn)發(fā)效率,滿足高吞吐量的系統(tǒng)的需要。三,系統(tǒng)設計以交換矩陣為中心,便于IP集成和模塊復用。   交換矩陣的實現(xiàn)方案較為復雜,最早的交換沿襲了共享總線式的架構,因此對于某個端口需要傳輸,則其他端口只能阻塞,等待總線空閑后再進行傳輸。而交換矩陣則是一個全互
            • 關鍵字: FPGA  交換矩陣  

            TM1300 DSP系統(tǒng)以太網(wǎng)接口的設計

            •   1 概述   隨著網(wǎng)絡技術、多媒體技術的飛速發(fā)展,基于IP網(wǎng)絡的多媒體應用越來越廣泛。TM1300是Philips公司推出的一款高性能多媒體數(shù)字信號處理器芯片,適合于實時性強的音視頻處理應用,可廣泛應用于會議電視、可視電話、遠程圖像監(jiān)控等應用場合。具有廣闊的應用前景。   根據(jù)具體的基于IP網(wǎng)絡上的多媒體應用系統(tǒng)的需要,采集的音視頻數(shù)據(jù)經(jīng)壓縮處理后,一般要傳送到遠程終端或控制中心,這時就需要解決DSP應用系統(tǒng)與IP網(wǎng)絡接口的問題。   考慮到國內(nèi)局域網(wǎng)大部分是以太網(wǎng),隨著交換式網(wǎng)絡、寬帶網(wǎng)絡的發(fā)
            • 關鍵字: TM1300  DSP  CS8900A  

            TMS320LF2407與LAN91C111型嵌入式以太網(wǎng)接口電路的實現(xiàn)

            •   嵌入式以太網(wǎng)不僅可用于工業(yè)現(xiàn)場實現(xiàn)現(xiàn)場節(jié)點的自動上網(wǎng)功能,而且還可以用于信息家電的以太網(wǎng)接口實現(xiàn)遠程控制,具有很好的發(fā)展前景。文章介紹基于TMS320LF2407型DSP的嵌入式系統(tǒng)與LAN91C111型自適應10Mb/s/100Mb/s嵌入式以太網(wǎng)控制的接口電路及軟硬件實現(xiàn)方法。   1 引言   目前關于嵌入式以太網(wǎng)的設計方案不是很多,其中大多是基于單片機的,缺點是速度慢、成本太高。DSP作為一種特殊的嵌入式微處理器系統(tǒng),具有嵌入的協(xié)處理器和用于快速數(shù)據(jù)處理的并行數(shù)據(jù)通道,在嵌入式網(wǎng)絡設備中引
            • 關鍵字: 以太網(wǎng)  DSP  LAN91C111  

            基于MPSoC的以太網(wǎng)接口設計與實現(xiàn)

            •   研究了以太網(wǎng)在多核系統(tǒng)中的數(shù)據(jù)通訊,設計了以太網(wǎng)IP核到MPSoC網(wǎng)絡資源的硬件接口。闡述了設計中各模塊的實現(xiàn)功能和設計方法,通過仿真和FPGA驗證結(jié)果表明,以太網(wǎng)接口數(shù)據(jù)通訊具有實時和高吞吐率。實現(xiàn)了多核系統(tǒng)與網(wǎng)絡數(shù)據(jù)的信息傳遞,硬件設計結(jié)構簡單、性能穩(wěn)定可靠。   隨著電子信息技術發(fā)展,網(wǎng)絡通信在日常生活中應用越來越廣泛,以太網(wǎng)技術經(jīng)歷了10 Mbit·s-1到10 Gbit·s-1的發(fā)展歷程。當前電子設備網(wǎng)絡化、多媒體技術、數(shù)字圖像處理技術成為研究的熱點,片上多核系
            • 關鍵字: MPSoC  以太網(wǎng)  FPGA  

            東亞LTE設備需求強勁 FPGA業(yè)者喜迎4G商機

            •   東亞地區(qū)長程演進計畫(LTE)設備需求,驅(qū)動現(xiàn)場可編程閘陣列(FPGA)業(yè)者營收攀升。2014年中國大陸及臺灣陸續(xù)啟動LTE商轉(zhuǎn),帶動龐大的LTE設備購置及基礎建設投資潮,深耕通訊領域有成的FPGA業(yè)者也趁著這波潮流搭上順風車,大發(fā)LTE財。   賽靈思(Xilinx)亞太區(qū)銷售與市場副總裁楊飛表示,中國大陸于2013年底發(fā)放LTE營運牌照后,業(yè)界都在引頸期盼這個全球最大的內(nèi)需市場將為LTE供應鏈帶來一波新氣象;果不其然,2014年中國大陸三大電信營運商陸續(xù)啟動LTE商轉(zhuǎn),加上臺灣LTE網(wǎng)路也隨后開
            • 關鍵字: Xilinx  FPGA  LTE  

            進軍數(shù)據(jù)中心應用 FPGA業(yè)者走合作策略

            •   因應網(wǎng)路速度的提升與資料呈現(xiàn)暴炸性的成長,資料中心無疑是IT領域下一波決戰(zhàn)的主戰(zhàn)場,這從網(wǎng)路服務業(yè)者,如Google、臉書與亞馬遜近期的動作來看,就能窺見端倪。    ?   Xilinx亞太區(qū)銷售及市場副總裁楊飛   就晶片供應商而言,過去一直以來,大多都是CPU與GPU業(yè)者扮演主導角色,如今FPGA(可編程邏輯閘陣列)業(yè)者們,也對該應用領域有相當積極的動作。Xilinx亞太區(qū)銷售及市場副總裁楊飛便表示,伺服器業(yè)者們都在思考如何降低功耗的問題,再加上伺服器或是資料中心本身也都會
            • 關鍵字: Altera  FPGA  GPU  

            DSP編程技巧之28---答疑解惑哪家強之(3)

            •   答疑解惑哪家強?當屬我們EEPW最強。。。接下來繼續(xù)我們的答疑解惑。   17. 如何把RTS庫添加到工程文件中?   如果使用命令行腳本的方式添加庫文件,則使用-l <庫文件名>來添加即可。   在圖形化界面下,填加RTS庫文件的選項在不同版本的CCS中是不一樣的,在此把它們一一列出。   在CCS6.x和5.x版本下:   在工程管理器中的工程名上點擊右鍵,選擇"properties",然后切換到如下視圖。   在CCS4.x版本下:   在CCS3.
            • 關鍵字: DSP  CCS  C/C++  

            多傳感器智能輪椅的硬件系統(tǒng)設計

            •   0 引言   智能輪椅的任務是安全、便捷地把用戶送到目的地,完成既定任務。在運動過程中,輪椅既需要接受用戶的指令,又需結(jié)合環(huán)境信息啟動自身避障、導航等功能模塊,與移動機器人不同的是,在使用過程中,輪椅與用戶成為一個協(xié)同工作的系統(tǒng)。這就要求在設計之初就把人這個因素納入考慮之中,所以,安全、舒適和容易操作應成為智能輪椅設計中最重要的因素;使用者身體能力的差異決定了智能輪椅需被設計為一個功能多元化,能滿足多種層次需要的電子系統(tǒng),而模塊化最能體現(xiàn)系統(tǒng)多功能化的特征,每個用戶都能根據(jù)其自身殘障類型和程度選擇適
            • 關鍵字: 傳感器  DSP  TMS320  

            基于FPGA的多傳感器管道內(nèi)漏磁檢測系統(tǒng)

            •   針對傳統(tǒng)管道漏磁檢測器檢測精度的不足,提出了新式的基于FPGA的高精度管道漏磁檢測系統(tǒng)設計,以適應813mm管徑的管道檢測任務。主要介紹了系統(tǒng)邏輯設計,實現(xiàn)了多達400路傳感器漏磁檢測信號的采集與存儲。該設計融合了多種總線協(xié)議,可有效解決管道漏磁檢測中的采集速率、功耗和精度的問題。經(jīng)實驗驗證,方案切實可行,為設計高精度管道漏磁檢測系統(tǒng)提供了新的解決方案。   基于FPGA的多傳感器管道內(nèi)漏磁檢測系統(tǒng).pdf
            • 關鍵字: FPGA  傳感器  

            基于路徑延時匹配的硬件IP核知識產(chǎn)權保護方法

            •   摘要:隨著集成電路產(chǎn)業(yè)的迅速發(fā)展,集成電路設計的安全性越來越受重視,電路設計盜用等知識產(chǎn)權(IP)侵權行為嚴重損害了設計者和消費者的權益,阻礙了集成電路產(chǎn)業(yè)的發(fā)展。本文提出了一種有效保護IP核的方法,通過設計一個保護電路,控制功能電路運行結(jié)果的輸出,在消費者未取得合法授權時,功能電路無法正常工作,從而達到了保護電路的目的。本文將該保護方法運用在實際的電路上,進行仿真并驗證了該方法的有效性。   引言   隨著片上系統(tǒng)SoC的迅速發(fā)展,IP復用的知識產(chǎn)權保護問題日益嚴重,危害了設計者和消費者的權益[
            • 關鍵字: IP核  FPGA  寄存器  IP固核  RDY  201412  

            智能工業(yè)促使芯片變革

            •   摘要:制造業(yè)革命需要大量的工業(yè)機器人、PLC、電機,F(xiàn)PGA及模擬芯片廠商需要因應新的工業(yè)需求,推出新型的芯片或模塊解決方案。   機器人需要新型芯片及模組   世界機器人市場   現(xiàn)代工業(yè)正逐漸由“工業(yè)自動化”向“工業(yè)智能化”邁進,傳統(tǒng)制造業(yè)正開啟“智”造之門。實現(xiàn)工業(yè)智能化需要更高安全性、可靠性的工業(yè)以太網(wǎng)、更高精確度的運動控制技術以及馬達控制解決方案等,機器人就是綜合體現(xiàn)這種智能化的設備之一。   據(jù)統(tǒng)計,世界機器人
            • 關鍵字: 機器人  以太網(wǎng)  FPGA  PLC  201412  

            基于TMS320LF2407A DSP的心電監(jiān)護系統(tǒng)分析

            •   引言   隨著社會的發(fā)展和人們生活水平的提高,人們對健康的重視程度日益增加,但是伴隨著生活水平的提高心血管疾病的發(fā)病率不斷攀升。特別是近年來隨著社會老齡化的加劇,心血管疾病成了威脅人類生命的主要疾病,心臟病成了世界上死亡率最高的疾病。鑒于心血管疾病患者日益增多的嚴峻形勢,提高預防和監(jiān)測該疾病的手段勢在必行。而心電信號檢測是發(fā)現(xiàn)心臟病的最直接手段,但目前醫(yī)院用的心電監(jiān)護儀幾乎全部是進口的,價格昂貴,維護費用高,加重了醫(yī)院和患者的經(jīng)濟負擔;因此設計一種便攜、經(jīng)濟的心電監(jiān)護設備具有重要意義。本文設計了一種
            • 關鍵字: TI  DSP  TMS320  

            利用FPGA實現(xiàn)的FFT變換設計

            •   隨著集成電路的飛速發(fā)展,在圖像處理,通信和多媒體等很多領域中,數(shù)字信號處理技術已經(jīng)被廣泛應用。快速傅立葉變換(FFT)算法的提出,使得數(shù)字信號處理的運算時間上面縮短了好幾個數(shù)量級。因此對FFT算法及其實現(xiàn)方法的研究具有很強的理論和現(xiàn)實意義。   1 FFT算法及其實現(xiàn)方法   現(xiàn)場可編程門陣列FPGA是一種可編程使用的信號處理器件,其運算速度高,內(nèi)置高速乘法器可實現(xiàn)復雜累加乘法運算;同時其存儲量大,無需外接存儲器就可實現(xiàn)大量數(shù)據(jù)運算;而且算法實現(xiàn)簡單,通過VHDL編程語言可輕松實現(xiàn)功能開發(fā),縮短了
            • 關鍵字: FPGA  FFT  

            Plunify從Lanza techVentures獲得融資

            •   開創(chuàng)性FPGA軟件供應商Plunify® Pte. Ltd.今日宣布,從早期風險資本投資公司Lanza techVentures獲得一輪融資。   此次所獲投資將被用于發(fā)展Plunify的銷售和技術支持渠道,擴展其市場團隊,以推動專用于FPGA設計的InTimeTM時序收斂加速軟件。Lanza techVentures總經(jīng)理Lucio Lanza將成為Plunify董事會的一員。Lanza techVentures的自由合伙人Mark Templeton將擔任公司顧問。   Lanza t
            • 關鍵字: FPGA  Plunify  時序收斂  
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