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基于CPLD的多路數(shù)據(jù)采集系統(tǒng)的設(shè)計
- 摘要：隨著數(shù)字化生活的到來，數(shù)據(jù)采集系統(tǒng)在日常生活中的應用越來越顯著。模擬信號和數(shù)字信號之間的轉(zhuǎn)換已成為計算機控制系統(tǒng)中不可缺少的環(huán)節(jié)。較傳統(tǒng)數(shù)據(jù)采集系統(tǒng)，以可編程邏輯器件實現(xiàn)的數(shù)據(jù)采集系統(tǒng)具有時鐘頻
- 關(guān)鍵字： CPLD 多路數(shù)據(jù)采集 系統(tǒng)
一種基于CPLD的QDPSK調(diào)制解調(diào)電路設(shè)計
- 為了在CDMA系統(tǒng)中更好地應用QDPSK數(shù)字調(diào)制方式，在分析四相相對移相(QDPSK)信號調(diào)制解調(diào)原理的基礎(chǔ)上，設(shè)計了一種QDPSK調(diào)制解調(diào)電路，它包括串并轉(zhuǎn)換、差分編碼、四相載波產(chǎn)生和選相、相干解調(diào)、差分譯碼和并串轉(zhuǎn)換電路。在MAX+PLUS II軟件平臺上，進行了編譯和波形仿真。綜合后下載到復雜可編程邏輯器件EPM7128SLC84-15中，測試結(jié)果表明，調(diào)制電路能正確選相，解調(diào)電路輸出數(shù)據(jù)與QDPSK調(diào)制輸入數(shù)據(jù)完全一致，達到了預期的設(shè)計要求。
- 關(guān)鍵字： cpld
基于CPLD的高分辨率AD轉(zhuǎn)換電路設(shè)計
- 本次設(shè)計應用V /F轉(zhuǎn)換器實現(xiàn)高分辨率AD轉(zhuǎn)換，具有較高的滿刻度頻率響應、低功耗和較低的非線性度等特點，廣泛應用于儀器儀表對溫度的控制中，滿足對設(shè)定溫度控制穩(wěn)定性的要求。在系統(tǒng)設(shè)計中采用CPLD實現(xiàn)頻率計數(shù)功能，是數(shù)字系統(tǒng)精確測量頻率一種方法:在采樣時間內(nèi)同時對標準頻率信號和被測頻率信號計數(shù)。采樣完成后，把二者的計數(shù)值相比，再乘以標準頻率就可以得到被測頻率的精確值。
- 關(guān)鍵字： CPLD AD轉(zhuǎn)換 高分辨率 電路設(shè)計
基于DSP和MAX1420的高速數(shù)據(jù)采集系統(tǒng)設(shè)計
- 基于DSP和MAX1420的高速數(shù)據(jù)采集系統(tǒng)設(shè)計,1 引言 數(shù)據(jù)采集系統(tǒng)是通信與信息技術(shù)領(lǐng)域中重要的功能模塊，應用廣泛。而傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)大多以單片機或中規(guī)模數(shù)字電路為核心，其模數(shù)轉(zhuǎn)換器(A／D轉(zhuǎn)換器)采樣速率較低。顯然傳統(tǒng)數(shù)據(jù)采集系統(tǒng)不能完全滿足高速
- 關(guān)鍵字： DSP 數(shù)據(jù) 采集 CPLD USB
基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計與實現(xiàn)
- 基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計與實現(xiàn),介紹一種基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)，并詳細闡述了系統(tǒng)的結(jié)構(gòu)和軟硬件的實現(xiàn)方案。
關(guān)鍵詞：高速數(shù)據(jù)采集；CPLD；嵌入式系統(tǒng)Design and Implementation of Highspeed Data Sampling System Ba s - 關(guān)鍵字： 系統(tǒng) 設(shè)計 實現(xiàn) 數(shù)據(jù)采集 高速 嵌入式 基于 CPLD
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