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            利用VHDL語言進行可變速彩燈控制器的設(shè)計
            
                                                            
              
                    	
            • 0引言硬件描述語言(HDL)是相對于一般的計算機軟件語言如C，Pascal而言的。HDL是用于設(shè)計硬件電子系...
              • 
                    	                        
            • 關(guān)鍵字：
                        VHDL  FPGA  CPLD  可變速  彩燈控制器                          
              • 
                   	
            
                    
            
                
            
                                
            
                    
             常用FPGA/CPLD四種設(shè)計技巧
            
                                                            
                                        
              
                    	
            •  常用FPGA/CPLD四種設(shè)計技巧,FPGA/CPLD的設(shè)計思想與技巧是一個非常大的話題，本文僅介紹一些常用的設(shè)計思想與技巧，包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導(dǎo)日
              • 
                    	                        
            • 關(guān)鍵字：
                        技巧  設(shè)計  FPGA/CPLD  常用                          
              • 
                   	
            
                    
            
                
            
                                
            
                    
            基于VHDL/CPLD的I2C串行總線控制器設(shè)計及實現(xiàn)
            
                                                            
              
                    	
            • 分析了I2C串行總線的數(shù)據(jù)傳輸機制，用VHDL設(shè)計了串行總線控制電路，其中包括微處理器接口電路和I2C總線接口電路。采用ModelSim Plus 6.0 SE軟件進行了前仿真和調(diào)試,并在Xilinx ISE 7.1i開發(fā)環(huán)境下進行了綜合、后仿真和CPLD器件下載測試。 結(jié)果表明實現(xiàn)了I2C串行總線協(xié)議的要求。
              • 
                    	                        
            • 關(guān)鍵字：
                        控制器  設(shè)計  實現(xiàn)  總線  串行  VHDL/CPLD  I2C  基于                          
              • 
                   	
            
                    
            
                
            
                                
            
                    
            利用FPGA和CPLD數(shù)字邏輯實現(xiàn)ADC
            
                                                            
              
                    	
            • 數(shù)字系統(tǒng)的設(shè)計人員擅長在其印制電路板上用FPGA和CPLD將各種處理器、存儲器和標(biāo)準(zhǔn)的功能元件粘合在一起來實現(xiàn)數(shù)字設(shè)計。除了這些數(shù)字功能之外，F(xiàn)PGA和CPLD還可以使用LVDS輸入、簡單的電阻電容(RC)電路和一些FPGA或CP
              • 
                    	                        
            • 關(guān)鍵字：
                        FPGA  CPLD  ADC  數(shù)字邏輯                            
              • 
                   	
            
                    
            
                
            
                                
            
                    
            基于單片機及CPLD的B超檢測工裝設(shè)計
            
                                                            
              
                    	
            • 引言  超聲在人體內(nèi)傳播，由于人體各種組織有聲學(xué)的特性差異，超聲波在兩種不同組織界面處會產(chǎn)生反射、折射、散射、繞射、衰減以及聲源與接收器相對運動產(chǎn)生多普勒頻移等物理特性。應(yīng)用不同類型的超聲診斷儀，采用各
              • 
                    	                        
            • 關(guān)鍵字：
                        工裝  設(shè)計  檢測  CPLD  單片機  基于                          
              • 
                   	
            
                    
            
                
            
                                
            
                    
            基于CPLD的IEEE1149.1 USB下載電纜設(shè)計
            
                                                            
              
                    	
            • 引言隨著片上系統(tǒng)(SoC，SystemonChip)時代的到來，包括復(fù)雜可編程邏輯器件(CPLD，ComplexProgrammab...
              • 
                    	                        
            • 關(guān)鍵字：
                        FPGA  CPLD  USB下載電纜  IEEE1149.1                          
              • 
                   	
            
                    
            
                
            
                                
            
                    
            用雙端口RAM實現(xiàn)與PCI總線接口數(shù)據(jù)通訊
            
                                                            
                    
            
                
            
                                
            
                    
            基于CPLD的電動自行車充電系統(tǒng)的研究設(shè)計
            
                                                            
              
                    	
            • 電動車由于具有無廢氣污染、無噪音、輕便美觀等特點，受到眾多使用者的青睞。但使用中也暴露出它的局限性...
              • 
                    	                        
            • 關(guān)鍵字：
                        FPGA  CPLD  SPCE061A  充電系統(tǒng)  電動自行車                          
              • 
                   	
            
                    
            
                
            
                                
            
                    
            基于CPLD和ISA總線的數(shù)據(jù)采集系統(tǒng)設(shè)計
            
                                                            
              
                    	
            • 摘要：介紹一種基于復(fù)雜可編程邏輯器件(CPLD)的數(shù)據(jù)采集系統(tǒng)，并給出詳細的設(shè)計方案。計算機通過ISA總線實現(xiàn)與數(shù)據(jù)采集系統(tǒng)的指令和數(shù)據(jù)傳輸。通過VHDL編程實現(xiàn)CPLD對12位串行模數(shù)轉(zhuǎn)換器ADS7816的控制。最后，給出該
              • 
                    	                        
            • 關(guān)鍵字：
                        CPLD  ISA  總線  數(shù)據(jù)采集                            
              • 
                   	
            
                    
            
                
            
                                
            
                    
            CPLD在臭氧電源中的應(yīng)用
            
                                                            
              
                    	
            • 摘要：利用壓控振蕩器CD4046和可編程邏輯器件EPM7128構(gòu)成控制系統(tǒng)，通過調(diào)節(jié)逆變輸出脈沖的占空比和頻率，實現(xiàn)臭氧電源輸出電壓和頻率的調(diào)節(jié)，從而達到對臭氧電源輸出功率的調(diào)節(jié)。調(diào)試結(jié)果表明該系統(tǒng)滿足實時性和功耗
              • 
                    	                        
            • 關(guān)鍵字：
                        CPLD  臭氧電源  中的應(yīng)用                            
              • 
                   	
            
                    
            
                
            
                                
            
                    
            TMS320F2812與CPLD的視頻采集系統(tǒng)接口設(shè)計
            
                                                            
              
                    	
            • 摘要：介紹基于TMS320F2812和CPLD的數(shù)字視頻采集系統(tǒng)的接口設(shè)計。該系統(tǒng)采用同步分離電路、TMS320F2812、EPM7128、TMS320C6416、IDE硬盤存儲器以及顯示器接口等芯片，利用TMs320F2812中的ADC采樣速度和轉(zhuǎn)換精度高的優(yōu)
              • 
                    	                        
            • 關(guān)鍵字：
                        接口  設(shè)計  系統(tǒng)  采集  CPLD  視頻  TMS320F2812                          
              • 
                   	
            
                    
            
                
            
                                
            
                    
            基于PC104總線和CPLD的測頻模件設(shè)計
            
                                                            
              
                    	
            • 摘要：根據(jù)某測試系統(tǒng)的需要，設(shè)計基于PCl04總線和CPLD的高精度測頻模件，采用多周期同步測頻法實現(xiàn)對所測頻段的等精度測量。設(shè)計了該測頻模件的硬件電路，并給出用CPLD實現(xiàn)數(shù)字頻率計的詳細VHDL源代碼。采用原理圖的
              • 
                    	                        
            • 關(guān)鍵字：
                        CPLD  104  PC  總線                            
              • 
                   	
            
                    
            
                
            
                                
            
                    
            采用CPLD/FPGA的VHDL語言電路優(yōu)化原理設(shè)計
            
                                                            
                                        
              
                    	
            • 采用CPLD/FPGA的VHDL語言電路優(yōu)化原理設(shè)計,VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)展起來的。它是一種面向設(shè)計、多層次的硬件描述語言，是集行為描述、RTL
              • 
                    	                        
            • 關(guān)鍵字：
                        優(yōu)化  原理  設(shè)計  電路  語言  CPLD/FPGA  VHDL  采用                          
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            基于CPLD的異步串行通訊控制器的研究與設(shè)計
            
                                                            
              
                    	
            • 本文在對異步串行通信協(xié)議進行分析的基礎(chǔ)上，根據(jù)實際工程的需要，對異步串行通信控制器進行了詳細設(shè)計，并結(jié)合CPLD器件，采用VHDL語言，對設(shè)計方案進行了實現(xiàn)和驗證，通過最后時序仿真的波形圖得出了設(shè)計方案的正確，而且加載了該設(shè)計程序的CPLD在實際工程中能夠很好地與處理器進行連接來收發(fā)數(shù)據(jù)，從而為那些沒有串行異步接口的處理器提供一個比較理想的設(shè)計方案。
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            • 關(guān)鍵字：
                        CPLD  異步串行  通訊  控制器                            
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            基于CPLD/FPGA的VHDL語言電路優(yōu)化設(shè)計
            
                                                            
                    
            
                
            
                                                

                
            
	                
            
		                	
            
	
            
	共775條
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