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      基于FPGA的輪詢(xún)合路的設(shè)計(jì)和實(shí)現(xiàn)

      • 針對(duì)高密度接口設(shè)計(jì)中基于字節(jié)處理和整包處理的轉(zhuǎn)換問(wèn)題,本文提出了分片輪詢(xún)調(diào)度和改進(jìn)式欠賬輪詢(xún)調(diào)度相結(jié)合的調(diào)度策略
      • 關(guān)鍵字: FPGA  輪詢(xún)合路    

      基于FPGA的位寬可擴(kuò)展多路組播復(fù)制的實(shí)現(xiàn)

      • 用VHDL語(yǔ)言在FPGA內(nèi)部編程實(shí)現(xiàn)組播復(fù)制。本文介紹其實(shí)現(xiàn)方法,并給出了時(shí)序仿真波形。通過(guò)擴(kuò)展,該設(shè)計(jì)可以支持多位寬、多路復(fù)制,因而具有較好的應(yīng)用前景。
      • 關(guān)鍵字: FPGA  位寬  多路    

      具有多個(gè)電壓軌的FPGA和DSP電源設(shè)計(jì)實(shí)例(二)

      • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
      • 關(guān)鍵字: DSP  電源設(shè)計(jì)  FPGA  德州儀器  

      具有多個(gè)電壓軌的FPGA和DSP電源設(shè)計(jì)實(shí)例(一)

      • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
      • 關(guān)鍵字: DSP  電源設(shè)計(jì)  FPGA  

      基于FPGA的二值圖像連通域標(biāo)記快速算法實(shí)現(xiàn)

      • 摘  要:針對(duì)高速圖像目標(biāo)實(shí)時(shí)識(shí)別和跟蹤任務(wù),需要利用系統(tǒng)中有限的硬件資源實(shí)現(xiàn)高速、準(zhǔn)確的二值圖像連通域標(biāo)記,提出了一種適合FPGA實(shí)現(xiàn)的二值圖像連通域標(biāo)記快速算法。算法以快捷、有效的方式識(shí)別、并記錄區(qū)域間復(fù)雜的連通關(guān)系。與傳統(tǒng)的二值圖像標(biāo)記算法相比,該算法具有運(yùn)算簡(jiǎn)單性、規(guī)則性和可擴(kuò)展性的特點(diǎn)。利用FPGA實(shí)現(xiàn)該算法時(shí),能夠準(zhǔn)確有效的識(shí)別出圖像中復(fù)雜的連通關(guān)系,產(chǎn)生正確的標(biāo)記結(jié)果。在100MHz工作時(shí)鐘下,處理384
      • 關(guān)鍵字: FPGA  單片機(jī)  二值圖像連通域標(biāo)記  嵌入式系統(tǒng)  

      基于FPGA的高速可變周期脈沖發(fā)生器的設(shè)計(jì)

      • 1 引 言 要求改變脈沖周期和輸出脈沖個(gè)數(shù)的脈沖輸出電路模塊在許多工業(yè)領(lǐng)域都有運(yùn)用。采用數(shù)字器件設(shè)計(jì)周期和輸出個(gè)數(shù)可調(diào)節(jié)的脈沖發(fā)生模塊是方便可行的。為了使之具有高速、靈活的優(yōu)點(diǎn),本文采用Atelra公司的可編程芯片F(xiàn)PGA設(shè)計(jì)了一款周期和輸出個(gè)數(shù)可變的脈沖發(fā)生器。經(jīng)過(guò)板級(jí)調(diào)試獲得良好的運(yùn)行效果。 2 總體設(shè)計(jì)思路 脈沖的周期由高電平持續(xù)時(shí)間與低電平持續(xù)時(shí)間共同構(gòu)成,為了改變周期,采用兩個(gè)計(jì)數(shù)器來(lái)分別控制高電平持續(xù)時(shí)間和低電平持續(xù)時(shí)間。計(jì)數(shù)器采用可并行加載初始值的N位減法計(jì)數(shù)器。設(shè)定:當(dāng)要求的高電平
      • 關(guān)鍵字: FPGA  單片機(jī)  脈沖發(fā)生器  嵌入式系統(tǒng)  

      基于CPLD的數(shù)字濾波抗干擾電路設(shè)計(jì)

      • 引言 紅外密集度光電立靶測(cè)試系統(tǒng)是一種用于測(cè)量低伸彈道武器射擊密集度的新型的測(cè)試系統(tǒng),它既可用于金屬?gòu)椡璧臏y(cè)試,又可測(cè)試非金屬?gòu)椡瑁哂蟹从踌`敏、精度高而穩(wěn)定、操作簡(jiǎn)單、容易維護(hù)等優(yōu)點(diǎn),已被許多靶場(chǎng)投入使用。 光電靶的基本原理是:當(dāng)光幕內(nèi)的光通量發(fā)生足夠大的變化時(shí),光電傳感器會(huì)響應(yīng)這種變化而產(chǎn)生電信號(hào)。這就是說(shuō),一些非彈丸物體在穿過(guò)光幕時(shí)也會(huì)使光幕內(nèi)的光通量發(fā)生變化以使光電傳感器產(chǎn)生電信號(hào)。從原理上講。這種現(xiàn)象并非異常,而從測(cè)試來(lái)講,則屬于干擾。在具體靶場(chǎng)測(cè)試中,當(dāng)干擾嚴(yán)重時(shí),可能會(huì)導(dǎo)致測(cè)試無(wú)法進(jìn)行
      • 關(guān)鍵字: CPLD  單片機(jī)  干擾電路  嵌入式系統(tǒng)  數(shù)字濾波  邏輯電路  

      FPGA所需的電源供應(yīng):深入分析

      • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
      • 關(guān)鍵字: 美國(guó)國(guó)家半導(dǎo)體公司  FPGA  DC/DC  

      基于FPGA的IDE硬盤(pán)接口卡的實(shí)現(xiàn)

      • 引言 本文采用FPGA實(shí)現(xiàn)了IDE硬盤(pán)接口協(xié)議。系統(tǒng)提供兩套符合ATA-6規(guī)范的IDE接口,一個(gè)與普通IDE硬盤(pán)連接,另一個(gè)與計(jì)算機(jī)主板上的IDE接口相連。系統(tǒng)采用FPGA實(shí)現(xiàn)接口協(xié)議,完成接口數(shù)據(jù)的截獲、處理(在本文中主要是數(shù)據(jù)加密)和轉(zhuǎn)發(fā),支持PIO和Ultra DMA兩種數(shù)據(jù)傳輸模式。下面重點(diǎn)介紹用FPGA實(shí)現(xiàn)接口協(xié)議的方法。 1 IDE接口協(xié)議簡(jiǎn)介 1.1 IDE接口引腳定義 IDE(Integrated Drive Electronics)即“電子集成驅(qū)動(dòng)器”,又稱(chēng)為ATA接口。表1列
      • 關(guān)鍵字: FPGA  IDE硬盤(pán)  單片機(jī)  嵌入式系統(tǒng)  存儲(chǔ)器  

      基于ARM和FPGA的多功能車(chē)輛總線嵌入式系統(tǒng)設(shè)計(jì)

      • 基于ARM和FPGA的多功能車(chē)輛總線嵌入式系統(tǒng)設(shè)計(jì),本文介紹了一種基于ARM和FPGA,從軟件到硬件完全自主開(kāi)發(fā)多功能車(chē)輛總線(Multifunction Vehicle Bus)MVB嵌入式系統(tǒng)的設(shè)計(jì)和實(shí)現(xiàn)。
      • 關(guān)鍵字: 嵌入式  系統(tǒng)  設(shè)計(jì)  總線  多功能車(chē)  ARM  FPGA  基于  

      賽靈思推出新型完整FPGA解決方案

      •   賽靈思公司宣布推出支持DDR2 SDRAM接口的低成本Spartan™-3A FPGA開(kāi)發(fā)套件、支持多種高性能存儲(chǔ)器接口(I/Fs)的Virtex™-5 FPGA 開(kāi)發(fā)平臺(tái)(ML-561) ,以及存儲(chǔ)器接口生成器(MIG)軟件1.7版本。這些完整的解決方案使FPGA用戶(hù)能夠快速實(shí)施并驗(yàn)證在不同數(shù)據(jù)速率和總線寬度下的專(zhuān)用存儲(chǔ)器接口設(shè)計(jì),從而加快產(chǎn)品的上市時(shí)間。   這些包括器件特性描述、數(shù)據(jù)輸入電路以及存儲(chǔ)器控制器的解決方案,均已在使用了美光科技公司(Micron Techn
      • 關(guān)鍵字: FPGA  單片機(jī)  嵌入式系統(tǒng)  賽靈思  

      基于DSP和CPLD的移相全橋軟開(kāi)關(guān)電源數(shù)字控制器

      基于CPLD的聲發(fā)射信號(hào)傳輸系統(tǒng)設(shè)計(jì)

      • 引言 聲發(fā)射技術(shù)是光纖傳感技術(shù)和聲發(fā)射技術(shù)相結(jié)合的產(chǎn)物,是目前聲發(fā)射技術(shù)的發(fā)展趨勢(shì)。它將高靈敏度聲發(fā)射傳感器安裝于受力構(gòu)件表面以形成一定數(shù)目的傳感器陣列,實(shí)時(shí)接收和采集來(lái)自于材料缺陷的聲發(fā)射信號(hào),進(jìn)而通過(guò)對(duì)這些聲發(fā)射信號(hào)的識(shí)別、判斷和分析來(lái)對(duì)材料損傷缺陷進(jìn)行檢測(cè)研究并對(duì)構(gòu)件強(qiáng)度、損傷、壽命等進(jìn)行分析和研究。 在實(shí)際的構(gòu)件檢測(cè)中,現(xiàn)場(chǎng)聲源信號(hào)通常是在100~800 kHz之間的微弱高頻信號(hào),而且材料損傷檢測(cè)、聲發(fā)射源定位往往需要多個(gè)傳感器形成傳感器陣列,而聲發(fā)射信號(hào)的數(shù)據(jù)傳輸系統(tǒng)必須達(dá)到640 Mbp
      • 關(guān)鍵字: CPLD  傳輸系統(tǒng)  單片機(jī)  發(fā)射信號(hào)  嵌入式系統(tǒng)  

      賽靈思推出65nm FPGA一周年:VIRTEX-5 FPGA率先實(shí)現(xiàn)量產(chǎn)

      •   賽靈思公司日前隆重宣布,其屢獲殊榮的65nm Virtex-5 FPGA系列兩款器件LX50 和 LX50T最先實(shí)現(xiàn)量產(chǎn)。自2006年5月15日推出65nm Virtex-5 FPGA平臺(tái)以來(lái),賽靈思目前已向市場(chǎng)發(fā)售了三款平臺(tái)(LX、LXT和SXT)的13種器件,它們?yōu)榭蛻?hù)提供了無(wú)需任何折衷的業(yè)界最高的性能、最低的功耗, 并擁有業(yè)界唯一內(nèi)建的PCI Express®™ 端點(diǎn)和千兆以太網(wǎng)模塊,以及業(yè)界最高的DSP性能。   賽靈思公司高級(jí)產(chǎn)品部執(zhí)行副總裁Iain Morris 表示
      • 關(guān)鍵字: 65nm  FPGA  VIRTEX-5  單片機(jī)  嵌入式系統(tǒng)  賽靈思  

      基于DSP與CPLD的ADS7805多通道數(shù)據(jù)采集

      • 設(shè)計(jì)了利用TMS320LF2407A與EPM3032A控制的ADS7805多通道采集系統(tǒng)的邏輯結(jié)構(gòu),介紹了系統(tǒng)的工作原理,詳細(xì)描述了ADS7805、DSP及CPLD之間接口的硬件與軟件設(shè)計(jì)。
      • 關(guān)鍵字: 通道  數(shù)據(jù)采集  ADS7805  CPLD  DSP  基于  
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