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      基于FPGA的設(shè)計(jì)解決物聯(lián)網(wǎng)實(shí)現(xiàn)的核心挑戰(zhàn)

      • 當(dāng)前,物聯(lián)網(wǎng)(IoT)已成為一個(gè)廣受歡迎的名詞,幾乎每一個(gè)電子設(shè)備相互連接到互聯(lián)網(wǎng)上加以使用,都被大家稱為物聯(lián)網(wǎng)。它包含了一個(gè)從智能家電、汽車到可
      • 關(guān)鍵字: FPGA  

      FPGA和CPLD內(nèi)部自復(fù)位電路設(shè)計(jì)方案

      • 本文描述了復(fù)位的定義,分類及不同復(fù)位設(shè)計(jì)的影響,并討論了針對(duì)FPGA和CPLD的內(nèi)部自復(fù)位方案。1、定義復(fù)位信號(hào)是一個(gè)脈沖信號(hào),它會(huì)使設(shè)計(jì)的電路進(jìn)入設(shè)
      • 關(guān)鍵字: FPGA  

      CRC循環(huán)冗余校驗(yàn)的原理與算法及FPGA實(shí)現(xiàn)

      • CRC基本原理在串行數(shù)據(jù)流的最有效的檢錯(cuò)方案是CRC(Cyclic Redundancy check)循環(huán)冗余檢驗(yàn),CRC循環(huán)冗余校驗(yàn)最根本的原理就是將原始數(shù)據(jù)除以某個(gè)固定的
      • 關(guān)鍵字: CRC  循環(huán)冗余  FPGA  

      十年FPGA開發(fā)經(jīng)驗(yàn)工程師談設(shè)計(jì)技巧

      • 從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間,至今記得當(dāng)初第一次在EDA實(shí)驗(yàn)平臺(tái)上完成數(shù)字秒表、搶答器、密碼鎖等實(shí)驗(yàn)時(shí)那個(gè)興奮勁。當(dāng)時(shí)由于沒有接
      • 關(guān)鍵字: 控制  FPGA  

      如何基于EMIF接口的DSP控制系統(tǒng)設(shè)計(jì)?

      • 摘要:提出一種DSP 通過EMIF 接口控制復(fù)雜系統(tǒng)的方案。通過將DSP 芯片連接多片F(xiàn)PGA,并利用FPGA 與各種外部芯片連接,使得DSP 通過EMIF 接口就能控制
      • 關(guān)鍵字: EMIF接口  FPGA  DSP  

      適用于 FPGA、GPU 和 ASIC 系統(tǒng)的電源管理

      • 在 FPGA、GPU 或 ASIC 控制的系統(tǒng)板上,僅有為數(shù)不多的幾種電源管理相關(guān)的設(shè)計(jì)挑戰(zhàn),但是由于需要反復(fù)調(diào)試,所以這類挑戰(zhàn)可能使系統(tǒng)的推出時(shí)間嚴(yán)重滯后
      • 關(guān)鍵字: FPGA  GPU  ASIC  電源管理  

      FPGA開發(fā)之IP核:軟核、硬核以及固核概念

      • IP(Intelligent Property)核是具有知識(shí)產(chǎn)權(quán)核的集成電路芯核總稱,是經(jīng)過反復(fù)驗(yàn)證過的、具有特定功能的宏模塊,與芯片制造工藝無關(guān),可以移植到不同的
      • 關(guān)鍵字: FPGA  IP核  固核概念  

      如何基于蜜罐技術(shù)的FPGA實(shí)現(xiàn)技術(shù)?

      • 1. 項(xiàng)目背景蜜罐技術(shù)由來已久,蜜罐(Honeypot)是一種在互聯(lián)網(wǎng)上運(yùn)行的計(jì)算機(jī)系統(tǒng)。它是專門為吸引并誘騙那些試圖非法闖入他人計(jì)算機(jī)系統(tǒng)的人(如電腦黑
      • 關(guān)鍵字: 蜜罐技術(shù)  FPGA  實(shí)現(xiàn)技術(shù)  

      如何基于FPGA的短波通信接收機(jī)?

      • 短波通信又稱高頻通信,是利用HF波段(3-30MHz)電磁波進(jìn)行的無線電通信。短波通信主要靠天波傳播,可經(jīng)電離層一次或數(shù)次反射,最遠(yuǎn)可傳至上萬里,如按氣
      • 關(guān)鍵字: FPGA  短波通信  接收機(jī)  

      十年FPGA開發(fā)經(jīng)驗(yàn)工程師教你的絕密設(shè)計(jì)技巧

      • 從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間,至今記得當(dāng)初第一次在EDA實(shí)驗(yàn)平臺(tái)上完成數(shù)字秒表、搶答器、密碼鎖等實(shí)驗(yàn)時(shí)那個(gè)興奮勁。當(dāng)時(shí)由于沒有接
      • 關(guān)鍵字: CPLD  電子工程師  FPGA  

      如何為基于FPGA的嵌入式系統(tǒng)進(jìn)行安全升級(jí)?

      • 如何防止器件ldquo;磚頭化rdquo;,只發(fā)出警告就夠了嗎?ldquo;系統(tǒng)正在更新,請(qǐng)勿關(guān)閉電源。rdquo;我們都看到過這個(gè)警告,它通常在電子器件要在閃存
      • 關(guān)鍵字: 嵌入式  FPGA  

      如何基于CPLD的電池供電系統(tǒng)斷電電路的設(shè)計(jì)?

      • 今天,大多數(shù)的CPLD(復(fù)雜可編程邏輯器件)都采用可減少功耗的工作模式,但當(dāng)系統(tǒng)未使用時(shí),應(yīng)完全切斷電源以保存電池能量,從而實(shí)現(xiàn)很多設(shè)計(jì)者的終極節(jié)
      • 關(guān)鍵字: CPLD  電池供電  斷電電路  

      引起的較高時(shí)鐘頻率仿真失敗原因

      • 通常如果你的設(shè)計(jì)在較低時(shí)鐘頻率時(shí)通過了仿真,但是在較高時(shí)鐘頻率時(shí)卻失敗了,你的第一個(gè)問題應(yīng)該是你的設(shè)計(jì)在某個(gè)較高時(shí)鐘頻率時(shí)是否達(dá)到了時(shí)序約束
      • 關(guān)鍵字: FPGA  時(shí)鐘頻率  賽靈思  

      如何設(shè)計(jì)基于FPGA的虛擬現(xiàn)實(shí)定位系統(tǒng)?

      • 虛擬現(xiàn)實(shí)技術(shù)是目前計(jì)算機(jī)信息科學(xué)中的前沿學(xué)科,文中設(shè)計(jì)了一種以FPGA 為核心的數(shù)據(jù)采集處理系統(tǒng).利用HMC5883L和ADXL345對(duì)虛擬場(chǎng)景中物體的方位和朝
      • 關(guān)鍵字: FPGA  虛擬現(xiàn)實(shí)  定位系統(tǒng)  

      經(jīng)驗(yàn)總結(jié):電路設(shè)計(jì)的8個(gè)誤區(qū)

      • 關(guān)于電路設(shè)計(jì)8個(gè)誤區(qū)的經(jīng)驗(yàn)總結(jié)
      • 關(guān)鍵字: PCB  FPGA  CPU  
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