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基于FPGA狀態(tài)機和片上總線的CompactPCI異步串口板設(shè)計方案
- 摘要：首先簡要介紹了CompactPCI異步串口板的通常設(shè)計方法，并且提出了這些方法的不足之處，重點闡述了基于FPGA狀態(tài)機和片上總線的新設(shè)計方案，以及該方案的技術(shù)優(yōu)勢，隨后公布了基于該方案的異步串口板達到的性能指標。通過比較有關(guān)應(yīng)答延遲的試驗數(shù)據(jù)，提出了基于FPGA狀態(tài)機和基于DSP處理器的異步串口板卡存在明顯的處理速度差異問題，并基于兩種設(shè)計方案，解釋了形成差異的原因。最后提出了FPGA狀態(tài)機對外部總線存儲器或端口的訪問管理性能大幅超越了任何一款DSP處理器的觀點，并對同行提出了類似研發(fā)項目的設(shè)計建議
- 關(guān)鍵字： FPGA DSP 片上總線 CompactPCI 異步串口板 201407
基于CPLD的數(shù)據(jù)采集與顯示接口設(shè)計及實現(xiàn)
- 0 引 言 CPLD稱為復(fù)雜可編程邏輯設(shè)計芯片，它是大規(guī)?？删幊唐骷哂懈呒啥?、高可靠性、高速度的特點。CPLD是利用EDA技術(shù)進行電子系統(tǒng)設(shè)計的載體。硬件描述語言是EDA技術(shù)進行電子系統(tǒng)設(shè)計的主要表達手段，VHDL語言是常用的硬件描述語言之一;軟件開發(fā)工具是利用EDA技術(shù)進行電子系統(tǒng)設(shè)計的智能化的自動化設(shè)計工具，常用開發(fā)工具有QuartusII，Ispexpert，F(xiàn)oundation等。CPLD以高速、高可靠性、串并行工作方式等特點在電子設(shè)計中廣泛應(yīng)用。它打破了軟硬件之間的界限，加速了產(chǎn)
- 關(guān)鍵字： CPLD MCS-51 數(shù)據(jù)采集
基于ARM+CPLD的實時圖像采集模塊設(shè)計
- 摘要：介紹了32位嵌入式系統(tǒng)及應(yīng)用現(xiàn)狀，指出了在嵌入式實時圖像采集的重要性和存在問題，提出了一種基于嵌入式系統(tǒng)總線接口的實時圖像采集模塊的實現(xiàn)方法。 關(guān)鍵詞：32位嵌入式系統(tǒng) CMOS攝像 實時圖像采集 1 32位嵌入式系統(tǒng)及其應(yīng)用現(xiàn)狀 1.1 32位嵌入式系統(tǒng)概述 嵌入式系統(tǒng)是后PC時代的主導(dǎo)，當(dāng)?shù)投说那度胧较到y(tǒng)無法滿足信息化、智能化、網(wǎng)絡(luò)化時代的更高要求時，32位嵌入式系統(tǒng)應(yīng)運而生。32位嵌入式系統(tǒng)是電腦硬件與軟件的有機結(jié)合。嵌入式設(shè)計的目的在于滿足某種特殊的功能。嵌入式系
- 關(guān)鍵字： ARM CPLD CMOS攝像
基于MicroBlaze的嵌入式串口服務(wù)器的設(shè)計實現(xiàn)，提供軟硬件架構(gòu)、原理
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： MicroBlaze 嵌入式串口服務(wù)器 FPGA Spartan-3
基于FPGA/CPLD的VHDL語言電路設(shè)計優(yōu)化方法
- VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標準硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)展起來的。它是一種面向設(shè)計、多層次的硬件描述語言，是集行為描述、RTL描述、門級描述功能為一體的語言，并已成為描述、驗證和設(shè)計數(shù)字系統(tǒng)中最重要的標準語言之一。由于VHDL在語法和風(fēng)格上類似于高級編程語言，可讀性好，描述能力強，設(shè)計方法靈活，可移植性強，因此它已成為廣大EDA工程師的首選。目前，
- 關(guān)鍵字： FPGA CPLD VHDL
基于CPLD的LED顯示屏控制電路設(shè)計
- 引言 近年來，隨著計算機技術(shù)和集成電路技術(shù)的飛速發(fā)展，得到廣泛應(yīng)用的大屏幕顯示系統(tǒng)當(dāng)屬視頻LED顯示系統(tǒng)。在LED顯示技術(shù)中，由于紅色、綠色發(fā)光二極管的亮度、光效色差等性能也得到了很大的提高，加之計算機多媒體制作軟件的發(fā)展，現(xiàn)在偽彩視頻LED顯示系統(tǒng)的制造成本大大降低，應(yīng)用領(lǐng)域不斷增加。這種偽彩色視頻LED顯示系統(tǒng)采用了計算機多媒體技術(shù)，全同步動態(tài)顯示視頻圖像，圖像清晰，亮度高，無拼縫，每種顏色的視頻灰度等級已經(jīng)由早期的16級灰度上升現(xiàn)在的256灰度，隨著大規(guī)模集成電路和專用元器件的發(fā)展，256
- 關(guān)鍵字： CPLD LED 顯示屏
STM32再學(xué)習(xí)之工程師眼中的SPI
- 前些天，有位網(wǎng)友談到通過FPGA來實現(xiàn)SPI通訊。通過帖子的回復(fù)發(fā)現(xiàn)好多網(wǎng)友對SPI通訊還有些疑惑，于是今天就帶著大家從SPI的標準協(xié)議，SPI在STM32單片機上的配置及在74HC595邏輯芯片通訊的實例來全方面認識一下這個既復(fù)雜又簡單的通訊協(xié)議?！ PI 是Serial Peripheral Interface的縮寫，直譯為串行外圍設(shè)備接口，SPI是Motorola公司推出的一種同步串行通訊方式，是一種四線同步總線，因其硬件功能很強，與SPI有關(guān)的軟件就相當(dāng)簡單，使MCU有更多的時間處理其他事務(wù)
- 關(guān)鍵字： FPGA SPI MCU
基于CPLD的DRAM控制器設(shè)計方法
- 80C186XL16位嵌入式微處理器是Intel公司在嵌入式微處理器市場的上導(dǎo)產(chǎn)品之一，已廣泛應(yīng)用于電腦終端、程控交換和工控等領(lǐng)域。在該嵌入式微處理器片內(nèi)，集成有DRAM RCU單元，即DRAM刷新控制單元。RCU單元可以自動產(chǎn)生DRAM刷新總線周期，它工作于微處理器的增益模式下。經(jīng)適當(dāng)編程后，RCU將向?qū)⑻幚砥鞯?BIU(總線接口)單元產(chǎn)生存儲器讀請求。對微處理器的存儲器范圍編程后，BIU單元執(zhí)行刷新周期時，被編程的存儲器范圍片選有效。 存儲器是嵌入式計算機系統(tǒng)的重要組成部分之一。通常采用靜態(tài)
- 關(guān)鍵字： CPLD DRAM VHDL
Altera可編程邏輯成為軟件定義數(shù)據(jù)中心的關(guān)鍵DNA
- Altera公司(NASDAQ: ALTR)今天宣布，其FPGA成為軟件定義數(shù)據(jù)中心(SSDC)開發(fā)的核心組成，Altera與微軟研究院以及必應(yīng)合作，加速網(wǎng)絡(luò)搜索引擎部分的開發(fā)。Altera的現(xiàn)場可編程邏輯陣列(FPGA)加速了大量數(shù)據(jù)在服務(wù)器上的處理過程，幫助解決大數(shù)據(jù)難題，滿足了巨大的分布式工作負載需求。 微軟在名為《一種加速大規(guī)模數(shù)據(jù)中心服務(wù)的重新配置架構(gòu)》的研究論文中共享了關(guān)鍵開發(fā)內(nèi)容，在明尼阿波利斯舉行的41屆計算機體系結(jié)構(gòu)國際大會 (ISCA)上宣讀此篇論文。這篇論文詳細介紹了怎樣應(yīng)
- 關(guān)鍵字： Altera FPGA 可編程邏輯
基于CPLD的LED顯示屏控制電路設(shè)計
- 引言 近年來，隨著計算機技術(shù)和集成電路技術(shù)的飛速發(fā)展，得到廣泛應(yīng)用的大屏幕顯示系統(tǒng)當(dāng)屬視頻LED顯示系統(tǒng)。在LED顯示技術(shù)中，由于紅色、綠色發(fā)光二極管的亮度、光效色差等性能也得到了很大的提高，加之計算機多媒體制作軟件的發(fā)展，現(xiàn)在偽彩視頻LED顯示系統(tǒng)的制造成本大大降低，應(yīng)用領(lǐng)域不斷增加。這種偽彩色視頻LED顯示系統(tǒng)采用了計算機多媒體技術(shù)，全同步動態(tài)顯示視頻圖像，圖像清晰，亮度高，無拼縫，每種顏色的視頻灰度等級已經(jīng)由早期的16級灰度上升現(xiàn)在的256灰度，隨著大規(guī)模集成電路和專用元器件的發(fā)展，256
- 關(guān)鍵字： CPLD LED 顯示屏
一種基于CPLD的單片機脈沖信號源設(shè)計
- 單片機產(chǎn)生的脈沖信號源由于是靠軟件實現(xiàn)的，所以輸出頻率及步進受單片機時鐘頻率、指令數(shù)和指令執(zhí)行周期的限制。文中介紹了一種以CPLD為核心的脈沖信號源，脈沖信號源的參數(shù)(頻率、占空比)由工控機通過I/O板卡設(shè)置，設(shè)定的參數(shù)由數(shù)碼管顯示，這種脈沖信號源與其它脈沖信號發(fā)生電路相比具有輸出頻率高、步進小(通過選用高速CPLD可提高頻率及縮小步進)、精度高、參數(shù)調(diào)節(jié)方便、易于修改等優(yōu)點。 1系統(tǒng)組成及工作原理 脈沖信號源電路核心采用一片可編程邏輯器件EPM7128SLC84—10，它屬于
- 關(guān)鍵字： CPLD Altera MAX7000
基于CPLD的單片機與ISA總線接口的并行通信設(shè)計
- 摘要：介紹了用ALTERA公司MAX7000系列CPLD芯片實現(xiàn)單片機與PC104ISA總線接口之間的關(guān)行通信。給出了系統(tǒng)設(shè)計方法及程序源代碼。 關(guān)鍵詞：CPLD ISA總線 并行通信 CPLD(Complex Programmable Logic Device)是一種復(fù)雜的用戶可編程邏輯器件，由于采用連續(xù)連接結(jié)構(gòu)，易于預(yù)測延時，從而使電路仿真更加準確。CPLD是標準的大規(guī)模集成電路產(chǎn)品，可用于各種數(shù)字邏輯系統(tǒng)的設(shè)計。近年來，由于采用先進的集成工藝和大指量生產(chǎn)，CPLD器件成本不斷下降，集
- 關(guān)鍵字： CPLD ISA總線 并行通信
一種基于ARM和CPLD的嵌入式視覺系統(tǒng)設(shè)計
- 目前，關(guān)于視覺系統(tǒng)的研究已經(jīng)成為熱點，也有開發(fā)出的系統(tǒng)可供參考。但這些系統(tǒng)大多是基于PC機的，由于算法和硬件結(jié)構(gòu)的復(fù)雜性而使其在小型嵌入式系統(tǒng)中的應(yīng)用受到了限制。上述系統(tǒng)將圖像數(shù)據(jù)采集后，視覺處理算法是在PC機上實現(xiàn)的。隨著嵌入式微處理器技術(shù)的進步，32位 ARM處理器系統(tǒng)擁有很高的運算速度和很強的信號處理能力，可以作為視覺系統(tǒng)的處理器，代替PC機來實現(xiàn)簡單的視覺處理算法。下面介紹一種基于ARM和 CPLD的嵌入式視覺系統(tǒng)，希望能分享嵌入式視覺開發(fā)過程中的一些經(jīng)驗。 1 系統(tǒng)方案與原理 在嵌入式視覺的
- 關(guān)鍵字： ARM CPLD
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