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      基于DSP和FPGA的編碼器信號(hào)測(cè)量及處理的通用模塊

      • 隨著科學(xué)技術(shù)的飛速發(fā)展,自動(dòng)控制系統(tǒng)在各領(lǐng)域中的應(yīng)用越來越多,特別是計(jì)算機(jī)自動(dòng)控制系統(tǒng)已成為現(xiàn)代科學(xué)技術(shù)、軍事工程和現(xiàn)代工業(yè)等領(lǐng)域不可缺少的部分。因而,自動(dòng)控制元件如作為動(dòng)力裝置的各種電動(dòng)機(jī)、發(fā)電機(jī)和
      • 關(guān)鍵字: DSP  FPGA  增量式編碼器  

      基于脈沖信號(hào)源的CPLD方法實(shí)現(xiàn)

      • 單片機(jī)產(chǎn)生的脈沖信號(hào)源由于是靠軟件實(shí)現(xiàn)的,所以輸出頻率及步進(jìn)受單片機(jī)時(shí)鐘頻率、指令數(shù)和指令執(zhí)行周期的限制。文中介紹了一種以CPLD為核心的脈沖信號(hào)源,脈沖信號(hào)源的參數(shù)(頻率、占空比)由工控機(jī)通過I/O板卡設(shè)置,
      • 關(guān)鍵字: 脈沖信號(hào)源  CPLD  單片機(jī)  

      MicroBlaze AXI總線實(shí)現(xiàn)OLED顯示

      • OLED作為從設(shè)備,主設(shè)備通過SPI控制協(xié)議和OLED模塊進(jìn)行通信,硬件接口為PMOD接口,OLED模塊內(nèi)部集成SRAM存儲(chǔ)設(shè)備緩存顯示數(shù)據(jù)。OLED模塊使用4wire SPI串行方式,其信號(hào)包含:SCK(時(shí)鐘),CS(片選),MOSI(master output
      • 關(guān)鍵字: NANO2    microblaze    FPGA    OLED  

      基于OpenCL標(biāo)準(zhǔn)的FPGA設(shè)計(jì)

      • 在可編程技術(shù)發(fā)展的最初階段,可編程能力出現(xiàn)了兩個(gè)極端。一個(gè)極端的代表是單核CPU和DSP單元。這些器件使用含有一系列可執(zhí)行指令的軟件來進(jìn)行編程。對(duì)于編程人員,在概念上以連續(xù)的方式來開發(fā)這些指令,而高級(jí)處理器
      • 關(guān)鍵字: OpenCL    FPGA  

      采用Altera 10代FPGA實(shí)現(xiàn)低延時(shí)小尺寸設(shè)計(jì)

      • 由于電子設(shè)計(jì)日漸復(fù)雜,設(shè)計(jì)人員通常需要采用各種不同類型的功能,但他們無法具備所有的專業(yè)知識(shí)、資源和時(shí)間。這促使了半導(dǎo)體知識(shí)產(chǎn)權(quán)(SIP)市場(chǎng)的增長(zhǎng),預(yù)計(jì)2017年將達(dá)到57億美元。某些復(fù)雜設(shè)計(jì)使用的各種SIP模塊甚
      • 關(guān)鍵字: FPGA  低延遲  Altera  

      FPGA 101:用Vivado HLS為軟件提速

      • 在編寫軟件時(shí),您有沒有遇到過無論怎么努力編碼,軟件都不能按您期望的速度運(yùn)行?我遇到過。您有沒有想過,“有沒有什么簡(jiǎn)單而且成本不高的方法可將一些代碼輸入多個(gè)定制處理器或定制硬件?”畢竟,您的應(yīng)用
      • 關(guān)鍵字: FPGA    Vivado  

      FPGA更適用于視覺處理

      • 美國(guó)國(guó)家儀器公司將工程的視覺處理移植到FPGA上實(shí)現(xiàn),可獲得更高的處理性能Jeff Bier 是嵌入式視覺聯(lián)盟的創(chuàng)始人,本月在德克薩斯州奧斯汀舉辦的NI WEEK大會(huì)上,Jeff關(guān)注了國(guó)家儀器公司的一個(gè)演示系統(tǒng),這個(gè)系統(tǒng)是國(guó)
      • 關(guān)鍵字: FPGA    視覺處理  

      基于FPGA的振動(dòng)信號(hào)采集處理系統(tǒng)設(shè)計(jì)

      • 摘要:在振動(dòng)信號(hào)采集和處理系統(tǒng)設(shè)計(jì)中,信號(hào)的處理時(shí)間與可靠性決定著系統(tǒng)應(yīng)用的可行性。本文設(shè)計(jì)了一種基于FPGA的振動(dòng)信號(hào)采集處理系統(tǒng),該系統(tǒng)通過振動(dòng)信號(hào)采集電路、抗混疊濾波電路、AD采樣電路將電荷信號(hào)轉(zhuǎn)化為
      • 關(guān)鍵字: 振動(dòng)信號(hào)采集  數(shù)據(jù)流控制  時(shí)鐘時(shí)標(biāo)  FPGA  

      基于SOPC的現(xiàn)場(chǎng)總線多通道實(shí)時(shí)溫度采集系統(tǒng)設(shè)計(jì)

      • 引言溫度是表征物體冷熱程度的物理量,是工業(yè)生產(chǎn)中常見和最基本的參數(shù)之一,在生產(chǎn)過程中常常需要對(duì)溫度進(jìn)行監(jiān)控。傳統(tǒng)的溫度采集系統(tǒng),通常采用單片機(jī)或數(shù)字信號(hào)處理器DSP作為微控制器,控制模數(shù)轉(zhuǎn)換器ADC及其他外
      • 關(guān)鍵字: 溫度采集  FPGA  NiosII  PROFIBUS  

      基于FPGA的BPSK信號(hào)載頻估計(jì)單元設(shè)計(jì)與實(shí)現(xiàn)

      • 摘要:根據(jù)BPSK調(diào)制信號(hào)調(diào)制機(jī)理和平方倍頻法原理,在FPGA平臺(tái)上設(shè)計(jì)實(shí)現(xiàn)了BPSK調(diào)制信號(hào)載波頻率估計(jì)單元。利用ModelSim仿真環(huán)境對(duì)載頻估計(jì)功能進(jìn)行仿真,驗(yàn)證了平方倍頻法對(duì)BPSK信號(hào)進(jìn)行載波信號(hào)估計(jì)的有效性。仿真
      • 關(guān)鍵字: FPGA  載頻估計(jì)  平方倍頻  BPSK  

      駿龍科技Andrew ―― FPGA資深FAE的經(jīng)驗(yàn)獨(dú)白

      • 看似簡(jiǎn)單的幾個(gè)問題,Andrew卻回答的井井有條,小編已經(jīng)沒有辦法有什么其他詞語去形容了。本文Andrew不僅僅對(duì)FPGA入門學(xué)習(xí)流程做了詳細(xì)的分享,更是對(duì)FPGA開發(fā)工作的要求分成大公司和小公司兩個(gè)層面來分析。你能想象
      • 關(guān)鍵字: FPGA  FAE  駿龍科技  

      CPLD電梯運(yùn)行控制器VHDL

      • 西安航空職業(yè)技術(shù)學(xué)院 李軍法1 引言隨著社會(huì)的發(fā)展。使用電梯越來越普遍,已從原來只在商業(yè)大廈、賓館過渡到在辦公室、居民樓等多種建筑中,并且對(duì)電梯功能的要求也不斷提高,其相應(yīng)控制方式也在不斷發(fā)生變化。電梯的
      • 關(guān)鍵字: CPLD  電梯  運(yùn)行控制器  VHDL  

      CPLD DDS正交信號(hào)源濾波器

      • 桂林電子科技大學(xué) 韓劍 李德明 馮雪1 引言由于傳統(tǒng)的多波形函數(shù)信號(hào)發(fā)生器需采用大量分離元件才能實(shí)現(xiàn),且設(shè)計(jì)復(fù)雜,這里提出一種基于CPLD的多波形函數(shù)信號(hào)發(fā)生器。它采用CPLD作為函數(shù)信號(hào)發(fā)生器的處理器,以單片機(jī)和
      • 關(guān)鍵字: CPLD  DDS  單片機(jī)  

      FPGA工程師的研發(fā)之道――總線的研究

      • 如果設(shè)計(jì)中有多個(gè)模塊,每個(gè)模塊內(nèi)部有許多寄存器或者存儲(chǔ)塊需要配置或者提供讀出那么實(shí)現(xiàn)方式有多種,主要如下:實(shí)現(xiàn)方式一:可以在模塊頂部將所有寄存器引出,提供統(tǒng)一的模塊進(jìn)行配置和讀出。這種方式簡(jiǎn)單是簡(jiǎn)單,
      • 關(guān)鍵字: FPGA  總線  

      Lark Board評(píng)估板 Cyclone V SoC的專用舞臺(tái)

      • 隨著FPGA技術(shù)的高速發(fā)展,芯片規(guī)模不斷提升,帶來了更強(qiáng)的性能的同時(shí),也實(shí)現(xiàn)了更低的功耗。FPGA憑借其強(qiáng)大的并行信號(hào)處理能力,在應(yīng)對(duì)控制復(fù)雜度低、數(shù)據(jù)量大的運(yùn)算時(shí)具有較強(qiáng)的優(yōu)勢(shì)。但是在復(fù)雜算法的實(shí)現(xiàn)上,F(xiàn)PGA
      • 關(guān)鍵字: FPGA  RISC  英蓓特  
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