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基于CPLD/FPGA的VHDL語(yǔ)言電路優(yōu)化設(shè)計(jì)
- 杜志傳,鄭建立(上海理工大學(xué) 醫(yī)療器械與食品學(xué)院 上海 200093)0 引 言VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語(yǔ)言,是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)
- 關(guān)鍵字: VHDL CPLD/FPGA 電路設(shè)計(jì) 優(yōu)化
基于嵌入式系統(tǒng)中DRAM控制器的CPLD解決方案
- 80C186XL16位嵌入式微處理器是Intel公司在嵌入式微處理器市場(chǎng)的上導(dǎo)產(chǎn)品之一,已廣泛應(yīng)用于電腦終端、程控交換和工控等領(lǐng)域。在該嵌入式微處理器片內(nèi),集成有DRAM RCU單元,即DRAM刷新控制單元。RCU單元可以自動(dòng)產(chǎn)生
- 關(guān)鍵字: 嵌入式系統(tǒng) DRAM控制器 CPLD
基于CPLD器件在時(shí)間統(tǒng)一系統(tǒng)中的應(yīng)用
- 引言隨著電子技術(shù)的發(fā)展,對(duì)遙測(cè)信號(hào)的幀結(jié)構(gòu)的可編程度、集成度的要求越來(lái)越高,用于時(shí)間統(tǒng)一系統(tǒng)的B碼源的設(shè)計(jì)也趨于高度集成化。為了適應(yīng)現(xiàn)代靶場(chǎng)試驗(yàn)任務(wù)的要求,我們采用Altera的CPLD器件,將用于產(chǎn)生B碼的各種
- 關(guān)鍵字: CPLD 時(shí)間統(tǒng)一系統(tǒng) IRIG-B碼
DSP與CPLD的輸電線路局部氣象監(jiān)測(cè)裝置設(shè)計(jì)
- 1 概 述輸電線路的狀態(tài)直接決定著整個(gè)電網(wǎng)的安全穩(wěn)定運(yùn)行,輸電線路微氣象參數(shù)的實(shí)時(shí)監(jiān)測(cè)能夠?yàn)殡娋W(wǎng)正常調(diào)度、以及自然災(zāi)害預(yù)測(cè)和控制提供必要的現(xiàn)場(chǎng)信息。輸電線路是電力系統(tǒng)的關(guān)鍵元件之一。為了安全、穩(wěn)定地運(yùn)行,
- 關(guān)鍵字: DSP CPLD 輸電線路 氣象監(jiān)測(cè)
基于數(shù)字電位計(jì)的X射線探測(cè)器偏壓調(diào)節(jié)
- 針對(duì)某X射線探測(cè)器輸出信號(hào)增益需不斷調(diào)節(jié)以滿足后續(xù)信號(hào)采集電路的輸入范圍,其偏置電壓需要精細(xì)調(diào)節(jié),文章采用數(shù)字電位計(jì)和FPGA設(shè)計(jì)了X射線探測(cè)器偏置電壓調(diào)節(jié)系統(tǒng)。闡述了所選數(shù)字電位計(jì)的參數(shù)、特點(diǎn)及內(nèi)部結(jié)構(gòu),在此基礎(chǔ)上給出了系統(tǒng)的設(shè)計(jì)方案。文章中FPGA采用SPI通信方式對(duì)數(shù)字電位計(jì)進(jìn)行配置實(shí)現(xiàn)電阻100KΩ共256檔的調(diào)節(jié),最終給出實(shí)際測(cè)試結(jié)果,驗(yàn)證了采用數(shù)字電位計(jì)實(shí)現(xiàn)偏壓調(diào)節(jié)的靈活性。
- 關(guān)鍵字: X射線探測(cè)器 反向偏壓調(diào)節(jié) 數(shù)字電位計(jì) SPI FPGA
硬核浮點(diǎn)DSP的FPGA或取代高性能計(jì)算GPGPU
- 近來(lái),Altera公司推出業(yè)界首款浮點(diǎn)FPGA,它集成了硬核IEEE754兼容浮點(diǎn)運(yùn)算功能,提高了DSP性能、設(shè)計(jì)人員的效能和邏輯效率。據(jù)悉,硬核浮點(diǎn)DSP模塊集成在Altera20nmArria10FPGA和SoC中,以及14nmStratix10FPGA和SoC
- 關(guān)鍵字: DSP FPGA 數(shù)字信號(hào)處理
基于CPLD的CCD信號(hào)發(fā)生器的研究
- 1、引言CCD (Charge Coupled Devices)電荷藕合器件是20世紀(jì)70年代初發(fā)展起來(lái)的新型半導(dǎo)體器件。目前CCD作為光電傳感器由于其具有體積小、重量輕、功耗小、工作電壓低和抗燒毀 等優(yōu)點(diǎn)以及在分辨率、動(dòng)態(tài)范圍、靈敏度
- 關(guān)鍵字: CPLD CCD 信號(hào)發(fā)生器
一種FPGA高速訪問(wèn)USB設(shè)備的設(shè)計(jì)方案
- 摘要:針對(duì)FPGA訪問(wèn)USB設(shè)備存在傳輸速率低、資源消耗大、開發(fā)復(fù)雜的缺點(diǎn),提出了一種將ARM處理器與FPGA相結(jié)合實(shí)現(xiàn)高速訪問(wèn)USB設(shè)備的方案。該方案利用ARM處理器的USB Host讀取USB設(shè)備數(shù)據(jù)井緩存于高速內(nèi)存,采用乒乓
- 關(guān)鍵字: USB設(shè)備 數(shù)據(jù)訪問(wèn) FPGA 嵌入式系統(tǒng)
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