arm+fpga 文章進(jìn)入arm+fpga技術(shù)社區(qū)

FPGA在高速互連中的應(yīng)用

　　在技術(shù)發(fā)展的進(jìn)程中，某些出現(xiàn)的里程碑式技術(shù)甚至引起了發(fā)展方向的全盤(pán)改變。最初常用的并行打印機(jī)端口現(xiàn)在幾乎已經(jīng)絕跡了。系統(tǒng)結(jié)構(gòu)以8/16/32位并行總線的方式實(shí)現(xiàn)硅器件和存儲(chǔ)器之間的互連。傳統(tǒng)的系統(tǒng)背板會(huì)定義寬度達(dá)64位的并線總線。由于用戶對(duì)更高保真度多媒體體驗(yàn)的需求不斷提升，導(dǎo)致數(shù)據(jù)率不斷提高，系統(tǒng)數(shù)據(jù)吞吐量的要求呈現(xiàn)幾何級(jí)數(shù)的增長(zhǎng)。不過(guò)，增加并行總線的寬度和時(shí)鐘的頻率并不是長(zhǎng)期可行的解決方案，因?yàn)檫@種方法本身已經(jīng)達(dá)到了某些技術(shù)死角，主要會(huì)碰到的問(wèn)題包括PCB的空間限制、信號(hào)噪聲、信號(hào)完整性和避免信號(hào)
關(guān)鍵字： FPGA

賽靈思正式發(fā)布Virtex-5 FXT FPGA

65nm Virtex-5系列FPGA第四款平臺(tái)集成了PowerPC 440處理器模塊、 GTX高速收發(fā)器，以及超過(guò)190 GMACs的DSP性能
關(guān)鍵字： Virtex-5 FXT FPGA 賽靈思 65納米

撥開(kāi)迷霧：FPGA用做數(shù)字信號(hào)處理應(yīng)用？

　　在2004年加入賽靈思公司之前，與大多數(shù)人的觀點(diǎn)一樣，我也認(rèn)為FPGA“非常適用于原型設(shè)計(jì)，但對(duì)于批量DSP系統(tǒng)應(yīng)用來(lái)說(shuō)，成本太高，功耗太大。”,我原來(lái)一直認(rèn)為，F(xiàn)PGA在成本和功效方面無(wú)法滿足今天采用DSP系統(tǒng)架構(gòu)完成的那些設(shè)計(jì)的預(yù)算要求。然而，沒(méi)過(guò)多久，我源于“DSP視角”的看法就被大大地并且不可逆轉(zhuǎn)地改變了。　　今天針對(duì)DSP優(yōu)化的高性能FPGA已經(jīng)在DSP領(lǐng)域扮演著重要的角色。DSP領(lǐng)域的設(shè)計(jì)工程師逐漸發(fā)現(xiàn)他們所處的環(huán)境變化十分迅速，標(biāo)準(zhǔn)快速
關(guān)鍵字： FPGA 數(shù)字信號(hào)處理

基于ARM與MEMS器件的微慣性測(cè)量裝置設(shè)計(jì)

　　在仿生推進(jìn)機(jī)理的研究中，精確測(cè)量魚(yú)類(lèi)尾鰭拍動(dòng)參數(shù)對(duì)于魚(yú)類(lèi)仿生推進(jìn)機(jī)理研究及工程應(yīng)用具有重要的意義;然而，目前研究者大多采用分析高速攝像機(jī)拍攝的圖像獲得參數(shù)的觀測(cè)方法。這種方法受到環(huán)境與設(shè)備的限制，結(jié)果精確度較差。本設(shè)計(jì)是一種基于MEMS器件的生物運(yùn)動(dòng)微慣性測(cè)量裝置。利用該裝置實(shí)現(xiàn)了對(duì)SPC-III機(jī)器魚(yú)尾鰭拍動(dòng)參數(shù)的精確測(cè)量，為國(guó)內(nèi)首次利用MEMS器件進(jìn)行的活體魚(yú)尾鰭拍動(dòng)參數(shù)測(cè)量實(shí)驗(yàn)打下了基礎(chǔ)，為機(jī)器魚(yú)仿生推進(jìn)設(shè)計(jì)理論提供支撐。　　1 設(shè)計(jì)要求和系統(tǒng)結(jié)構(gòu) 　　根據(jù)活體魚(yú)類(lèi)的生物特征和實(shí)驗(yàn)本身的特
關(guān)鍵字： ARM MEMS

Xilinx推出整體設(shè)計(jì)工具套件-ISE10.1突破性提升設(shè)計(jì)生產(chǎn)力、性能和功耗

　　2008年3月25日，北京 ——全球可編程解決方案領(lǐng)導(dǎo)廠商賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)今天宣布推出其ISE® Design Suite10.1版。這一統(tǒng)一的整體解決方案為FPGA邏輯、嵌入式和DSP設(shè)計(jì)人員提供了賽靈思的整個(gè)設(shè)計(jì)工具產(chǎn)品線，其中的設(shè)計(jì)工具具有完全的互操作能力。ISE Design Suite 10.1版以平均運(yùn)行速度快兩倍的特性極大地加快了設(shè)計(jì)實(shí)施速度。因此設(shè)計(jì)人員可以在一天時(shí)間里完成多次反復(fù)設(shè)計(jì)。今天的發(fā)布另外一個(gè)重
關(guān)鍵字： DSP 嵌入式 FPGA

英特爾：嵌入式聯(lián)網(wǎng)設(shè)備市場(chǎng)是下一個(gè)金礦

　　隨著技術(shù)和通信技術(shù)的發(fā)展，二者之間已呈現(xiàn)出更多的融合趨勢(shì)：一方面嵌入式設(shè)備被更多地連接到互聯(lián)網(wǎng)上，成為互聯(lián)網(wǎng)接入終端；另一方面這些設(shè)備之間也越來(lái)越多地實(shí)現(xiàn)了互聯(lián)互通。自今年英特爾推出面向嵌入式領(lǐng)域的凌動(dòng)處理器以來(lái)，英特爾的嵌入式市場(chǎng)戰(zhàn)略逐漸清晰，而其與終端設(shè)備芯片廠商ARM之間的競(jìng)爭(zhēng)也成為業(yè)界關(guān)注的焦點(diǎn)。　 7月14日，英特爾在北京舉行嵌入式戰(zhàn)略溝通會(huì)，英特爾公司數(shù)字企業(yè)事業(yè)部副總裁、嵌入式及通信事業(yè)部總經(jīng)理DougDavis參加了會(huì)議，其在接受《中國(guó)電子報(bào)》記者采訪時(shí)表示，下一個(gè)價(jià)值
關(guān)鍵字：英特爾嵌入式系統(tǒng) ARM PC

ST STM32系列獲ARM RealView開(kāi)發(fā)工具包支持

　　STM32F101 (接入行)和STM32F103 (性能行)將是意法半導(dǎo)體首個(gè)基于ARM Cortex-M3處理器的器件系列，兼具卓越的高性能和低功耗，待機(jī)功耗僅為2 A。該系列器件擁有高達(dá)72MHz的CPU時(shí)鐘速度、128Kbyte片上閃存ROM及20Kbyte片上RAM，還包括A/D、CAN、USB、SPI、I2C等眾多外設(shè)及多達(dá)80個(gè)GPIO。　　RealView微控制器開(kāi)發(fā)工具包3.1可為新器件提供支持。這一最新版本保留了Keil Vision3集成開(kāi)發(fā)環(huán)境（IDE）易于使用的特性，并增
關(guān)鍵字： ST ARM 處理器 Cortex-M3

FPGA電路設(shè)計(jì)：如何應(yīng)對(duì)電源相關(guān)問(wèn)題的挑戰(zhàn)

　　引言　　在設(shè)計(jì)可編程門(mén)陣列(FPGA)電路時(shí)，必須極端重視電源問(wèn)題，從而使最終產(chǎn)品能在所有可能的條件下無(wú)缺陷工作并處于最優(yōu)狀態(tài)。FPGA 電路電源有兩項(xiàng)需考慮的問(wèn)題: FPGA 電路上電要求和電路功耗分析。這篇文章針對(duì)這兩方面的要求，討論您可能遇到的問(wèn)題，以及解決方案。　　目前FPGA電路設(shè)計(jì)所面臨的問(wèn)題　　FPGA電路通常需要多路電源輸入。為優(yōu)化開(kāi)機(jī)時(shí)的電流拖曳，防止鎖死和永久性的電路損壞，同時(shí)也為了防止開(kāi)機(jī)接通時(shí)的毛刺干擾和降低開(kāi)機(jī)接通的功耗，這些電源輸入必須具有精確的上電序列以及正確
關(guān)鍵字： FPGA 電源

基于FPGA的并行可變長(zhǎng)解碼器的實(shí)現(xiàn)技術(shù)

　　可變長(zhǎng)編碼(VLC)是一種無(wú)損熵編碼，它廣泛應(yīng)用于多媒體信息處理等諸多領(lǐng)域。在H.261/263、MPEG1/2/3等國(guó)際標(biāo)準(zhǔn)中，VLC占有重要地位。VLC的基本思想是對(duì)一組出現(xiàn)概率各不相同的信源符號(hào)，采用不同長(zhǎng)度的碼字表示，對(duì)出現(xiàn)概率高的信源符號(hào)采用短碼字，對(duì)出現(xiàn)概率低的信源符號(hào)采用長(zhǎng)碼字。Huffman編碼是一種典型的VLC，其編碼碼字的平均碼長(zhǎng)非常接近于數(shù)據(jù)壓縮的理論極限——熵。　　可變長(zhǎng)解碼(VLD)是VLC的逆過(guò)程，它從一組連續(xù)的碼流中提取出可變長(zhǎng)碼字，并將之轉(zhuǎn)換
關(guān)鍵字： VLD 串行解碼 FPGA

采用FPGA協(xié)處理器優(yōu)化汽車(chē)信息娛樂(lè)和信息通信系統(tǒng)(04-100)

　　集成了數(shù)據(jù)通信，定位服務(wù)和視頻娛樂(lè)的高端汽車(chē)信息娛樂(lè)系統(tǒng)需要高性能的可編程處理技術(shù)，其最佳實(shí)現(xiàn)方法是在主流汽車(chē)信息通信系統(tǒng)構(gòu)架中集成FPGA協(xié)處理器。本文講述汽車(chē)娛樂(lè)系統(tǒng)的需求，討論主流系統(tǒng)構(gòu)架，以及FPGA協(xié)處理器是如何集成到軟硬件體系中，以滿足高性能處理、靈活性和降低成本的要求。　　娛樂(lè)電子消費(fèi)已經(jīng)成為區(qū)分豪華轎車(chē)的標(biāo)志之一，推動(dòng)了汽車(chē)性能的快速發(fā)展，設(shè)計(jì)者必須在性能，成本和靈活性上進(jìn)行綜合考慮。高端應(yīng)用包括衛(wèi)星電話，后座娛樂(lè)，導(dǎo)航，各種音頻回放，語(yǔ)音合成、識(shí)別以及其他新的應(yīng)用。　　帶動(dòng)汽
關(guān)鍵字： FPGA 汽車(chē)娛樂(lè)系統(tǒng)

FPGA基軟件無(wú)線電(04-100)

　　軟件無(wú)線電技術(shù)給正在開(kāi)發(fā)無(wú)線電架構(gòu)的工程師帶來(lái)力量。編程中頻(IF)、帶寬、調(diào)制、編碼模式和其他無(wú)線電功能的能力廣泛引起注意。除了提供所有這些靈活性外，軟件無(wú)線電必須改善靈敏度，動(dòng)態(tài)范圍和鄰信道抑制性能。軟件無(wú)線電仍然是無(wú)線電，但它必須比被正在替代的通常無(wú)線電執(zhí)行的更好。　　現(xiàn)場(chǎng)可編程陣列(FPGA)技術(shù)先進(jìn)之處在于緊湊的占位空間能夠高速處理，同時(shí)也保持軟件無(wú)線電技術(shù)的靈活性和可編程性。FPGA在高速、計(jì)算密集、可重新配置應(yīng)用(FFT、FIR和其他乘法—累加運(yùn)算)中是受歡迎的。從FPG
關(guān)鍵字： FPGA 無(wú)線電

FPGA 電路設(shè)計(jì): 如何應(yīng)對(duì)電源相關(guān)問(wèn)題的挑戰(zhàn)

　　引言　　在設(shè)計(jì)可編程門(mén)陣列(FPGA)電路時(shí)，必須極端重視電源問(wèn)題，從而使最終產(chǎn)品能在所有可能的條件下無(wú)缺陷工作并處于最優(yōu)狀態(tài)。FPGA 電路電源有兩項(xiàng)需考慮的問(wèn)題: FPGA 電路上電要求和電路功耗分析。這篇文章針對(duì)這兩方面的要求，討論您可能遇到的問(wèn)題，以及解決方案。　　目前FPGA電路設(shè)計(jì)所面臨的問(wèn)題　　FPGA電路通常需要多路電源輸入。為優(yōu)化開(kāi)機(jī)時(shí)的電流拖曳，防止鎖死和永久性的電路損壞，同時(shí)也為了防止開(kāi)機(jī)接通時(shí)的毛刺干擾和降低開(kāi)機(jī)接通的功耗，這些電源輸入必須具有精確的上電序列以及正確
關(guān)鍵字： FPGA

在FPGA中集成高速串行收發(fā)器面臨的挑戰(zhàn)(04-100)

　　Altera公司對(duì)PCI Express，串行Rapid I/O和SerialLite等串行標(biāo)準(zhǔn)和協(xié)議的認(rèn)可，將促進(jìn)具有時(shí)鐘和數(shù)據(jù)恢復(fù)(CDR)功能的高速串行收發(fā)器的應(yīng)用。這些曾在4或8位ASSP中使用的收發(fā)器現(xiàn)在可以集成在高端FPGA中。帶有嵌入式收發(fā)器的FPGA占據(jù)更小的電路板空間，具有更高的靈活性和無(wú)需接口處理的兩芯片方案等優(yōu)勢(shì)，因此，采用這種FPGA對(duì)電路板設(shè)計(jì)者是很具有吸引力的選擇。　　在FPGA中集成收發(fā)器使得接口電路處理工作由電路板設(shè)計(jì)者轉(zhuǎn)向芯片設(shè)計(jì)者。本文闡述在一個(gè)FPGA中集成1
關(guān)鍵字： Altera FPGA ASSP ASIC

FPGA到高速DRAM的接口設(shè)計(jì)(04-100)

　　FPGA做為系統(tǒng)的核心元件正在更多的用于網(wǎng)絡(luò)、通信、存儲(chǔ)和高性能計(jì)算應(yīng)用中，在這些應(yīng)用中都需要復(fù)雜的數(shù)據(jù)處理。　　所以，現(xiàn)在FPGA支持高速、外部存儲(chǔ)器接口是必須遵循的?，F(xiàn)在的FPGA具有直接接口各種高速存儲(chǔ)器件的專(zhuān)門(mén)特性。本文集中描述高速DRAM到FPGA的接口設(shè)計(jì)。　　設(shè)計(jì)高速外部存儲(chǔ)器接口不是一件簡(jiǎn)單的任務(wù)。例如，同步DRAM已發(fā)展成高性能、高密度存儲(chǔ)器并正在用于主機(jī)中。最新的DRAM存儲(chǔ)器—DDR SDRAM，DDR2和RLDRAM II支持頻率范圍達(dá)到133MHz(260
關(guān)鍵字： Altera FPGA DRAM

基于FPGA的液晶顯示控制器設(shè)計(jì)

　　液晶顯示器由于具有低壓、微功耗、顯示信息量大、體積小等特點(diǎn)，在移動(dòng)通信終端、便攜計(jì)算機(jī)、GPS衛(wèi)星定位系統(tǒng)等領(lǐng)域有廣泛用途，成為使用量最大的顯示器件。液晶顯示控制器作為液晶驅(qū)動(dòng)電路的核心部件通常由集成電路組成，通過(guò)為液晶顯示系統(tǒng)提供時(shí)序信號(hào)和顯示數(shù)據(jù)來(lái)實(shí)現(xiàn)液晶顯示。本設(shè)計(jì)是一種基于FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)的液晶顯示控制器。與集成電路控制器相比，F(xiàn)PGA更加靈活，可以針對(duì)小同的液晶顯示模塊更改時(shí)序信號(hào)和顯示數(shù)據(jù)。FPGA的集成度、復(fù)雜度和面積優(yōu)勢(shì)使得其日益成為一種頗具吸引力的高性價(jià)比ASIC替代方案
關(guān)鍵字： FPGA 液晶