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arm+fpga 文章 進(jìn)入arm+fpga技術(shù)社區(qū)
賽靈思強(qiáng)化通信市場(chǎng)競(jìng)爭(zhēng)力 欲成為FPGATOP1供應(yīng)商
- 一直以來(lái),通信都是賽靈思整體業(yè)務(wù)的中流砥柱。今年年初,賽靈思專門成立通信事業(yè)部,并成功完成三起在光網(wǎng)絡(luò)領(lǐng)域的收購(gòu),更好地布局通信市場(chǎng),他們的目標(biāo)是成為華為、中興等通信廠商的FPGATOP1供應(yīng)商。 2011年發(fā)生的那些兒事和即將發(fā)生的那些事兒無(wú)不顯示著賽靈思在通信市場(chǎng)的持續(xù)專注和深耕。
- 關(guān)鍵字: 賽靈思 FPGA 光網(wǎng)絡(luò)
賽靈思Spartan-6 FPGA助力最新NI CompactRIO系統(tǒng)
- 全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) )在 2011 年 NIWeek 大會(huì)期間宣布,美國(guó)國(guó)家儀器公司 (NI) 推出采用賽靈思旗艦型Spartan?-6 FPGA的業(yè)界首款多核、性能最高的 NI CompactRIO 系統(tǒng)和最小型化的 NI Single-Board RIO器件,進(jìn)一步豐富了其可重配置 I/O (RIO) 高級(jí)控制與監(jiān)控產(chǎn)品系列。
- 關(guān)鍵字: 賽靈思 Spartan-6 FPGA
基于Verilog簡(jiǎn)易UART的FPGA/CPLD實(shí)現(xiàn)
- 基于Verilog簡(jiǎn)易UART的FPGA/CPLD實(shí)現(xiàn),目標(biāo):在xo640上實(shí)現(xiàn)一個(gè)簡(jiǎn)單的Uart,能夠解析串口數(shù)據(jù),并在寄存器中存儲(chǔ),用FIFO實(shí)現(xiàn)數(shù)據(jù)的傳遞。那么后期可以通過(guò)開(kāi)發(fā)板上的串口經(jīng)CPLD訪問(wèn)各種數(shù)據(jù)。比如PC=CPLD=EEPROM等等,極大方便后期的開(kāi)發(fā)和調(diào)試。
- 關(guān)鍵字: FPGA/CPLD 實(shí)現(xiàn) UART 簡(jiǎn)易 Verilog 基于
基于FPGA嵌入式系統(tǒng)的雷達(dá)目標(biāo)模擬器的設(shè)計(jì)
![](http://uphotos.eepw.com.cn/fetch/20130729/150374_1_0.jpg)
- 基于FPGA嵌入式系統(tǒng)的雷達(dá)目標(biāo)模擬器的設(shè)計(jì),人為地對(duì)雷達(dá)進(jìn)行測(cè)試時(shí),有時(shí)只對(duì)雷達(dá)的某個(gè)和某些參數(shù)感興趣,希望在回波中表征感興趣的參數(shù)強(qiáng)一些,這時(shí)就應(yīng)該在回波中去掉雜波和噪聲的影響,而這在實(shí)際的外場(chǎng)試飛過(guò)程中是不可能實(shí)現(xiàn)的,這也是雷達(dá)信號(hào)模擬器對(duì)
- 關(guān)鍵字: 目標(biāo) 模擬器 設(shè)計(jì) 雷達(dá) 系統(tǒng) FPGA 嵌入式 基于
半導(dǎo)體培養(yǎng)箱的ARM嵌入式控制系統(tǒng)研制
![](http://uphotos.eepw.com.cn/fetch/20130729/150375_1_0.jpg)
- 半導(dǎo)體培養(yǎng)箱的ARM嵌入式控制系統(tǒng)研制,針對(duì)傳統(tǒng)培養(yǎng)箱加熱制冷器件能耗高、體積大且溫控精度不高的特點(diǎn),應(yīng)用熱電半導(dǎo)體對(duì)培養(yǎng)箱的溫度進(jìn)行調(diào)節(jié)。采用ARM920T架構(gòu)的S3C2440AL處理器并配合外圍設(shè)備,在Linux嵌入式操作系統(tǒng)上進(jìn)行核心程序研發(fā),并加入模糊自適應(yīng)PID算法,以實(shí)現(xiàn)對(duì)培養(yǎng)箱溫度的精確控制。試驗(yàn)結(jié)果表明,該培養(yǎng)箱的控溫相對(duì)誤差達(dá)到±1.1%。
- 關(guān)鍵字: 控制系統(tǒng) 研制 嵌入式 ARM 培養(yǎng)箱 半導(dǎo)體
基于FPGA雷達(dá)多目標(biāo)模擬器DRFM設(shè)計(jì)與實(shí)現(xiàn)
- 研究了雷達(dá)多目標(biāo)模擬系統(tǒng)中數(shù)字射頻存儲(chǔ)(DRFM)單元的設(shè)計(jì)與實(shí)現(xiàn),根據(jù)模擬系統(tǒng)的設(shè)計(jì)要求, 提出一種基于高性能 FPGA數(shù)字射頻存儲(chǔ)單元設(shè)計(jì)方法;著重闡述了數(shù)字射頻存儲(chǔ)單元的設(shè)計(jì)思路, 給出了系統(tǒng)的設(shè)計(jì)方案, 并對(duì)系統(tǒng)中雷達(dá)模擬目標(biāo)的各功能模塊進(jìn)行了分析,實(shí)驗(yàn)結(jié)果表明,所設(shè)計(jì)的DRFM滿足設(shè)計(jì)系統(tǒng)要求。
- 關(guān)鍵字: FPGA DRFM 雷達(dá) 多目標(biāo)
FPGA與單片機(jī)實(shí)現(xiàn)低頻數(shù)字式相位測(cè)量?jī)x
![](http://uphotos.eepw.com.cn/fetch/20130729/150391_1_0.jpg)
- FPGA與單片機(jī)實(shí)現(xiàn)低頻數(shù)字式相位測(cè)量?jī)x,摘要:提出了以AVR ATmega128單片機(jī)和Altera公司的Cyclone系列EP1C3T100為核心的系統(tǒng)設(shè)計(jì)方案。分析了數(shù)字式低頻相位測(cè)量?jī)x的測(cè)量原理和測(cè)量誤差及其消除的方法。主要介紹了系統(tǒng)的軟硬件設(shè)計(jì)。實(shí)踐表明,此方案設(shè)計(jì)的
- 關(guān)鍵字: 數(shù)字式相位 測(cè)量?jī)x 低頻 實(shí)現(xiàn) 單片機(jī) FPGA
基于TMS320C6416與FPGA的實(shí)時(shí)光電圖像識(shí)別系統(tǒng)
![](http://uphotos.eepw.com.cn/fetch/20130729/150393_1_0.jpg)
- 基于TMS320C6416與FPGA的實(shí)時(shí)光電圖像識(shí)別系統(tǒng),光電混合模式識(shí)別以其高速并行處理和無(wú)串?dāng)_的優(yōu)點(diǎn)成為實(shí)現(xiàn)模式識(shí)別實(shí)用化和實(shí)時(shí)化的重要途徑,其在目標(biāo)識(shí)別、指紋識(shí)別、光纖檢測(cè)、工業(yè)零件識(shí)別、汽車牌照識(shí)別等領(lǐng)域得到了廣泛的研究和應(yīng)用[1.2],并取得了很好的識(shí)別
- 關(guān)鍵字: 圖像 識(shí)別 系統(tǒng) 光電 實(shí)時(shí) TMS320C6416 FPGA 基于
FPGA設(shè)計(jì)中毛刺信號(hào)解析
![](http://uphotos.eepw.com.cn/fetch/20130729/150396_1_0.jpg)
- FPGA設(shè)計(jì)中毛刺信號(hào)解析,在FPGA的設(shè)計(jì)中,毛刺現(xiàn)象是長(zhǎng)期困擾電子設(shè)計(jì)工程師的設(shè)計(jì)問(wèn)題之一, 是影響工程師設(shè)計(jì)效率和數(shù)字系統(tǒng)設(shè)計(jì)有效性和可靠性的主要因素。由于信號(hào)在FPGA的內(nèi)部走線和通過(guò)邏輯單元時(shí)造成的延遲,在多路信號(hào)變化的瞬間,組合
- 關(guān)鍵字: 解析 信號(hào) 毛刺 設(shè)計(jì) FPGA
arm+fpga介紹
您好,目前還沒(méi)有人創(chuàng)建詞條arm+fpga!
歡迎您創(chuàng)建該詞條,闡述對(duì)arm+fpga的理解,并與今后在此搜索arm+fpga的朋友們分享。 創(chuàng)建詞條
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