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            基于FPGA的高速串行傳輸系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

            • 摘要:作為高傳輸速率和低設(shè)計(jì)成本的傳輸技術(shù),串行傳輸技術(shù)被廣泛應(yīng)用于高速通信領(lǐng)域,并已成為業(yè)界首選。在此基于對(duì)高速串行傳輸系統(tǒng)的分析,對(duì)實(shí)例進(jìn)行了總體設(shè)計(jì)驗(yàn)證,最終達(dá)到高速傳輸?shù)哪康摹?br />關(guān)鍵詞:FPGA;
            • 關(guān)鍵字: FPGA  高速串行  傳輸系統(tǒng)    

            基于FPGA的通用異步收發(fā)器設(shè)計(jì)

            • 摘要:采用Verilog HDL語(yǔ)言作為硬件功能的描述,運(yùn)用模塊化設(shè)計(jì)方法分別設(shè)計(jì)了通用異步收發(fā)器(UART)的發(fā)送模塊、接收模塊和波特率發(fā)生器,并結(jié)合現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)的特點(diǎn),實(shí)現(xiàn)了一個(gè)可移植的UART模塊。該設(shè)計(jì)不
            • 關(guān)鍵字: FPGA  異步收發(fā)器    

            基于FPGA多通道同步數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

            •  引言  數(shù)據(jù)采集在工業(yè)測(cè)控領(lǐng)域里有廣泛的應(yīng)用,它已成為計(jì)算機(jī)測(cè)控系統(tǒng)的一個(gè)重要的環(huán)節(jié),尤其在設(shè)備故障監(jiān)測(cè)系統(tǒng)中,由于各種設(shè)備的結(jié)構(gòu)復(fù)雜,運(yùn)動(dòng)形式多種多樣,發(fā)生故障的可能部位很難確定,因此我們需要從設(shè)
            • 關(guān)鍵字: FPGA  多通道  同步數(shù)據(jù)采集  系統(tǒng)設(shè)計(jì)    

            ARM全力對(duì)付硅和電池的障礙

            • 硅縮放和電池技術(shù)的一個(gè)大障礙阻礙了在移動(dòng)通信系統(tǒng)中的巨大的機(jī)遇,一個(gè)ARM執(zhí)行在主題演講中說(shuō)。
            • 關(guān)鍵字: ARM  電池技術(shù)  

            NEXYS3 FPGA 開(kāi)發(fā)平臺(tái)

            • Digilent公司推出了一款新型的基于FPGA的硬件開(kāi)發(fā)平臺(tái),NEXYSTM3開(kāi)發(fā)板。此開(kāi)發(fā)板采用了Xilinx公司最先進(jìn)的Spartan6 FPGA芯片,擁有48M字節(jié)大小的外部存儲(chǔ)器(包括2個(gè)由Micron公司生產(chǎn)的非易失性的相變存儲(chǔ)器)、USB以及以太網(wǎng)接口,還有其他通用的I/O器件。
            • 關(guān)鍵字: Digilent  FPGA  

            基于ARM的遠(yuǎn)距離便攜式無(wú)線傳輸系統(tǒng)

            • 基于ARM的遠(yuǎn)距離便攜式無(wú)線傳輸系統(tǒng),摘要:為了解決傳統(tǒng)數(shù)據(jù)傳榆系統(tǒng)笨重、繁瑣、造價(jià)高、擴(kuò)展性差等缺點(diǎn),設(shè)計(jì)了一種基于ARM的便攜式無(wú)線傳輸系統(tǒng),可靈活地與數(shù)據(jù)采集設(shè)備進(jìn)行遠(yuǎn)距離數(shù)據(jù)傳輸。該系統(tǒng)可進(jìn)行遠(yuǎn)距離無(wú)線傳輸,并對(duì)數(shù)據(jù)進(jìn)行顯示、存儲(chǔ)、處
            • 關(guān)鍵字: 無(wú)線  傳輸系統(tǒng)  便攜式  遠(yuǎn)距離  ARM  基于  

            基于FPGA的交通燈系統(tǒng)控制設(shè)計(jì)

            • 摘要:為了對(duì)交通燈系統(tǒng)進(jìn)行精確控制,采用FPGA實(shí)驗(yàn)板,在QuartusⅡ軟件環(huán)境下,分別實(shí)現(xiàn)脈沖發(fā)生模塊、狀態(tài)定時(shí)模塊、交通燈顯示模塊、時(shí)間顯示模塊,進(jìn)行仿真實(shí)驗(yàn)和硬件下載,獲得的測(cè)試結(jié)果滿足設(shè)計(jì)要求。由于采用
            • 關(guān)鍵字: FPGA  交通燈  系統(tǒng)  控制設(shè)計(jì)    

            基于FPGA的遠(yuǎn)距離測(cè)溫器數(shù)控系統(tǒng)設(shè)計(jì)

            • 摘要:介紹了遠(yuǎn)距離測(cè)溫器的結(jié)構(gòu)組成和工作原理,設(shè)計(jì)了基于FPGA的遠(yuǎn)距離測(cè)溫器數(shù)控系統(tǒng)的數(shù)據(jù)采集與控制系統(tǒng),使用Altera公司的Cyclonell系列的FPGA實(shí)現(xiàn)了包括數(shù)據(jù)采集、數(shù)據(jù)通信等控制功能,著重?cái)⑹隽擞布c軟件的
            • 關(guān)鍵字: FPGA  測(cè)溫器  數(shù)控  系統(tǒng)設(shè)計(jì)    

            基于FPGA的DDS+DPLL跳頻信號(hào)源設(shè)計(jì)

            • 摘要:針對(duì)跳頻通信系統(tǒng)有固有噪聲的特點(diǎn),結(jié)合DDS+DPLL高分辨率、高頻率捷變速度的優(yōu)點(diǎn),并采用Altera公司的Quartus-Ⅱ_10.1軟件進(jìn)行設(shè)計(jì)綜合,提出了一種新型的跳頻信號(hào)源。結(jié)果表明,該設(shè)計(jì)中DPLL時(shí)鐘可達(dá)到12
            • 關(guān)鍵字: FPGA  DPLL  DDS  跳頻信號(hào)源    

            基于JTAG的ARM芯片系統(tǒng)調(diào)試

            • 基于JTAG的ARM芯片系統(tǒng)調(diào)試,1 引言  隨著嵌入式處理器性能的逐步提高,運(yùn)算速度越來(lái)越快、處理的數(shù)據(jù)量越來(lái)越大,傳統(tǒng)的調(diào)試方法如ROM駐留監(jiān)控程序以及串口調(diào)試工具已經(jīng)不能滿足要求。ARM處理器采用一種基于JTAG的ARM的內(nèi)核調(diào)試通道,它具有典
            • 關(guān)鍵字: 系統(tǒng)  調(diào)試  芯片  ARM  JTAG  基于  

            FPGA實(shí)現(xiàn)復(fù)接與分接系統(tǒng)

            • FPGA實(shí)現(xiàn)復(fù)接與分接系統(tǒng),引言  近年來(lái)可編程器件的應(yīng)用日益廣泛,使用較多的是現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)和復(fù)雜可編程邏輯器件(CPLD)。FPGA器件性能優(yōu)越,使用方便,成本低廉,投資風(fēng)險(xiǎn)小,使用FPGA設(shè)計(jì)可以完全根據(jù)設(shè)計(jì)者需要開(kāi)發(fā)ASIC芯片,
            • 關(guān)鍵字: 系統(tǒng)  實(shí)現(xiàn)  FPGA  

            ARM系統(tǒng)預(yù)引導(dǎo)固件的新機(jī)遇-UEFI

            • ARM系統(tǒng)預(yù)引導(dǎo)固件的新機(jī)遇-UEFI,ARM處理器已經(jīng)在智能手機(jī)市場(chǎng)占主導(dǎo)地位,并越來(lái)越成為整個(gè)嵌入式領(lǐng)域的主流。最近,ARM處理器也進(jìn)軍服務(wù)器領(lǐng)域,追求計(jì)算連續(xù)性?! ∪欢?,歷史上,ARM系統(tǒng)沒(méi)有一個(gè)預(yù)引導(dǎo)固件的標(biāo)準(zhǔn)。這使得每個(gè)設(shè)計(jì)都有自己獨(dú)特的
            • 關(guān)鍵字: 機(jī)遇  -UEFI  固件  引導(dǎo)  系統(tǒng)  ARM  

            基于ARM和CPLD的嵌入式視覺(jué)系統(tǒng)設(shè)計(jì)

            • 目前,關(guān)于視覺(jué)系統(tǒng)的研究已經(jīng)成為熱點(diǎn),也有開(kāi)發(fā)出的系統(tǒng)可供參考。但這些系統(tǒng)大多是基于PC機(jī)的,由于算法和硬件結(jié)構(gòu)的復(fù)雜性而使其在小型嵌入式系統(tǒng)中的應(yīng)用受到了限制。上述系統(tǒng)將圖像數(shù)據(jù)采集后,視覺(jué)處理算法是
            • 關(guān)鍵字: CPLD  ARM  嵌入式視覺(jué)  系統(tǒng)設(shè)計(jì)    

            以FPGA為基礎(chǔ)的SoC驗(yàn)證平臺(tái) 自動(dòng)化電路仿真?zhèn)慑e(cuò)功

            • 隨著系統(tǒng)芯片(SoC)設(shè)計(jì)的體積與復(fù)雜度持續(xù)升高,驗(yàn)證作業(yè)變成了瓶頸:占了整個(gè)SoC研發(fā)過(guò)程中70% 的時(shí)間。因此,任何能夠降低驗(yàn)證成本并能更早實(shí)現(xiàn)驗(yàn)證sign-off的方法都是眾人的注目焦點(diǎn)。臺(tái)灣工業(yè)技術(shù)研究院 (工研院
            • 關(guān)鍵字: FPGA  SoC  基礎(chǔ)  電路仿真    

            基于FPGA軟核的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

            • 為解決不同性能指標(biāo)數(shù)據(jù)采集系統(tǒng)開(kāi)發(fā)時(shí)間較長(zhǎng)的問(wèn)題,提出了一種將FPGA軟核技術(shù)應(yīng)用于高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)的方法。系統(tǒng)以Xilinx公司的FPGA為例設(shè)計(jì)軟核,使用VHDL語(yǔ)言對(duì)軟核進(jìn)行模塊化設(shè)計(jì)。介紹了數(shù)據(jù)采集系統(tǒng)的硬件電路、USB固件程序、USB驅(qū)動(dòng)程序以及LabVIEW上位機(jī)的設(shè)計(jì)。該數(shù)據(jù)采集系統(tǒng)結(jié)構(gòu)可移植性強(qiáng),有利于縮短同類型系統(tǒng)設(shè)計(jì)研發(fā)周期。
            • 關(guān)鍵字: FPGA  軟核  高速數(shù)據(jù)  采集    
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