ModelSim和QuestaSim功能簡介及應(yīng)用
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ModelSim支持RTL仿真，門級仿真，時序仿真：
主要特點：
*采用直接編譯結(jié)構(gòu)，編譯仿真速度最快；
*單一內(nèi)核無縫地進(jìn)行VHDL和Verilog混合仿真；
*與機(jī)器和版本無關(guān)，便于數(shù)據(jù)移植和庫維護(hù)；
*與機(jī)器無關(guān)的編譯代碼編于保護(hù)和利用IP；
*簡單易用和豐富的圖形用戶界面，快速全面調(diào)試；
*Tcl/Tk用戶可定制仿真器；
*完全支持VHDL/Verilog國際標(biāo)準(zhǔn),完全支持Verilog 2001；
*支持眾多的ASIC和FPGA廠家?guī)欤?br />*集成的Performance analyzer幫助分析性能瓶頸，加速仿真；
*靈活的執(zhí)行模式，Debug模式可以進(jìn)行高效的調(diào)試，效率模式大幅度提高仿真速度。
*加強的代碼覆蓋率功能Code coverage，能報告出statement 、branch、condition、
* expression、toggle、fsm等多種覆蓋率情況，進(jìn)一步提高了測試的完整性；
*同一波形窗口可以顯示多組波形，并且能進(jìn)行多種模式的波形比較（Wave Compare）；
*先進(jìn)的Signal Spy功能，可以方便地訪問VHDL 或者 VHDL 和Verilog 混合設(shè)計中的下層模塊的信號，便于設(shè)計調(diào)試；
*支持加密IP;
*集成的 C調(diào)試器，支持 用C 語言完成測試平臺和模塊；支持64位的OS;
ModelSim用戶界面：
ModelSim設(shè)計流程：
ModelSim coverage驗證：
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