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FPGA實(shí)現(xiàn)時(shí)分多址的一種改進(jìn)型方法

作者：時(shí)間：2011-03-17 來源：網(wǎng)絡(luò)

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在端口A輸入時(shí)鐘clk3072的每個(gè)下降沿，端口A輸入地址AddrIn都遞增1，則在elk3072的上升沿，根據(jù)例化的雙口RAM的IP核，端口A的四路輸入數(shù)據(jù)將存儲進(jìn)相應(yīng)的地址空間中。

在端口B輸入時(shí)鐘elk12288的每個(gè)下降沿，端口B輸入地址AddrOut都遞增1，則在elk12288的上升沿，根據(jù)例化的雙口RAM的IP核，相應(yīng)的地址空間中的數(shù)據(jù)將通過Dout被讀出來。

依次將輸出數(shù)據(jù)以時(shí)分多址的幀格式傳輸出去。

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關(guān)鍵詞： FPGA 時(shí)分 多址 改進(jìn)型

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