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            EEPW首頁(yè) > EDA/PCB > 設(shè)計(jì)應(yīng)用 > 基于VHDL語(yǔ)言的幾種消抖電路的設(shè)計(jì)

            基于VHDL語(yǔ)言的幾種消抖電路的設(shè)計(jì)

            作者: 時(shí)間:2011-04-13 來(lái)源:網(wǎng)絡(luò) 收藏

            主要程序結(jié)構(gòu)如下:
            d.JPG
            e.JPG
            圖2是N為7的波形仿真圖。在計(jì)數(shù)器狀態(tài)為0時(shí),key_in有按鍵操作,計(jì)數(shù)器開始連續(xù)計(jì)數(shù)直到計(jì)數(shù)器狀態(tài)為0;計(jì)數(shù)器狀態(tài)為1-7時(shí),key _in任何操作對(duì)計(jì)數(shù)器工作無(wú)影響,計(jì)數(shù)器在狀態(tài)為1時(shí),輸出一個(gè)單脈沖,脈沖寬度為1個(gè)時(shí)鐘周期。

            本文引用地址:http://www.biyoush.com/article/191239.htm

            f.JPG


            該設(shè)計(jì)方案的特點(diǎn)是能很好消除按鍵抖動(dòng)產(chǎn)生的連續(xù)脈沖,對(duì)按鍵時(shí)間沒(méi)有要求,缺點(diǎn)是在計(jì)數(shù)器狀態(tài)為0時(shí),遇到干擾、噪音等時(shí)會(huì)有輸出,從而產(chǎn)生誤操作。

            2 D觸發(fā)器型
            D觸發(fā)器型設(shè)計(jì)了三個(gè)D觸發(fā)器與一個(gè)三輸入與門。三個(gè)D觸發(fā)器串行連接,其Q輸出端分別與三輸入與門的輸入端連接,D觸發(fā)器型RTL電路如圖3所示。

            h.JPG



            關(guān)鍵詞: VHDL 消抖電路

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