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      基于FPGA無線傳感器網(wǎng)絡MAC控制器的設計

      作者: 時間:2011-06-17 來源:網(wǎng)絡 收藏

      接收狀態(tài)機產(chǎn)生整個接收過程所需要的控制信號,在控制信號的作用下將接收到的幀存儲到RxFIFO。接收部分的狀態(tài)轉移如圖6所示。

      本文引用地址:http://www.biyoush.com/article/191147.htm

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      (1)IDIE:初始狀態(tài)。當接收狀態(tài)機上電復位或者成功接收到幀時,進入到此狀態(tài)。收到RxCSP_en信號時,開始數(shù)據(jù)接收過程。
      (2)Rx_Preamhle:接收前導序列。啟動序列檢測器,開始檢測數(shù)據(jù)線上符合IEEE802.15.4協(xié)議的序列。
      (3)Rx_Length:接收數(shù)據(jù)幀長度。在這個狀態(tài)下,開始接收數(shù)據(jù)的長度,同時存入計數(shù)器寄存器。
      (4)Rx_MPDU:接收數(shù)據(jù)幀MPDU部分。這個狀態(tài)下,接收幀的有效數(shù)據(jù)。每接收到1 Byte有效數(shù)據(jù)后,便產(chǎn)生接收FIFO緩存寫信號,同時將數(shù)據(jù)寫入到接收FIFO。如果接收數(shù)據(jù)CRC校驗有誤或者接收過程中發(fā)生堵塞現(xiàn)象,則狀態(tài)機退回到初始狀態(tài)。
      (5)Rx_CRC_CHECK:接收CRC校驗。接收數(shù)據(jù)包的CRC校驗碼,同時啟動CRC校驗的過程。
      (6)Rx_RSSI_PAD:幀末尾RSSI值填充。計算RSSI強度值,并附著CRC校驗結果,將該字節(jié)填入接收FIFO。
      (7)Rx_CRC_PAD:CRC狀態(tài)和Correlation值填充。
      2.3 CSMN/CA協(xié)處理器模塊
      CSMA/CA協(xié)處理器是設計中的核心模塊。協(xié)處理器主要包括指令寄存器、4個輔助寄存器以及控制信號產(chǎn)生模塊。通過指令寄存器、4個輔助寄存器與系統(tǒng)CPU接口的功能。同時,控制信號產(chǎn)生模塊產(chǎn)生發(fā)送和接收模塊所需要的控制信號。
      包括4種工作狀態(tài):
      (1)睡眠狀態(tài):在該狀態(tài)下,除協(xié)處理器模塊外,所有子模塊的時鐘都將停止,從而降低功耗。只有當協(xié)處理器執(zhí)行發(fā)送使能指令或接收使能指令時,才離開睡眠狀態(tài)。
      (2)發(fā)送狀態(tài):當協(xié)處理器執(zhí)行發(fā)送使能指令時,進入發(fā)送狀態(tài)。如果一幀發(fā)送完成,則自動轉入接收狀態(tài)。
      (3)接收狀態(tài):當協(xié)處理器執(zhí)行接收使能指令時,進入接收狀態(tài)。因為接收狀態(tài)是主要的工作狀態(tài),所以在成功接收完一幀或幀校驗失敗后依然處于接收狀態(tài)。
      (4)發(fā)送應答幀狀態(tài):當協(xié)處理器執(zhí)行應答指令時,進入到此狀態(tài)。
      無論在那種狀態(tài),一旦執(zhí)行了休眠指令,控制器立即進入睡眠狀態(tài)。
      2.4 接口模塊
      接口模塊分為和系統(tǒng)MCU的特殊功能寄存器接口以及和與物理層芯片的物理接口。MCU要想控制MAC控制器的運行,就必須采用一種接口與它進行通信,本文采用SPI接口。
      SPI(Serial Peripheral Interface)是一種串行外圍設備接口,是Motorola首先在其MC68HCXX系列處理器上定義的。優(yōu)點如下:第一,它是一種高速的,全雙工,同步的通信總線;第二,它只占用4根線,節(jié)約了芯片的管腳,同時為PCB的布局上節(jié)省空間。SPI接口主要應用在EEPROM,F(xiàn)lash,實時時鐘,A/D轉換器,還有數(shù)字信號處理器和數(shù)字信號解碼器之間。
      SPI的通信原理:它以主從方式工作,這種模式通常有一個主設備,一個或多個從設備,需要至少4根線。
      (1)SEL:從設備使能信號,由主設備控制。
      (2)MOSI:主設備數(shù)據(jù)輸出,從設備數(shù)據(jù)輸入。
      (3)MISO:主設備輸入,從設備數(shù)據(jù)輸出。
      (4)SCLK:時鐘信號,由主設備產(chǎn)生。
      其中,SEL是控制芯片是否被選中,也就是說只有片選信號為預先規(guī)定的使能信號時,對此芯片的操作才有效。這就允許在同一總線上連接多個SPI設備成為可能。由SCLK提供時鐘脈沖,MOSI和MISO則基于此脈沖完成數(shù)據(jù)傳輸。數(shù)據(jù)輸出通過MOSI,MISO線,數(shù)據(jù)在時鐘上升沿或下降沿時改變,在緊接著的下降沿或上升沿被讀取,完成一位數(shù)據(jù)傳輸。輸入也使用同樣的原理。這樣,在至少8次時鐘信號改變內,就可以完成8位數(shù)據(jù)的傳輸。MAC控制器采取的是上升沿接收、下降沿發(fā)送、高位先發(fā)送。

      3 綜合結果
      本設計采用Verilog語言,芯片使用Altera公司的Cyclone,整個設計都是在Altera公司的Quartus8.0下進行綜合、布局布線以及仿真。表1是綜合結果。

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      4 結束語
      本文給出了完全用實現(xiàn)MAC控制器的設計方法,該方法只需外接物理層芯片和MCU便可完成網(wǎng)絡功能。從而有效降低了成本,減少了版面積,提高了整個系統(tǒng)的集成度。


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