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            LTE中卷積碼的譯碼器設(shè)計(jì)與FPGA實(shí)現(xiàn)

            作者: 時(shí)間:2011-08-05 來源:網(wǎng)絡(luò) 收藏

            3 的設(shè)計(jì)與實(shí)現(xiàn)
            的設(shè)計(jì)中,采用固定延遲算法。首先對(duì)進(jìn)入之前的軟判決數(shù)據(jù)進(jìn)行處理,如圖3所示。

            本文引用地址:http://www.biyoush.com/article/191081.htm

            c.jpg


            將其處理成圖中所示的待譯碼數(shù)據(jù)格式,其中DL是實(shí)際輸入的所需譯碼數(shù)據(jù)長度,PL為所需在數(shù)據(jù)中加的數(shù)據(jù)前綴長度,也即上述固定延遲算法中的頭譯碼長度,DD為所要達(dá)到的譯碼深度(Decoding Depth),DD-DL為所要加的后綴長度,即固定延遲算法中的尾譯碼長度。在設(shè)計(jì)中選擇PL為96,由于在系統(tǒng)中DL是變化的,最大為76,不能夠選擇固定的尾譯碼長度,但在本文設(shè)計(jì)中選擇固定的DD為192。
            譯碼器的整體設(shè)計(jì)框圖,如圖4所示。圖中譯碼器主要由譯碼器系統(tǒng)控制模塊,分支度量(BM)模塊,加比選(ACS)模塊,回溯(TB)模塊和輸出緩存組成。

            d.jpg


            數(shù)據(jù)處理由譯碼器系統(tǒng)控制模塊控制完成,它控制從輸入緩存中讀入數(shù)據(jù)進(jìn)行譯碼。
            下面對(duì)譯碼器BM模塊、ACS模塊和TB模塊這三個(gè)核心模塊的具體設(shè)計(jì)與實(shí)現(xiàn)進(jìn)行詳細(xì)介紹。
            3.1 BM模塊
            在整個(gè)系統(tǒng)中分支度量采用的是軟判決數(shù)據(jù)。軟判決根據(jù)接收的的軟判決比特和編碼器網(wǎng)格圖的參考分支,計(jì)算其歐氏距離。一般的歐氏距離采用如下公式計(jì)算:
            e.jpg
            式中:ri為接收的軟判決比特;ci為編碼器網(wǎng)格圖的參考分支。上述公式經(jīng)簡化后結(jié)合系統(tǒng)所用軟判決數(shù)據(jù)特點(diǎn),可以得到如下計(jì)算方法:
            f.jpg
            式中:Ri為接收的軟判決比特的絕對(duì)值;Ci∈{0,1)為參考分支比特。
            3.2 BM模塊
            在每一個(gè)時(shí)鐘中,用得到的分支度量(BM)和路徑度量(PM)相加,得到下一時(shí)刻狀態(tài)的多個(gè)路徑度量,通過比較,選擇一個(gè)幸存分支。將每個(gè)狀態(tài)的幸存分支,存儲(chǔ)到回溯存儲(chǔ)器中,更新路徑度量。在設(shè)計(jì)中,存儲(chǔ)從數(shù)據(jù)段(即圖4中的Initial State)開始,在這之前的幸存分支不需存儲(chǔ)。同時(shí),計(jì)算出64個(gè)狀態(tài)中,具有最小路徑度量的狀態(tài)。
            如果直接將前一狀態(tài)的路徑度量與分支度量相加,得到下一狀態(tài)的路徑度量,來選擇幸存分支,如圖2中,比較PMi+BMp和PMj+BMq選擇幸存分支。每個(gè)狀態(tài)2個(gè)加法器,64個(gè)狀態(tài)就需要128個(gè)加法器。



            關(guān)鍵詞: FPGA LTE 卷積碼 譯碼器

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