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            基于FPGA的存儲測試系統(tǒng)的設(shè)計(jì)

            作者: 時(shí)間:2011-09-13 來源:網(wǎng)絡(luò) 收藏

            根據(jù)被測信號頻率變化很大的特點(diǎn),設(shè)計(jì)如圖2所示的狀態(tài)圖,實(shí)現(xiàn)對此類信號的變頻采樣。測試分環(huán)境對信號采樣記錄,每個(gè)環(huán)境的采樣頻率可以在采樣前進(jìn)行設(shè)置,本設(shè)計(jì)為三個(gè)環(huán)境,即采樣頻率最多變化三次。

            本文引用地址:http://www.biyoush.com/article/191009.htm

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            開始之前,通過軟件編程將采集存儲過程分為幾個(gè)階段,根據(jù)被測信號的變化,每一個(gè)階段的采樣頻率、存儲點(diǎn)數(shù)、采樣開始時(shí)間會作自適應(yīng)的調(diào)整。首先接通電源使電路處于復(fù)位態(tài),此時(shí)數(shù)字電源VDD為通電、模擬電源VEE為斷電狀態(tài),中只有控制模塊工作;然后對電路編程設(shè)定各個(gè)環(huán)境的采樣頻率,給電路上電,電路進(jìn)入等待觸發(fā)態(tài),此時(shí)VDD、VEE通電,存儲器、AD轉(zhuǎn)換器啟動,開始采樣,地址計(jì)數(shù)器開始工作;觸發(fā)信號TRI1到來后,進(jìn)入f1采樣態(tài),系統(tǒng)按編程設(shè)定的采樣頻率f1開始采樣,負(fù)延遲計(jì)數(shù)器開始工作;2環(huán)境觸發(fā)后,系統(tǒng)按照設(shè)定的采樣頻率f2進(jìn)行采樣,此時(shí)處于f2采樣態(tài);3環(huán)境觸發(fā)后,系統(tǒng)按采樣頻率f3采樣,處于f3采樣態(tài);當(dāng)負(fù)延遲計(jì)數(shù)器計(jì)滿設(shè)定值時(shí),地址計(jì)數(shù)器和負(fù)延遲計(jì)數(shù)器均停止工作,VEE斷電,系統(tǒng)進(jìn)入等待讀出態(tài);在讀出數(shù)據(jù)態(tài),地址同步推進(jìn),直到讀完所有的數(shù)據(jù)。
            2.2 變頻采樣的模塊設(shè)計(jì)
            采樣頻率決定了采樣信號的質(zhì)量和數(shù)量,采樣頻率太高,會使采得的信號數(shù)量劇增,占用大量的存儲單元,采樣頻率太低的話,會使模擬信號的某些信息丟失,恢復(fù)出的信號會出現(xiàn)失真。為了達(dá)到最佳效果,必須根據(jù)信號的特點(diǎn)選擇合適的采樣頻率。圖3為設(shè)計(jì)的采樣時(shí)鐘選擇模塊。

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            關(guān)鍵詞: FPGA 存儲測試 系統(tǒng)

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