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            EEPW首頁 > EDA/PCB > 設(shè)計(jì)應(yīng)用 > 基于FPGA開發(fā)靜態(tài)無功補(bǔ)償控制器

            基于FPGA開發(fā)靜態(tài)無功補(bǔ)償控制器

            作者: 時(shí)間:2012-05-29 來源:網(wǎng)絡(luò) 收藏

            用戶感言

            “我們原來使用DSP開發(fā)板開發(fā)核心控制算法,再進(jìn)行外圍硬件電路及外殼設(shè)計(jì)和封裝?,F(xiàn)場運(yùn)行的反饋是穩(wěn)定性差,調(diào)試排錯(cuò)困難,導(dǎo)致整個(gè)的上市時(shí)間延長。在上海聚星儀器的協(xié)助下我們嘗試在NI CompactRIO平臺(tái)上開發(fā)控制算法,硬件接口邏輯設(shè)計(jì),上下位機(jī)通信等功能,算法開發(fā)時(shí)間得到有效縮短,最終發(fā)布并安裝到現(xiàn)場后系統(tǒng)穩(wěn)定性大大提高。目前已銷售了多套在NI CompactRIO上實(shí)現(xiàn)的靜態(tài)器。”

            硬件:CompactRIO,cRIO 9012,cRIO 9114,NI 9205,NI 9215,NI 9401,NI 9403


            圖1 基于NI CompactRIO 的SVC全數(shù)字控制系統(tǒng)


            圖2 LabVIEW編寫的PPL環(huán)節(jié)界面


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            關(guān)鍵詞: FPGA 無功補(bǔ)償 控制器

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