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            EEPW首頁(yè) > EDA/PCB > 設(shè)計(jì)應(yīng)用 > 基于CPCI總線(xiàn)的一體化數(shù)據(jù)處理中心的研究與實(shí)現(xiàn)

            基于CPCI總線(xiàn)的一體化數(shù)據(jù)處理中心的研究與實(shí)現(xiàn)

            作者: 時(shí)間:2013-05-16 來(lái)源:網(wǎng)絡(luò) 收藏

            其中LHOLD、BLAST、LA[31:2]、ADS、LW/R等信號(hào)由PCI9656驅(qū)動(dòng),LHOLDA、LBE[3:0]、READY信號(hào)由FPGA驅(qū)動(dòng)。通過(guò)模塊內(nèi)部設(shè)計(jì)的狀態(tài)機(jī)實(shí)現(xiàn)對(duì)局部的控制,具體實(shí)現(xiàn)過(guò)程如圖5所示。

            本文引用地址:http://www.biyoush.com/article/189599.htm

            f.JPG


            1)IDLE狀態(tài) 系統(tǒng)上電或復(fù)位后,處于IDLE狀態(tài)。在IDLE狀態(tài)時(shí),F(xiàn)PGA監(jiān)測(cè)LHOLD信號(hào),當(dāng)單板計(jì)算機(jī)訪(fǎng)問(wèn)FPGA時(shí),LHOLD信號(hào)變?yōu)楦唠娖?。FPGA監(jiān)測(cè)到該高電平后,立即使LHOLDA信號(hào)為高電平,轉(zhuǎn)入ADDR_S狀態(tài)。
            2)ADDR_S狀態(tài) 在此狀態(tài)下,F(xiàn)PGA監(jiān)測(cè)ADS信號(hào),當(dāng)ADS信號(hào)變?yōu)榈碗娖剑刂沸盘?hào)LA[31:2]有效,同時(shí)對(duì)輸入的讀寫(xiě)信號(hào)進(jìn)行判斷,若為讀操作,轉(zhuǎn)入READ狀態(tài),若為寫(xiě)操作,轉(zhuǎn)入WRITE狀態(tài)。
            3)WRITE狀態(tài) FPGA控制READY信號(hào)為低電平,以使上的數(shù)據(jù)有效,F(xiàn)PGA可以控制LBE[3:0]信號(hào),以對(duì)傳輸?shù)臄?shù)據(jù)字節(jié)進(jìn)行選取。并監(jiān)測(cè)BLAST信號(hào),當(dāng)監(jiān)測(cè)到BLAST信號(hào)為低電平時(shí),表示傳輸最后一個(gè)數(shù)據(jù),轉(zhuǎn)入THE_END狀態(tài)。
            4)READ狀態(tài) 同WRITE狀態(tài)相似。
            5)THE_END狀態(tài) 數(shù)據(jù)傳輸結(jié)束,F(xiàn)PGA監(jiān)測(cè)BLAST信號(hào)變?yōu)楦唠娖酵瑫r(shí)將READY信號(hào)變?yōu)楦唠娖?。?dāng)LHOLD信號(hào)變?yōu)榈碗娖胶?,LHOLDA信號(hào)變?yōu)榈碗娖剑D(zhuǎn)入IDLE狀態(tài),等待下一次傳輸。
            3.3 光纖通信電路和控制模塊設(shè)計(jì)
            本設(shè)計(jì)中的光纖通信電路由并串轉(zhuǎn)換電路和光傳輸電路組成。并串轉(zhuǎn)換電路采用了TI公司的TLK1501芯片,通過(guò)內(nèi)部的8B/10B編碼,將16位并行數(shù)據(jù)分成2個(gè)8位數(shù)據(jù)進(jìn)行編碼,編碼后的數(shù)據(jù)為20位,再通過(guò)并串轉(zhuǎn)換發(fā)送出去;光傳輸電路采用FINISAR公司推出的FTLF1321SIM TL光模塊,將串行數(shù)據(jù)進(jìn)行光電轉(zhuǎn)換輸出。
            光纖通信模塊內(nèi)部有一個(gè)狀態(tài)機(jī),上電或復(fù)位后,處于IDLE狀態(tài)。模塊對(duì)傳送標(biāo)志信號(hào)(TX_FLAG)監(jiān)測(cè),如果有傳送標(biāo)志(TX_FLAG=1),轉(zhuǎn)入TX_READY狀態(tài)。在正常傳送數(shù)據(jù)前,需要對(duì)芯片進(jìn)行同步操作,模塊控制信號(hào)TX-EN、TX-ER為00,連續(xù)發(fā)送3個(gè)空閑碼,使TLK1501進(jìn)入
            同步模式,狀態(tài)機(jī)轉(zhuǎn)入TX_S狀態(tài)。在TX_S狀態(tài)下,如果發(fā)送有效數(shù)據(jù),模塊控制TX_EN、TX-ER為10,進(jìn)行數(shù)據(jù)的正常發(fā)送,發(fā)送數(shù)據(jù)結(jié)束后,轉(zhuǎn)入IDLE狀態(tài),等待下一次傳輸。在接收數(shù)據(jù)時(shí),模塊監(jiān)測(cè)RX-DV,RX-ER信號(hào),如果RX-DV,RX-ER為10,正常接收數(shù)據(jù)。模塊設(shè)計(jì)的關(guān)鍵代碼如下:
            g.JPG

            4 結(jié)論
            本文通過(guò)對(duì)多種功能接口電路進(jìn)行研究分析,最終實(shí)現(xiàn)了在同一塊嵌入式板卡上集成光纖通信、A/D、D/A、、SDRAM存儲(chǔ)、FLASH存儲(chǔ)等功能。系統(tǒng)以FPGA芯片為處理核心,利用模塊化的思想進(jìn)行設(shè)計(jì),使系統(tǒng)方便擴(kuò)展、易于維護(hù)和升級(jí)。經(jīng)過(guò)長(zhǎng)期的工程實(shí)踐驗(yàn)證,本系統(tǒng)運(yùn)行可靠穩(wěn)定,能夠?qū)崿F(xiàn)在復(fù)雜工業(yè)控制系統(tǒng)中對(duì)數(shù)據(jù)靈活控制、實(shí)時(shí)處理和高效傳輸。


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