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            EEPW首頁(yè) > 嵌入式系統(tǒng) > 設(shè)計(jì)應(yīng)用 > 基于ARM與WindowsCE的LCD顯示器設(shè)計(jì)

            基于ARM與WindowsCE的LCD顯示器設(shè)計(jì)

            作者: 時(shí)間:2009-03-26 來(lái)源:網(wǎng)絡(luò) 收藏

            p_GPIORegs->GPDR1|=(XLLP_GPIO_BIT_L_DD0|XLLP_GPIO_BIT_L_DD1 |XLLP_GPIO_BIT_L_DD2|XLLP_GPIO_BIT_L_DD3
            |XLLP_GPIO_BIT_L_DD4|XLLP_GPIO_BIT_L_DD5);
            p_GPIORegs->GPDR2|=(XLLP_GPIO_BIT_L_DD6|XLLP_GPIO_BIT_L_DD7
            |XLLP_GPIO_BIT_L_DD8|XLLP_GPIO_BIT_L_DD9
            |XLLP_GPIO_BIT_L_DD10|XLLP_GPIO_BIT_L_DD11
            |XLLP_GPIO_BIT_L_DD12|XLLP_GPIO_BIT_L_DD13
            |XLLP_GPIO_BIT_L_DD14|XLLP_GPIO_BIT_L_DD15);
            p_GPIORegs->GAFR1_U=(p_GPIORegs->GAFR1_U~(XLLP_GPIO_AF_BIT_L_DD0_MASK|XLLP_GPIO_AF_BIT_L_DD1_MASK|XLLP_GPIO_AF_BIT_L_DD2_MASK|XLLP_GPIO_AF_BIT_L_DD3_MASK|XLLP_GPIO_AF_BIT_L_DD4_MASK|XLLP_GPIO_AF_BIT_L_DD5_MASK))|XLLP_GPIO_AF_BIT_L_DD0|XLLP_GPIO_AF_BIT_L_DD1|XLLP_GPIO_AF_BIT_L_DD2|XLLP_GPIO_AF_BIT_L_DD3|XLLP_GPIO_AF_BIT_L_DD4|XLLP_GPIO_AF_BIT_L_D;
            下都使用虛擬地址,經(jīng)過一個(gè)映射函數(shù)將用到的物理地址轉(zhuǎn)化為虛擬地址,這是操作系統(tǒng)所要求的,映射地址的函數(shù)為BOOL MapVirtualAddress()。

            按照屏的顯示模式來(lái)配置控制寄存器,其中包括配置控制信號(hào)的模式,通過參看的數(shù)據(jù)手冊(cè)和一系列的計(jì)算,在掌握 時(shí)序圖的基礎(chǔ)上進(jìn)行參數(shù)配置:

            L_FCLK為幀時(shí)鐘;L_LCLK_A0為行時(shí)鐘;L_BIAS為時(shí)鐘使能;L_PCLK_WR為像素時(shí)鐘,LDD17:0>為像素點(diǎn)數(shù)據(jù),在本中我們只用到了LDD15:0>。
            ENB:LCD數(shù)據(jù)使能位 HSP:水平時(shí)鐘信號(hào)電壓極性
            0------LCD不可用 0------水平時(shí)鐘為高電平有效
            1------LCD使能 1------水平時(shí)鐘為低電平有效
            PCP:像素時(shí)鐘電壓極性
            0------像素?cái)?shù)據(jù)在數(shù)據(jù)引腳為上升沿時(shí)采樣
            1------像素?cái)?shù)據(jù)在數(shù)據(jù)引腳為下降沿時(shí)采樣

            (1)行列的定義:
            PPL: LCD屏的水平像素點(diǎn)的個(gè)數(shù)。根據(jù)LCD屏的長(zhǎng)度來(lái)確定其值的大小。
            PPL =行寬-1
            在本中,行寬為800,那么PPL=800-1;
            LPP: LCD屏的垂直像素點(diǎn)的個(gè)數(shù)。根據(jù)LCD屏的寬度來(lái)確定其值的大小。
            LPP=列高―1
            在本中,列高為480,那么LPP=480―1;
            (2)L_PCLK_WR:
            VCLK是LCD控制器的時(shí)鐘信號(hào),此信號(hào)是LCD控制器和LCD驅(qū)動(dòng)器之間的象素時(shí)鐘信號(hào),VCLK計(jì)算時(shí)需先了解LCD屏所要求的幀速率的范圍,并由此設(shè)定一個(gè)在幀速率范圍內(nèi)的值為CLKVAL,VCLK與CLKVAL之間的關(guān)系可用如下公式計(jì)算:VCLK(Hz)=HCLK/((CLKVAL +1)x2)
            最小的CLKVAL為0,最大的CLKVAL由幀速率決定[8]。
            (3)各種延時(shí)的取值:
            BFW:一幀開始時(shí)所需要的延時(shí)長(zhǎng)度
            EFW:一幀結(jié)束時(shí)所需要的延時(shí)長(zhǎng)度
            VSW:幀同步信號(hào)VSYNC的寬度定義
            BLW:一行開始時(shí)所需要的延時(shí)長(zhǎng)度
            ELW:一行結(jié)束時(shí)所需要的延時(shí)長(zhǎng)度
            HSW:行同步信號(hào)HSYNC的寬度定義

            4 結(jié)束語(yǔ)

            嵌入式處理器進(jìn)行LCD設(shè)計(jì),采用LCD驅(qū)動(dòng)顯示屏,顯示模式是主動(dòng)的單掃描彩色模式,像素深度為16位的RGB格式,屏的大小為800×480。通過充分利用的硬件資源,用IntelPXA270 控制彩色顯示屏,顯示亮度達(dá)100尼特,在LCD 高亮度的情況下的功耗小于365 mW ,克服了一般 LCD 高亮度伴隨著高功耗的矛盾;支持用戶定制的TFT 液晶屏上實(shí)現(xiàn)WindowsCE 界面的圖形顯示;由于設(shè)計(jì)的硬件驅(qū)動(dòng)電路只需LCD控制器給出幀同步信號(hào)、行同步信號(hào)、像素時(shí)鐘、數(shù)據(jù)使能信號(hào)和RGB數(shù)據(jù)信號(hào),因此,設(shè)計(jì)的驅(qū)動(dòng)電路能靈活地移植到不同平臺(tái)。




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