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            SOC時序分析中的跳變點

            作者: 時間:2010-09-21 來源:網(wǎng)絡(luò) 收藏

              此時,,考慮壓擺率降級(由網(wǎng)絡(luò)引起)后,工具計算的驅(qū)動程序達到其50%的邏輯高值和負載達到其50%的邏輯高值時兩者之間的時間差。

              類似的解釋對于特定單元的輸入和輸出產(chǎn)生的下降信號和時延同樣適用。壓擺率值根據(jù).lib中提及的變量進行計算。

              b)當跳變點對于一個界面而不同時

              (i)20%比50%:

              圖4(a)描述了驅(qū)動程序時延跳變點為20%而對負載單元跳變點為50%的情況。

              在這種情況下,與負載信號相比,驅(qū)動程序的信號會快速達到其時延跳變點值。因此此類界面的網(wǎng)絡(luò)時延會大于驅(qū)動程序也達到50%情形下的時延[圖3(a)]。

              

            驅(qū)動程序時延跳變點為20

              圖4(a)

              工具可通過線性或非線性擴展計算網(wǎng)絡(luò)上出現(xiàn)的額外時延。

              (ii)50%比20%

              圖4(b)描述了驅(qū)動程序跳變點為50%而負載單元的跳變點為20%的情形。

              在這種情況下,與驅(qū)動信號相比,負載的信號會更早達到其時延跳變點值。這種情況通過工具借助擴展(線性或非線性)來進行處理。

              

            驅(qū)動程序跳變點為50

              圖4(b)

              這里需要注意的是:在這種情況下,擴展會引起“負時延”。

              應注意:盡管現(xiàn)實世界不能在時域中后向穿越,但是時序工具需要將這種時延考慮在內(nèi),這樣,從開始點(在本例中為驅(qū)動單元的輸入引腳)到終端點(在本例中為負載單元的輸出引腳)的整體路徑時延接近現(xiàn)實世界時延(Spice)。

              5.與跳變點相關(guān)的其他問題:

              (i)SDF中的負時延:在通過時序工具完成擴展后產(chǎn)生的負時延將以標準時延格式(SDF)進行復制,用于門級模擬。不希望發(fā)生這種情況,因為門級模擬器無法處理負時延。

              它們要么標志錯誤消息要么表示此類情況的零時延。作為一種變通方法,可編寫一個腳本(附錄A),根據(jù)所計算的負時延,增加(或減少)負載單元(或驅(qū)動單元)時延。

              (ii)端口和IO單元之間的附加時延:

              通常時序工具報告端口到I/O單元的時延。在硅片上,該網(wǎng)絡(luò)作為接合線出現(xiàn)在芯片外部。因此,對于該網(wǎng)絡(luò)物理信息不能進行量化。

              時序工具提供此類網(wǎng)絡(luò)的時延報告。原因包括:

              a)由于沒有時序模型可用于端口,因此時序工具采用用戶定義的或默認跳變點和電壓電平計算時延。

              b)由于假定跳變點和端口w.r.tI/O單元跳變點的電壓電平值之間有差額。圖5(a)和圖5(b)描述了此類情況。

              

            假定跳變點和端口w

              圖5(a)

              

            假定跳變點和端口w

              圖5(b)



            關(guān)鍵詞: 分析 時序 SOC

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