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            EEPW首頁 > 嵌入式系統(tǒng) > 設(shè)計(jì)應(yīng)用 > 基于FPGA的短幀Turbo譯碼器的實(shí)現(xiàn)

            基于FPGA的短幀Turbo譯碼器的實(shí)現(xiàn)

            作者: 時(shí)間:2012-10-31 來源:網(wǎng)絡(luò) 收藏

            碼雖然具有優(yōu)異的譯碼性能,但是由于其譯碼復(fù)雜度高,譯碼延時(shí)大等問題,嚴(yán)重制約了碼在高速通信系統(tǒng)中的應(yīng)用。因此,如何設(shè)計(jì)一個(gè)簡(jiǎn)單有效的譯碼器是目前碼實(shí)用化研究的重點(diǎn)。本文主要介紹了短幀Turbo譯碼器的,并對(duì)相關(guān)參數(shù)和譯碼結(jié)構(gòu)進(jìn)行了描述。

            本文引用地址:http://www.biyoush.com/article/148285.htm

            1 幾種譯碼算法比較


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