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            基于CPLD的水下沖擊波記錄儀的設計
            
                                                            
                                        
              
                    	
            • 基于CPLD的水下沖擊波記錄儀的設計,1.引言 
              　　
              隨著大規(guī)模集成電路和單片機的迅速發(fā)展，復雜可編程邏輯器件（CPLD）具有使用靈活、可靠性高、功能強大的優(yōu)點，在電子產(chǎn)品設計中得到了廣泛的應用。CPLD可實現(xiàn)在系統(tǒng)編程，重復多次，而且還兼容IEEE1
              • 
                    	                        
            • 關鍵字：
                        記錄儀  設計  沖擊波  水下  CPLD  基于                          
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            節(jié)省電池能量的系統(tǒng)斷電電路CPLD
            
                                                            
                                        
              
                    	
            • 節(jié)省電池能量的系統(tǒng)斷電電路CPLD,今天，大多數(shù)的CPLD（復雜可編程邏輯器件）都采用可減少功耗的工作模式，但當系統(tǒng)未使用時，應完全切斷電源以保存電池能量，從而實現(xiàn)很多設計者的終極節(jié)能目標。圖1描述了如何在一片CPLD 上增加幾只分立元件，實現(xiàn)一
              • 
                    	                        
            • 關鍵字：
                        電路  CPLD  斷電  系統(tǒng)  電池  能量  節(jié)省                          
              • 
                   	
            
                    
            
                
            
                                
            
                    
            基于CPLD的專用鍵盤接口芯片的方案設計
            
                                                            
                                        
              
                    	
            • 基于CPLD的專用鍵盤接口芯片的方案設計,在單片機應用系統(tǒng)中，存在多種形式的外部數(shù)據(jù)輸入接口界面，例如RS-232C串行通信、鍵盤輸入等[1,4] 。其中利用鍵盤接口輸入數(shù)據(jù)，是實現(xiàn)現(xiàn)場實時調(diào)試、數(shù)據(jù)調(diào)整和控制最常用的方法。單片機的外圍鍵盤擴展電路有多種實
              • 
                    	                        
            • 關鍵字：
                        芯片  方案設計  接口  鍵盤  CPLD  專用  基于                          
              • 
                   	
            
                    
            
                
            
                                
            
                    
            基于CPLD的數(shù)字電壓表設計
            
                                                            
              
                    	
            • 雙積分型ADC具有轉換精度高，速度慢的特點，因而被廣泛應用于高精度數(shù)字儀器儀表中。該設計的主要創(chuàng)新點是以可編程器件(CPL-D)為核心，采用積分電路、檢零比較器等組成16位ADC，控制部分采用51單片機，能實現(xiàn)自動量程轉換。由于采用了CPLD技術，減少了外界干擾和所占空間，而且大大提高了系統(tǒng)的響應時間，提高了數(shù)字電壓表的性能。
              • 
                    	                        
            • 關鍵字：
                        CPLD  數(shù)字  電壓表設計                            
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            用VHDL實現(xiàn)的有線電視機頂盒信源發(fā)生方案
            
                                                            
              
                    	
            • VHDL是隨著可編輯邏輯器件（PLD）的發(fā)展而發(fā)展起來的一種硬件描述語言。它是1980年美國國防部VHSIC（超高速集...
              • 
                    	                        
            • 關鍵字：
                        PLD  VHDL  機頂盒  信源                          
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            基于CPLD的圖像傳感器非均勻性校正研究
            
                                                            
              
                    	
            • 圖像傳感器是現(xiàn)代視覺信息獲取的一種基礎器件,它將入射到光敏面上按空間分布的光強信息轉換為按時序輸...
              • 
                    	                        
            • 關鍵字：
                        CPLD  圖像傳感器  非均勻性校正                          
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            基于CPLD／FPGA的CMI編碼設計與實現(xiàn)
            
                                                            
              
                    	
            • 根據(jù)CMI碼的特性，介紹了一種新的編程思路實現(xiàn)CMI編碼，在Max+PlusⅡ開發(fā)平臺上使用VHDL編程實現(xiàn)CMI編碼，并得到仿真波形。實驗結果表明，這種編程思路簡單、清晰。在產(chǎn)生7位偽隨機序列的前提下，分別對“O”，“1”進行編碼。這種思路為其他碼型設計提供了參考。
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            • 關鍵字：
                        CPLD  FPGA  CMI  編碼                            
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            一種基于CPLD的壓電生物傳感器檢測電路的設計
            
                                                            
                                        
              
                    	
            • 本文介紹了一種基于復雜可編程邏輯器件(CPLD)的壓電生物傳感器檢測電路.該檢測電路以高性能CPLD(MAX7128)為核心,實現(xiàn)了對壓電生物傳感器10MHz高頻信號的測量與采集,以及所采集的頻率數(shù)據(jù)動態(tài)、實時顯示以及頻率數(shù)據(jù)串行通信等功能.該電路體積小、集成度高,具有可靠性高、實時性高的特點.此外該系統(tǒng)還可以通過RS-232串行接口與計算機連接進行數(shù)據(jù)傳輸和數(shù)據(jù)存儲及分析.詳細闡明了系統(tǒng)整體結構設計以及系統(tǒng)硬件部分的實現(xiàn),并給出了CPLD內(nèi)核仿真結果和數(shù)據(jù)采集軟件實測頻率曲線. 
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            • 關鍵字：
                        檢測  電路  設計  傳感器  生物  CPLD  壓電  基于  功率模塊                          
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            使用用CPLD和Flash實現(xiàn)FPGA的配置
            
                                                            
              
                    	
            • 電子設計自動化EDA(ElectronicDesignAutomation)是指以計算機為工作平臺，以EDA軟件為開發(fā)環(huán)境，以硬件描...
              • 
                    	                        
            • 關鍵字：
                        CPLD  FPGA  Flash  RAM  EDA  VHDL                          
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             VHDL語言實現(xiàn)的幀同步算法
            
                                                            
                                        
              
                    	
            • 數(shù)字通信網(wǎng)中，幀同步是同步復接設備中最重要的部分，他包括幀同步碼的產(chǎn)生和幀同步碼的識別，其中接收端的幀同步識別電路的結構對同步性能的影響是主要的。 

              1 工作原理

              實現(xiàn)幀同步的基本方法是在發(fā)送端預先規(guī)
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            • 關鍵字：
                        算法  同步  實現(xiàn)  語言  VHDL                          
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            基于VHDL的線性分組碼編譯碼器的研究設計
            
                                                            
              
                    	
            • 在通信系統(tǒng)中，由于信道存在大量的噪聲和干擾，使得經(jīng)信道傳輸后的接收碼與發(fā)送碼之間存在差異，出現(xiàn)誤碼。在...
              • 
                    	                        
            • 關鍵字：
                        VHDL  編譯碼器  線性分組碼                          
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            基于CPLD器件的單穩(wěn)態(tài)脈沖展寬電路的設計
            
                                                            
              
                    	
            • 在數(shù)字電路設計中，當需要將一輸入的窄脈沖信號展寬成具有一定寬度和精度的寬脈沖信號時，往往很快就想到利...
              • 
                    	                        
            • 關鍵字：
                        FPGA  CPLD  寬脈沖信號  ISP                          
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            基于VHDL語言的99小時定時器設計及實現(xiàn)
            
                                                            
              
                    	
            • 0引言傳統(tǒng)的定時器硬件連接比較復雜，可靠性差，而且計時時間短，難以滿足需要。本設計采用可編程芯片...
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            • 關鍵字：
                        FPGA  VHDL  定時器  EP1C6Q240C8                          
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            基于VHDL的線性分組碼編譯碼器設計
            
                                                            
              
                    	
            • 數(shù)字信號在傳輸過程中受到干擾的影響，降低了其傳輸?shù)目煽啃裕€性分組碼作為一種常用的信道編碼，在通信傳輸系統(tǒng)中應用廣泛。在對線性分組碼的編譯碼規(guī)則研究基礎上，討論了生成矩陣、監(jiān)督矩陣與錯誤圖樣集之間的關系，在Max+PlusⅡ開發(fā)環(huán)境中，用VHDL語言設計線性分組碼編譯碼器，對其各項設計功能進行了仿真和驗證。結果表明，該設計正確，其功能符合線性分組碼編譯碼器的要求。
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            • 關鍵字：
                        VHDL  線性  分組碼  編譯碼器                            
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