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UWB - 智能物聯(lián)的未來之星，你怎么看他？低功耗Wi-Fi解決方案在智能家居的應(yīng)用和發(fā)展結(jié)合超寬帶測距和雷達功能以實現(xiàn)高級IoT應(yīng)用來這里瞧瞧NXP技術(shù)培訓(xùn)視頻吧>>

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vhdl-cpld 文章進入vhdl-cpld技術(shù)社區(qū)

基于ARM和CPLD的無線內(nèi)窺系統(tǒng)設(shè)計

引言當前，醫(yī)用無線內(nèi)窺鏡已有產(chǎn)品問世。以色列GI公司早在2001年5月即推出其M2A無線內(nèi)窺鏡產(chǎn)品，并獲得美國FDA認證。GI公司生產(chǎn)的膠囊型內(nèi)窺鏡長為26 mm，直徑為11mm，重3.5g;采用微功耗CMOS圖像傳感器，可觀察視角
關(guān)鍵字： ARM CPLD 無線內(nèi)窺

基于CPLD和LVPECL門電路的脈寬可調(diào)窄脈沖信號發(fā)生器設(shè)計

超寬帶無線通信技術(shù)是目前無線通信領(lǐng)域先進的通信技術(shù)之一，它利用極寬頻帶的超窄脈沖進行無線通信，在無載波脈沖體制雷達中被廣泛應(yīng)用，多年來一直被限定為軍用技術(shù)。近年來，隨著電子技術(shù)的飛速發(fā)展，在無線通信用
關(guān)鍵字： CPLD LVPECL 可調(diào)窄脈沖產(chǎn)生器

基于CPLD/FPGA的出租車計費器系統(tǒng)的設(shè)計實現(xiàn)

1 引言隨著EDA技術(shù)的發(fā)展及大規(guī)?？删幊踢壿嬈骷﨏PLD/FPGA的出現(xiàn)，電子系統(tǒng)的設(shè)計技術(shù)和工具發(fā)生了巨大的變化，通過EDA技術(shù)對CPLD/FP-GA編程開發(fā)產(chǎn)品，不僅成本低、周期短、可靠性高，而且可隨時在系統(tǒng)中修改其邏輯功
關(guān)鍵字： CPLD FPGA 出租車計費器

CPLD實現(xiàn)單片機與ISA總線并行通信

摘要：用ALTERA公司MAX7000系列CPLD芯片實現(xiàn)單片機與PC104 ISA總線接口之間的并行通信，給出系統(tǒng)設(shè)計方法及程序源代碼。包括通信軟件和AHDL設(shè)計部分。關(guān)鍵詞：CPLD ISA總線并行通信CPLD(Complex Programmable Logi
關(guān)鍵字： CPLD 單片機 ISA總線并行通信

FPGA：縱向創(chuàng)新與橫向整合引領(lǐng)變革

FPGA在先進工藝路上的狂飚猛進帶來了如影隨形的挑戰(zhàn)：一方面，進入20nm和14nm階段后，不光是FPGA復(fù)雜度提升，對其外圍的電源管理等芯片也提出了“與時俱進”的要求。另一方面，隨著SoC FPGA和3D IC技術(shù)
關(guān)鍵字： FPGA 創(chuàng)新 FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

從業(yè)績來看，賽靈思已經(jīng)遠遠領(lǐng)先于Altera

Altera和賽靈思20年來都在FPGA這個窄眾市場激烈的競爭者，然而Peter Larson基于對兩個公司現(xiàn)金流折現(xiàn)法的研究表明，賽靈思是目前FPGA市場的絕對領(lǐng)先者。(http://seekingalpha.com/article/2008621-xilinx-appears-
關(guān)鍵字：賽靈思 Altera FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

VHDL設(shè)計進階:邏輯綜合的原則以及可綜合的代碼設(shè)計風格

4.5.1 always塊語言指導(dǎo)原則使用always塊進行可綜合的代碼設(shè)計時需要注意以下幾個問題。(1)每個always塊只能有一個事件控制“@(event-expression)”，而且要緊跟在always關(guān)鍵字后面。(2)always塊可以表示
關(guān)鍵字： VHDL 進階代碼設(shè)計邏輯

用于VHDL的DRAM控制器設(shè)計

80C186XL16位嵌入式微處理器是Intel公司在嵌入式微處理器市場的上導(dǎo)產(chǎn)品之一，已廣泛應(yīng)用于電腦終端、程控交換和工控等領(lǐng)域。在該嵌入式微處理器片內(nèi)，集成有DRAM RCU單元，即DRAM刷新控制單元。RCU單元可以自動產(chǎn)
關(guān)鍵字： 80C186XL CPLD DRAM控制器 VHDL

基于CPLD／FPGA的VHDL語言電路優(yōu)化設(shè)計

杜志傳，鄭建立(上海理工大學醫(yī)療器械與食品學院上海 200093)0 引言VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標準硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)
關(guān)鍵字： VHDL CPLD／FPGA 電路設(shè)計優(yōu)化

FPGA與CPLD的辨別和分類

FPGA與CPLD的辨別和分類主要是根據(jù)其結(jié)構(gòu)特點和工作原理。通常的分類方法是：將以乘積項結(jié)構(gòu)方式構(gòu)成邏輯行為的器件稱為CPLD，如Lattice的ispLSI系列、Xilinx的XC9500系列、Altera的MAX7000S系列和Lattice(原Vantis)
關(guān)鍵字： FPGA CPLD 辨識

基于嵌入式系統(tǒng)中DRAM控制器的CPLD解決方案

80C186XL16位嵌入式微處理器是Intel公司在嵌入式微處理器市場的上導(dǎo)產(chǎn)品之一，已廣泛應(yīng)用于電腦終端、程控交換和工控等領(lǐng)域。在該嵌入式微處理器片內(nèi)，集成有DRAM RCU單元，即DRAM刷新控制單元。RCU單元可以自動產(chǎn)生
關(guān)鍵字：嵌入式系統(tǒng) DRAM控制器 CPLD

拆解安捷倫電源/測量單元(SMU)

Dave Jones在5年時間里，上傳了超過600個電子類的視頻。在每周二，Jones會拆解一個不錯的設(shè)備(當然，有時候沒有那么好)，Jones并不是簡單地把盒子破壞、打開，他會用他豐富的電子設(shè)計知識來說明這個設(shè)備是怎么設(shè)計
關(guān)鍵字：拆解 FPGA CPLD Xilinx 安捷倫

基于CPLD器件在時間統(tǒng)一系統(tǒng)中的應(yīng)用

引言隨著電子技術(shù)的發(fā)展，對遙測信號的幀結(jié)構(gòu)的可編程度、集成度的要求越來越高，用于時間統(tǒng)一系統(tǒng)的B碼源的設(shè)計也趨于高度集成化。為了適應(yīng)現(xiàn)代靶場試驗任務(wù)的要求，我們采用Altera的CPLD器件，將用于產(chǎn)生B碼的各種
關(guān)鍵字： CPLD 時間統(tǒng)一系統(tǒng) IRIG－B碼

DSP與CPLD的輸電線路局部氣象監(jiān)測裝置設(shè)計

1 概述輸電線路的狀態(tài)直接決定著整個電網(wǎng)的安全穩(wěn)定運行，輸電線路微氣象參數(shù)的實時監(jiān)測能夠為電網(wǎng)正常調(diào)度、以及自然災(zāi)害預(yù)測和控制提供必要的現(xiàn)場信息。輸電線路是電力系統(tǒng)的關(guān)鍵元件之一。為了安全、穩(wěn)定地運行，
關(guān)鍵字： DSP CPLD 輸電線路氣象監(jiān)測

基于CPLD的CCD信號發(fā)生器的研究

1、引言CCD (Charge Coupled Devices)電荷藕合器件是20世紀70年代初發(fā)展起來的新型半導(dǎo)體器件。目前CCD作為光電傳感器由于其具有體積小、重量輕、功耗小、工作電壓低和抗燒毀等優(yōu)點以及在分辨率、動態(tài)范圍、靈敏度
關(guān)鍵字： CPLD CCD 信號發(fā)生器

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利用CPLD實現(xiàn)多路數(shù)據(jù)采集
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