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serdes ip 文章進入serdes ip技術社區(qū)

精確時鐘同步確保IP網(wǎng)電信級特性

回顧以太網(wǎng)同步技術的發(fā)展，我們曾在以太網(wǎng)上用過互聯(lián)網(wǎng)網(wǎng)絡時間協(xié)議NTP(Network Time Protocol)技術，簡單網(wǎng)絡時間協(xié)議SNTP(Simple Network Time Protocol)技術，GPS技術或用T1/E1和以太網(wǎng)組成混合網(wǎng)絡來增加以太網(wǎng)
關鍵字：電信特性 IP 確保時鐘同步精確

新出現(xiàn)的SoC FPGA上的策略考慮

集成了FPGA架構、硬核CPU子系統(tǒng)以及其他硬核IP的半導體器件SoCFPGA已經(jīng)發(fā)展到了一個“關鍵點”，它在今...
關鍵字： SoC FPGA 硬核 IP 嵌入式系統(tǒng) Altera

IP視頻監(jiān)控系統(tǒng)存儲設備選型指導

近年來，模擬視頻監(jiān)控系統(tǒng)的市場份額在不斷縮水，正如人們所期望的，IP視頻監(jiān)控逐漸深入人心。確實，IP視頻監(jiān)控解決了傳統(tǒng)監(jiān)控布線繁瑣的問題，可是它也帶來了新的問題?！　∧M攝像機達到650線便已是最高水平，然而
關鍵字：選型指導存儲設備監(jiān)控系統(tǒng) 視頻 IP

SPI IP核及其在微投影系統(tǒng)中的應用

摘要：介紹了SPI總線控制器IP核的硬件結構與應用方法，并著重介紹了該IP核在微投影系統(tǒng)中的使用，以完成微顯示芯片的初始化。實驗表明，該SPI總線接口使用靈活，便于移植，并且穩(wěn)定可靠。
關鍵詞：SPI總線控制器；N
關鍵字：系統(tǒng) 應用投影及其 IP SPI

FreeARM7 IP核的微處理器邏輯擴展與驗證

摘要：介紹了FreeARM7 IP核的基本概況及其接口特點，以LPC2101為原型對該IP核進行了擴展。結合USB 1．1設備控制器IP核和自定制硬件邏輯，構建了一種微控制器功能驗證回路。在主機端開發(fā)了驗證程序、驅動和通信軟件。
關鍵字：擴展驗證邏輯微處理器 IP FreeARM7

基于Wishbone總線的UART IP核設計

摘要：介紹了一種基于Wishbone總線的UART IP核的設計方法。該設計采用了自頂向下的模塊化劃分和有限狀態(tài)機相結合的方法，由于其應用了標準的Wishbone總線接口，從而使微機系統(tǒng)與串行設備之間的通信更加靈活方便。驗證
關鍵字： IP 設計 UART 總線 Wishbone 基于

臺積電和聯(lián)電爭搶IP授權商機代工廠整合第三方設計工具已成趨勢

　　芯片設計愈趨復雜，對已驗證IP的需求也愈來愈高，根據(jù)全球半導體協(xié)會(GSA)統(tǒng)計，2010年晶圓代工廠提供給IC設計業(yè)者的IP數(shù)量，已經(jīng)超過以IP授權為主要業(yè)務的第三方IP供貨商。為了縮短芯片設計至量產(chǎn)時間，臺積電旗下創(chuàng)意、聯(lián)電旗下智原等2家設計服務業(yè)者，已經(jīng)成為晶圓雙雄搶食IP授權市場趨勢下的主要受惠者。　　根據(jù)GSA調查統(tǒng)計，IC設計業(yè)者的IP來源，雖然因為芯片設計功能區(qū)塊(design block)仍以自家技術為主，自有IP比例達到66%，但是去年一年當中，已有愈來愈多的IC設計業(yè)者開始依賴
關鍵字：臺積電 IP

FPGA基礎入門（二）

很多兄弟對于CPLD下JTAG的下載很熟悉了,可轉到FPGA來的時候,多多少少有些迷惑,怎么出現(xiàn)配置芯片了,為什么...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于CPLD設計的電器定時開關控制系統(tǒng)

1前言隨著當今社會工作和生活節(jié)奏的加快，人們對許多電器、儀器、設備的自動化要求也越來越高，但現(xiàn)有...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

利用CPLD來替代微控制器的6種方法

引言如果告訴便攜式電子設計人員有一種低功耗數(shù)字器件能使他們利用軟件程序來重新配置硬件工作，他們中的十個...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

我學習FPGA的總結

閱讀本文的人群：熟悉數(shù)字電路基本知識（如加法器、計數(shù)器、RAM等），熟悉基本的同步電路設計方法，熟悉HDL語言，對FPGA...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

verilog中阻塞賦值和非阻塞復制的理解

阻塞和非阻塞語句作為verilogHDL語言的最大難點之一，一直困擾著FPGA設計者，即使是一個頗富經(jīng)驗的設計工程師，...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

選擇VHDL或者verilog HDL還是System Verilog？

硬件描述語言HDL（HardwareDescribeLanguage）HDL概述隨著EDA技術的發(fā)展，使用硬件語言設計PLD/FPGA成為一...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

系統(tǒng)級芯片設計語言和驗證語言的發(fā)展

作者：韓俊剛時間：2006-02-1117:08:15來自：西安郵電學院ASIC設計中心簡介：由于微電子技術的迅速發(fā)...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

FPGA設計中關鍵問題的研究

隨著FPGA(FieldProgrammableGateArray)容量、功能以及可靠性的提高，其在現(xiàn)代數(shù)字通信系統(tǒng)中的應用日漸廣...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

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串口聯(lián)網(wǎng)解決方案
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