rf-fpga 文章進(jìn)入rf-fpga技術(shù)社區(qū)

下一代的模擬和射頻設(shè)計(jì)驗(yàn)證工具

　　目前最先進(jìn)的模擬和射頻電路，正廣泛應(yīng)用于消費(fèi)電子產(chǎn)品、無(wú)線通訊設(shè)備、計(jì)算機(jī)和網(wǎng)絡(luò)設(shè)備的SoC中。它們帶來(lái)了一系列驗(yàn)證方面的挑戰(zhàn)，而這些挑戰(zhàn)往往是傳統(tǒng)SPICE、FastSPICE和射頻仿真軟件無(wú)法完全解決的。這些挑戰(zhàn)包括：多于10萬(wàn)個(gè)器件的設(shè)計(jì)復(fù)雜度、大于幾GHz的時(shí)鐘主頻、納米級(jí)的CMOS工藝技術(shù)、低功耗、工藝變化、非常明顯的非線性效應(yīng)、極度復(fù)雜的噪聲環(huán)境以及無(wú)線/有線通訊協(xié)議的支持問(wèn)題。　　在現(xiàn)如今大多數(shù)傳統(tǒng)的電路仿真軟件開發(fā)時(shí)，這些挑戰(zhàn)都還沒(méi)有存在。在很多情況下，當(dāng)今的模擬和射頻電路在流片之
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RFMD MEMS技術(shù)將在RF應(yīng)用中實(shí)現(xiàn)突破性整合

　　日前，RF Micro Devices(RFMD)宣布推出專有微機(jī)電系統(tǒng) (MEMS) - 面向 RF 及其他應(yīng)用的技術(shù)。RFMD 期望其專有的 MEMS 技術(shù)將在 RF 及其他應(yīng)用中實(shí)現(xiàn)突破性的性能及空前水平的功能整合。　　RFMD 推出的第一批 RF MEMS 器件將是面向 3G 多模手機(jī)的 RF MEMS 發(fā)送/接收開關(guān)及 RF MEMS 模式開關(guān)。通過(guò)極大減小產(chǎn)品占位面積并提高效率，從而延長(zhǎng)手機(jī)通話時(shí)間，RFMD 的 MEMS 開關(guān)技術(shù)將有助于加速 3G 部署。當(dāng)與面向前端解決方案(GaA
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用FPGA設(shè)計(jì)軟件無(wú)線電和調(diào)制解調(diào)器

　　本文以16-QAM RF發(fā)射數(shù)據(jù)泵的設(shè)計(jì)為例，介紹利用FPGA設(shè)計(jì)數(shù)字濾波器的技巧和器件選擇方法，說(shuō)明執(zhí)行分布式計(jì)算時(shí)FPGA比DSP的優(yōu)越之處。　　所有數(shù)字邏輯的基本結(jié)構(gòu) 　　16-QAM調(diào)制器　　編碼和碼元映射　　平方根升余弦濾波器　　設(shè)計(jì)技巧　　5 MHz載波　　分布式計(jì)算(DA)技術(shù) 　　濾波器的實(shí)現(xiàn) 　　用現(xiàn)場(chǎng)可編程門陣列(FPGA)設(shè)計(jì)軟件無(wú)線電和調(diào)制解調(diào)器可與DSP芯片媲美。雖然FPGA可輕而易舉地實(shí)現(xiàn)卷積編碼器等復(fù)雜邏輯功能，但在實(shí)現(xiàn)大量復(fù)雜計(jì)算方面卻有很
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如何利用FPGA實(shí)現(xiàn)優(yōu)異的家用電器設(shè)計(jì)

低成本的FPGA或CPLD可以幫助家電設(shè)計(jì)師利用靈活的、集成有DSP算法的單片集成解決方案實(shí)現(xiàn)節(jié)能的電機(jī)控制。
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郵政速遞將成RFID應(yīng)用第二大市場(chǎng)

　　RFID是一種非接觸式的自動(dòng)識(shí)別技術(shù)，被列為21世紀(jì)最具變革力與核心價(jià)值的一項(xiàng)新技術(shù)之一，早在2006年，全球RFID單品標(biāo)簽的應(yīng)用發(fā)展超過(guò)了大多數(shù)人預(yù)期的“單品標(biāo)簽量將達(dá)到2億枚”。從2007年起，RFID單品應(yīng)用將是世界上最大的RFID市場(chǎng)。2016年，預(yù)計(jì)應(yīng)用在單品上標(biāo)簽的價(jià)值將超過(guò)110億美元，相關(guān)RFID系統(tǒng)市場(chǎng)價(jià)值將達(dá)到260億美元。據(jù)預(yù)測(cè)，2009年全球RFID市場(chǎng)規(guī)模將從2004年3億美元增至28億美元。到2016年，全球郵政速遞領(lǐng)域使用包括標(biāo)簽在內(nèi)的RFID系統(tǒng)的市場(chǎng)份額將達(dá)到30億
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FPGA的SoC和專用化趨勢(shì)

　　過(guò)去一年中，F(xiàn)PGA巨頭賽靈思(Xilinx)在中國(guó)大舉構(gòu)建生態(tài)系統(tǒng)，其速度和力度讓人吃驚。2006年末，賽靈思公司董事會(huì)主席、總裁兼CEOWimRoelandts來(lái)華宣布了“促進(jìn)中國(guó)電子設(shè)計(jì)創(chuàng)新”的在華發(fā)展戰(zhàn)略，主要內(nèi)容包括加強(qiáng)客戶支持力度、建立良好生態(tài)網(wǎng)絡(luò)、投資新興半導(dǎo)體公司以及培養(yǎng)未來(lái)工程設(shè)計(jì)人才，拉開了賽靈思在中國(guó)大舉擴(kuò)張的序幕。　　隨后，賽靈思宣布設(shè)立了金額達(dá)7500萬(wàn)美元的亞太區(qū)技術(shù)基金，投資那些基于可編程邏輯、為重點(diǎn)行業(yè)開發(fā)創(chuàng)新應(yīng)用的公司。2007年，賽靈思又分別在上海張江和江蘇無(wú)錫
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Key值更新隨機(jī)Hash鎖對(duì)RFID安全隱私的加強(qiáng)

　　RFID是20世紀(jì)90年代興起的一項(xiàng)非接觸式的自動(dòng)識(shí)別技術(shù)，其無(wú)線通信方式和無(wú)可視性讀寫的要求，給我們帶來(lái)了極大方便，也帶來(lái)了很多安全隱私問(wèn)題。針對(duì)RFID 的安全隱私問(wèn)題，目前國(guó)內(nèi)外開展了很多加強(qiáng)RFID安全隱私保護(hù)的研究，并提出了一系列的方法，如Hash鎖、隨機(jī)Hash鎖和Hash鏈，但這些方法存在安全性不高或效率低等缺陷。本文針對(duì)現(xiàn)有方法的不足，進(jìn)一步對(duì)RFID的安全隱私保護(hù)展開研究。　　1 RFID技術(shù)及其安全隱私分析　　RFID系統(tǒng)主要由閱讀器、標(biāo)簽及后端數(shù)據(jù)庫(kù)組成，如圖1所示。
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FPGA加速滲透非傳統(tǒng)應(yīng)用領(lǐng)域

　　自從1985年首款FPGA器件誕生以來(lái)，F(xiàn)PGA產(chǎn)業(yè)一方面修煉內(nèi)功——從技術(shù)上來(lái)說(shuō)，工藝從2μm發(fā)展到65nm，晶體管數(shù)量從8.5萬(wàn)個(gè)增長(zhǎng)到10億個(gè)以上;另一方面向外擴(kuò)張——應(yīng)用領(lǐng)域從最初的通信業(yè)不斷向消費(fèi)電子、汽車、工業(yè)控制等滲透，同時(shí)在不斷“蠶食”DSP、ASIC、ASSP和嵌入式處理器的市場(chǎng)。如今，Xilinx、Altera和Actel等FPGA產(chǎn)業(yè)的領(lǐng)導(dǎo)廠商也不再是20多年前的孤軍奮戰(zhàn)，在其周圍，F(xiàn)PGA開發(fā)和應(yīng)用的生態(tài)系統(tǒng)已然初步形成，大大促進(jìn)了FPGA產(chǎn)業(yè)的發(fā)展。　　“非傳統(tǒng)”應(yīng)用領(lǐng)域
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基于FPGA的圖像邊緣檢測(cè)

　　引言　　圖像邊緣檢測(cè)是圖像處理的一項(xiàng)基本技術(shù)，在工業(yè)、醫(yī)學(xué)、航天和軍事等領(lǐng)域有著廣泛的應(yīng)用。圖像處理的速度一直是一個(gè)難題。雖然DSP具備指令流水線特性和很高的處理速度，但其速度仍然很受限制，而利用高速可編程邏輯器件FPGA/CPLD來(lái)設(shè)計(jì)圖像邊緣檢測(cè)器可以很好的克服這個(gè)問(wèn)題，是一種全新的解決方案。　　1 圖像邊緣檢測(cè)算法　　用于圖像邊緣檢測(cè)的算法很多，諸如Rorberts算子、Sobel算子、Prewitt算子、Laplaceian算子等，由于Sobel算法只涉及到加法操作，并且可以取得很
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CADENCE公布新的RF技術(shù)簡(jiǎn)化納米級(jí)無(wú)線設(shè)備芯片的設(shè)計(jì)

　　Cadence設(shè)計(jì)系統(tǒng)公司宣布推出Virtuoso Passive Component Designer，這是一種面向電感、變壓器和傳輸線設(shè)計(jì)、分析與建模的完整流程。這種新技術(shù)讓模擬與RF設(shè)計(jì)師能夠輕易掌握無(wú)源元件的設(shè)計(jì)，迅速開發(fā)出復(fù)雜的無(wú)線SoC和RFIC。Virtuoso Passive Component Designer從感應(yīng)系數(shù)、Q值和頻率等設(shè)計(jì)規(guī)范開始，幫助設(shè)計(jì)師為他們的特定應(yīng)用和工藝技術(shù)自動(dòng)生成最適宜的感應(yīng)器件，實(shí)現(xiàn)更高的性能和更小的面積。內(nèi)置的精確3D全波解算器用于檢驗(yàn)生成的器件，不再
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FPGA與DDR3 SDRAM的接口設(shè)計(jì)

DDR3 SDRAM內(nèi)存的總線速率達(dá)到600 Mbps to 1.6 Gbps (300 to 800 MHz)，1.5V的低功耗工作電壓，采用90nm制程達(dá)到2Gbits的高密度。這個(gè)架構(gòu)毫無(wú)疑問(wèn)更快、更大，每比特的功耗也更低，但是如何實(shí)現(xiàn)FPGA和DDR3 SDRAM DIMM條的接口設(shè)計(jì)呢？　　關(guān)鍵字：均衡（leveling）　　如果FPGA&nbs
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基于MAX+plusⅡ開發(fā)平臺(tái)的EDA設(shè)計(jì)方法

MAX + plus Ⅱ是美國(guó)Altera 公司的一種EDA 軟件,用于開發(fā)CPLD 和FPGA 進(jìn)行數(shù)字系統(tǒng)的設(shè)計(jì)。用圖形輸入方式和文本輸入方式設(shè)計(jì)了一模60計(jì)數(shù)器,介紹了數(shù)字系統(tǒng)設(shè)計(jì)的一般方法和過(guò)程,揭示了其在數(shù)字系統(tǒng)中的重要作用。　　 EDA ( Elect ronic Design
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32位單精度浮點(diǎn)乘法器的FPGA實(shí)現(xiàn)

本文使用Altera Quartus II 4.1仿真軟件, 采用的器件是EPF10K100EQ 240 -1, 對(duì)乘法器進(jìn)行了波形仿真, 并采用0.5CMOS工藝進(jìn)行邏輯綜合。
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GiDEL在最新的開發(fā)系統(tǒng)中采用Altera的Stratix FPGA系列

　　Altera宣布，GiDEL的新一代PROC算法加速板和PROCxM原型開發(fā)系統(tǒng)的PC_X8 PCI Express (PCIe)適配器采用了Stratix® II、Stratix II GX和Stratix III FPGA。高性能Altera® Stratix FPGA使GiDEL能夠在新的PCIe應(yīng)用和設(shè)計(jì)人員開發(fā)系統(tǒng)中集成更多的功能，提升系統(tǒng)性能。　　GiDEL的PROCStar III開發(fā)系統(tǒng) 　　面向基于PCIe的嵌入式處理應(yīng)用，GiDEL的PROCStar III開
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賽靈思65nm產(chǎn)品摘取中國(guó)電子業(yè)界創(chuàng)新大獎(jiǎng)

　　賽靈思公司(Xilinx, Inc. )日前宣布其創(chuàng)新的65nm技術(shù)獲得了中國(guó)電子行業(yè)權(quán)威專家及電子設(shè)計(jì)社群的一致認(rèn)可，其業(yè)界唯一投入量產(chǎn)的65nmFPGA產(chǎn)品系列中的Virtex-5 LXT榮膺IDG集團(tuán)下屬權(quán)威電子雜志《電子設(shè)計(jì)技術(shù)》(EDN China)頒發(fā)的數(shù)字IC與可編程器件類2007年度“最佳產(chǎn)品獎(jiǎng)”, 該獎(jiǎng)項(xiàng)是EDN China年度創(chuàng)新獎(jiǎng)的最高榮譽(yù)。 2007年11月9日，EDN China雜志社在深圳舉辦的創(chuàng)新大會(huì)上授予了賽靈思公司該獎(jiǎng)項(xiàng)。　　2007年度EDN China創(chuàng)新獎(jiǎng)
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