DDR SDRAM是Double Data Rate SDRAM的縮寫，即雙倍速率同步動態(tài)隨機存儲器。DDR內存是在SDRAM內存基礎上發(fā)展而來的，能夠在時鐘的上升沿和下降沿各傳輸一次數(shù)據(jù)，可以在與SDRAM相同的總線時鐘頻率下達到更高的數(shù)據(jù)傳輸率。雖然DDR2和DDR一樣,都采用相同采樣方式進行數(shù)據(jù)傳輸，但DDR2擁有兩倍于DDR的預讀取系統(tǒng)命令數(shù)據(jù)的能力。
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Cyclone FPGA DDR2 III
英飛凌科技股份公司近日宣布，公司2011財年第二季度的營收和運營利潤均超過先前預計水平。
英飛凌預計2011財年第二季度的營收將從第一季度的9.22億歐元提高至9.94億歐元，運營利潤率達到20%。
在2011年2月1日公布的2011財年第二季度業(yè)績展望中，英飛凌預計第二季度的營收略高于上一季度，運營利潤率將達到18%至20%。
英飛凌預計，2011財年第三季度的營收和運營利潤率將與第二季度基本持平。
英飛凌將于2011年5月3日公布2011財年第二季度的財務數(shù)據(jù)，屆時公司將詳
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英飛凌 MCU
本文結合MSP430系列微處理器，詳細論述了通過控制改變MCU的時鐘頻率來降低功耗的設計方法?！ ? 功耗產(chǎn)生的原因 在CMOS電路中，功耗損失主要包括靜態(tài)功耗損失和動態(tài)功耗損失兩部分。其中靜態(tài)功耗主要是由反偏PN結
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分析 時鐘 動態(tài) MCU 功耗
通常吸抽油煙機轉速靠人工調節(jié)，因此為了達到最佳排油效果及節(jié)能目的，往往需要使用者多次人工干預。因此，為了使抽油煙機可實現(xiàn)自動調速、降低噪音、解放人力并最大限度地節(jié)能，瑞薩電子（本文涉及產(chǎn)品主要為瑞薩電
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抽油煙機 方案 變頻 直流 MCU 8位
為了檢測太陽能組件或組件陣列的各項性能參數(shù)，提出一種利用數(shù)控電阻測試光佚電池輸出特性的方法。測試儀采用數(shù)控電阻器、高精度ADC和微控制器結合的方案，與傳統(tǒng)的電子負載相比，具有便攜、精度高、智能化和測量時間短等特點。利用制作的樣機，在自然光照條件下進行了光伏電池測試實驗，并在Matlab環(huán)境中對光伏電池模型進行了仿真驗證。通過樣機試驗結果和仿真結果比較，結果表明測試儀具有較高的精度。
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MCU 光伏電池 試儀設計
引言 串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)的帶寬不斷增加至多吉比特范圍，并行接口已經(jīng)被高速串行鏈接，或SERDES （串化器/ 解串器）所取代 。起初， SERDES是獨立的ASSP或ASIC器
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SERDES FPGA 性能 接口
隨著IT產(chǎn)業(yè)和通信技術、電子技術、計算機技術的高速發(fā)展，大量的生產(chǎn)裝備和產(chǎn)品的電子化、數(shù)字化、自動化、智能化的程度越來越高，與之配套的電子測量設備必須適應這種形勢。因此，綜合測量技術、電子技術、自動化技
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系統(tǒng) 設計 診斷 測試 MCU 自動 基于
本設計使用硬件描述語言VHDL在FPGA數(shù)字邏輯層面上實現(xiàn)AES加解密，為了系統(tǒng)的擴展性和構建良好的人機交互，設計通過PS/2鍵盤輸入加密密鑰，并將其顯示在LCD上。在軟核MicroBlaze上，通過SPI總線讀寫FIFO和RAM控制射頻芯片CC2420，使系統(tǒng)具有信道選擇、地址識別、自動CRC校驗功能，使系統(tǒng)更加安全、通信誤碼率更低。
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保密 通信 終端 無線 系統(tǒng) Xilinx FPGA 基于
摘要 基于FPGA基本數(shù)據(jù)流的下載控制方式，利用遺傳算法，通過單片機控制數(shù)據(jù)流的方式對FPGA進行編程配置，實現(xiàn)自身重構，使系統(tǒng)具有自適應、自組織和自修復的特性。
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FPGA 數(shù)據(jù)流 動態(tài)可重構
摘要 利用異步FIFO實現(xiàn)FPGA與DSP進行數(shù)據(jù)通信的方案。FPGA在寫時鐘的控制下將數(shù)據(jù)寫入FIFO，再與DSP進行握手后，DSP通過EMIFA接口將數(shù)據(jù)讀入。文中給出了異步FIFO的實現(xiàn)代碼和FPGA與DSP的硬件連接電路。經(jīng)驗證，利用
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通信 運用 DSP FPGA FIFO 異步
摘要：針對需要切換FPGA器件的配置以實現(xiàn)不同功能的特殊應用場合，提出了一種使用大容量的Flash存儲器作配置碼流載體的FPGA多配置系統(tǒng)。該系統(tǒng)采用傳輸速度快的JTAG接口提高了配置碼流的燒寫速度，采用并行從模式減少
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FIash JTAG FPGA 接口
基于FPGA的CAN總線控制器SJA1000軟核的設計
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SJA1000 軟核 設計 控制器 總線 FPGA CAN
摘要：為了方便基于FPGA實現(xiàn)的隨機數(shù)發(fā)生器的驗證與演示，以CycloneII FPGA芯片EP2C20Q240C8N為核心，設計實現(xiàn)了隨機數(shù)發(fā)生器IP核下載與測試的開發(fā)驗證平臺，并詳細闡述了各模塊的設計原理及關鍵技術。最后，通過下載
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FPGA USB 隨機數(shù)發(fā)生器
為了能更好地實現(xiàn)變電站的自動化和數(shù)字化以及完成變電站系統(tǒng)的實時監(jiān)控、測試，更快捷、直觀地獲得設備的運行狀態(tài)。介紹了一臺基于ARM+FPGA的電力光纖信號分析儀的設計與研究，從硬件方面提出了新的設計方案。這種光纖信號分析儀主要實現(xiàn)對數(shù)字化變電站中通過100 M BaseFX傳輸?shù)母鞣N格式報文的抓取、信息提取、報文解碼、實時存儲及波形顯示等功能。
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FPGA ARM 電力光纖 信號分析
摘要：文章通過對1553B總線協(xié)議的研究，結合現(xiàn)代EDA技術，介紹了一種使用現(xiàn)場可編程邏輯器件(FPGA)設計1553B,總線協(xié)議用的manches-ter II型碼解碼器的方法。通過采用Verilog HDL硬件描述語言和原理圖混合輸入法，使設
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1553B FPGA 總線協(xié)議 解碼器
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