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自由IP Core資源的利用
- 摘 要：本文介紹了與免費(fèi)IP Core運(yùn)作有關(guān)的問題以及免費(fèi)資源的若干來源，然后通過對兩個不同來源的、免費(fèi)的八位RISC CPU進(jìn)行比較和分析，給出了若干選用免費(fèi)核時應(yīng)考慮的問題。關(guān)鍵詞：IP Core； CPU引言隨著集成電路單位面積晶體管數(shù)量的激增和人們對縮短設(shè)計(jì)周期的追求，設(shè)計(jì)重用已經(jīng)成為有效的應(yīng)對方法，它不但適合于ASIC，也適合于CPLD/FPGA。在CPLD/FPGA的設(shè)計(jì)過程中，由于開發(fā)工具的通用性、設(shè)計(jì)語言的標(biāo)準(zhǔn)化，設(shè)計(jì)過程幾乎與所用器件的硬件結(jié)構(gòu)無關(guān)，
- 關(guān)鍵字： CPU IP Core
TCP/IP協(xié)議棧在嵌入式芯片上的實(shí)現(xiàn)
- 摘 要：本文介紹了一種在Atmega128芯片上嵌入TCP/IP協(xié)議棧的實(shí)現(xiàn)方法，整個協(xié)議棧采用模塊化設(shè)計(jì)，結(jié)構(gòu)簡單，可以很方便的移植到不同芯片上。關(guān)鍵詞：TCP/IP；嵌入式系統(tǒng)；8019AS；Atmega128引言對于嵌入式系統(tǒng)而言，考慮到TCP/IP協(xié)議的復(fù)雜性以及嵌入式系統(tǒng)自身資源的有限，對TCP/IP的實(shí)現(xiàn)并不是一件容易的事情。在一些特殊場合，比如要求實(shí)時性或者數(shù)據(jù)的安全性，實(shí)現(xiàn)TCP/IP協(xié)議時還需要特別加以考慮。下面以ATMEL公司的mega128芯片為硬
- 關(guān)鍵字： 8019AS Atmega128 TCP/IP 嵌入式系統(tǒng)
基于C*SoC200的32位稅控機(jī)專用系統(tǒng)芯片設(shè)計(jì)
- 摘 要：本文首先介紹了一個32位嵌入式稅控機(jī)專用系統(tǒng)芯片C3118的功能、結(jié)構(gòu)和特點(diǎn)，然后分析了一個自動化程度很高的SoC設(shè)計(jì)平臺——C*SoC200，對該平臺的主要結(jié)構(gòu)和功能進(jìn)行了分析。關(guān)鍵詞：IP；SoC；平臺；仿真 引言2003年7月，中國國家質(zhì)量監(jiān)督檢驗(yàn)檢疫總局發(fā)布了由稅控機(jī)國家標(biāo)準(zhǔn)制定委員會制定的稅控收款機(jī)國家標(biāo)準(zhǔn)。并將陸續(xù)出臺一系列的管理法規(guī)。為了滿足國家標(biāo)準(zhǔn)的要求，各稅控機(jī)生產(chǎn)廠家都在積極使用32位MCU開發(fā)符合新規(guī)范的稅控機(jī)。而32位的嵌入式稅控機(jī)專用
- 關(guān)鍵字： IP SoC 仿真 平臺 SoC ASIC
基于FPGA的可編程定時器/計(jì)數(shù)器8253的設(shè)計(jì)與實(shí)現(xiàn)
- 摘 要：本文介紹了可編程定時器/計(jì)數(shù)器8253的基本功能，以及一種用VHDL語言設(shè)計(jì)可編程定時器/計(jì)數(shù)器8253的方法，詳述了其原理和設(shè)計(jì)思想，并利用Altera公司的FPGA器件ACEX 1K予以實(shí)現(xiàn)。關(guān)鍵詞：FPGA；IP；VHDL 引言在工程上及控制系統(tǒng)中，常常要求有一些實(shí)時時鐘，以實(shí)現(xiàn)定時或延時控制，如定時中斷，定時檢測，定時掃描等，還要求有計(jì)數(shù)器能對外部事件計(jì)數(shù)。要實(shí)現(xiàn)定時或延時控制，有三種主要方法：軟件定時、不可編程的硬件定時、可編程的硬件定時器。其中可編
- 關(guān)鍵字： FPGA IP VHDL
在TMS320VC5402上實(shí)現(xiàn)的嵌入式TCP/IP協(xié)議棧
- 實(shí)現(xiàn)一個運(yùn)行在16位數(shù)字信號處理器TMS320VC5402上的小型嵌入式TCP/IP協(xié)議棧。對TCP/IP協(xié)議中的IP協(xié)議、ARP協(xié)議、UDP協(xié)議進(jìn)行分析，完成基于TCP/IP協(xié)議的嵌入式網(wǎng)絡(luò)系統(tǒng)。
- 關(guān)鍵字： 協(xié)議 TCP/IP 嵌入式 實(shí)現(xiàn) TMS320VC5402
自由IP Core資源的利用
- 摘 要：本文介紹了與免費(fèi)IP Core運(yùn)作有關(guān)的問題以及免費(fèi)資源的若干來源，然后通過對兩個不同來源的、免費(fèi)的八位RISC CPU進(jìn)行比較和分析，給出了若干選用免費(fèi)核時應(yīng)考慮的問題。關(guān)鍵詞：IP Core； CPU引言隨著集成電路單位面積晶體管數(shù)量的激增和人們對縮短設(shè)計(jì)周期的追求，設(shè)計(jì)重用已經(jīng)成為有效的應(yīng)對方法，它不但適合于ASIC，也適合于CPLD/FPGA。在CPLD/FPGA的設(shè)計(jì)過程中，由于開發(fā)工具的通用性、設(shè)計(jì)語言的標(biāo)準(zhǔn)化，設(shè)計(jì)過程幾乎與所用器件的硬件結(jié)構(gòu)無關(guān)，
- 關(guān)鍵字： CPU IP Core
TCP/IP協(xié)議棧在嵌入式異構(gòu)網(wǎng)絡(luò)互聯(lián)中的應(yīng)用
- TCP/IP協(xié)議棧在嵌入式異構(gòu)網(wǎng)絡(luò)互聯(lián)中的應(yīng)用,隨著測控技術(shù)與網(wǎng)絡(luò)技術(shù)日益緊密的結(jié)合，測控系統(tǒng)接入互聯(lián)網(wǎng)已經(jīng)成為大勢所趨
- 關(guān)鍵字： 應(yīng)用 網(wǎng)絡(luò)互聯(lián) 嵌入式 協(xié)議 TCP/IP
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