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基于PIC單片機的電波數(shù)碼顯示時鐘的設(shè)計

電波鐘是新興的準(zhǔn)確計時產(chǎn)品，是把原子振動的頻率引出來作為計時基準(zhǔn).設(shè)計以PIC16F873單片機為核心，由接收單元，中央處理顯示單元和電源單元三個主要部分構(gòu)成，用于接收原子發(fā)射臺以超長波間歇性發(fā)射的信號，以獲得更加準(zhǔn)確的時間，在軍事和科學(xué)實驗以及人們?nèi)粘Ｉ钪卸加袕V泛的應(yīng)用前景。
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一種基于CPLD的曼徹斯特編解碼器設(shè)計

引言　　雖然計算機通信的方法和手段多種多樣，但都必須依靠數(shù)據(jù)通信技術(shù)。數(shù)據(jù)通信就是將數(shù)據(jù)信號加到數(shù)據(jù)傳輸信道上進行傳輸，并在接收點將原始發(fā)送的數(shù)據(jù)正確地恢復(fù)過來。由于計算機產(chǎn)生的一般都是數(shù)字信號，因此計算機之間的通信實際上都屬于數(shù)據(jù)通信。曼徹斯特碼編解碼器是1553B總線接口中不可缺少的重要組成部分。曼徹斯特碼編解碼器設(shè)計的好壞直接影響總線接口的性能。在數(shù)控測井系統(tǒng)和無線監(jiān)控等領(lǐng)域，曼徹斯特碼編解碼器都有廣泛應(yīng)用。 1 數(shù)據(jù)通信系統(tǒng)結(jié)構(gòu) 　　　圖1所示是數(shù)據(jù)通信系統(tǒng)的基本構(gòu)成。在計算機通信中
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嵌入式智能人機界面與PLC的通訊

　　1、引言　　近年來，“嵌入式”一詞越來越多的被人們提及，嵌入式產(chǎn)品被應(yīng)用到各行各業(yè)。與嵌入式相關(guān)的技術(shù)如嵌入式產(chǎn)品，嵌入式系統(tǒng)的研究等也被列為“十五” 家發(fā)展的重點方向。　　嵌入式系統(tǒng) (Embedded System)被定義為：以應(yīng)用為中心，以計算機技術(shù)為基礎(chǔ)，軟件硬件可裁剪，適應(yīng)對功能、可靠性、成本、體積、功耗嚴(yán)格要求的專用計算機系統(tǒng)。　　隨著工業(yè)自動化的發(fā)展，基于PLC，單片機等設(shè)備的自動化系統(tǒng)，自動化設(shè)備越來越普及，幾乎遍布所有自動化領(lǐng)域，
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基于VxWorks的多DSP系統(tǒng)的多任務(wù)程序設(shè)計

　　近年來，計算機產(chǎn)品的應(yīng)用領(lǐng)域越來越廣，數(shù)字信號處理器的發(fā)展表現(xiàn)得尤為明顯。DSP芯片制造商和DSP板開發(fā)商利用自身的優(yōu)勢不斷開發(fā)出多DSP結(jié)構(gòu)的產(chǎn)品來滿足這種需求。通常的DSP設(shè)備是與嵌入式系統(tǒng)相結(jié)合，來實時地完成某一特定任務(wù)。隨著信號采集速度和處理速度的要求越來越高，許多領(lǐng)域都需要進行多處理器運算，其中包括醫(yī)學(xué)、圖像處理、軍事、工業(yè)控制、電信等許多領(lǐng)域。多處理器系統(tǒng)可以根據(jù)所需實現(xiàn)的功能和處理器的性能來調(diào)節(jié)處理結(jié)點的數(shù)目，使系統(tǒng)達到最佳的性能價格比。　　實際上，只有從芯片開始仔細(xì)設(shè)計，才能方便
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Altera宣布其Cyclone III FPGA提供對EtherCAT IP支持

　　Altera公司日前宣布為EtherCAT技術(shù)協(xié)會的EtherCAT協(xié)議提供知識產(chǎn)權(quán)(IP)支持。此前IP是針對Cyclone® II器件，現(xiàn)在將針對Altera新的低成本、低功耗Cyclone III FPGA。　　EtherCAT技術(shù)協(xié)會執(zhí)行總監(jiān)Martin Rostan說：“在競爭非常激烈的工廠自動化設(shè)備市場上，企業(yè)正在尋找能夠迅速突出產(chǎn)品優(yōu)勢的新功能和特性。Cyclone III FPGA實現(xiàn)對EtherCAT的支持，使設(shè)計人員能夠以高性價比方式，輕松加入實時以太網(wǎng)功能?！? 　　
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利用FPGA實現(xiàn)UART的設(shè)計

引言　　隨著計算機技術(shù)的發(fā)展和廣泛應(yīng)用，尤其是在工業(yè)控制領(lǐng)域的應(yīng)用越來越廣泛，計算機通信顯的尤為重要。串行通信雖然使設(shè)備之間的連線大為減少，但隨之帶來串／并轉(zhuǎn)換和位計數(shù)等問題，這使串行通信技術(shù)比并行通信技術(shù)更為復(fù)雜。串／并轉(zhuǎn)換可用軟件實現(xiàn)，也可用硬件實現(xiàn)。用軟件實現(xiàn)串行傳送大多采用循環(huán)移位指令將一個字節(jié)由高位到低位(或低位到高位)一位一位依次傳送，這種方法雖然簡單但速度慢，而且大量占用CPU的時間，影響系統(tǒng)的性能。更為方便的實現(xiàn)方法是用硬件，目前微處理器串行接口常用的LSI 芯片是UART(通用異
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基于雙嵌入式處理器的高清數(shù)字電視設(shè)計

　　1 引言　　隨著數(shù)字傳輸技術(shù)和圖像處理技術(shù)的提高，電視技術(shù)正逐步從SDTV（Standard Definition TV，標(biāo)準(zhǔn)清晰度電視）過渡到HDTV（High Definition TV，高清晰度電視）。高清數(shù)字電視符合人們對高品質(zhì)的數(shù)字多媒體播放和高性能的網(wǎng)絡(luò)信息終端的需要，具備廣闊的市場前景，其基于嵌入式系統(tǒng)技術(shù)的實現(xiàn)也成為嵌入式領(lǐng)域的新熱點[1-2]。　　高清電視是指播放畫質(zhì)超過720p或者1080i的高清晰度電視系統(tǒng)（i表示隔行掃描，p表示逐行掃描）。目前標(biāo)清的播放畫質(zhì)為480i，
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降低FPGA功耗的設(shè)計

　　使用這些設(shè)計技巧和ISE功能分析工具來控制功耗　　新一代 FPGA的速度變得越來越快，密度變得越來越高，邏輯資源也越來越多。那么如何才能確保功耗不隨這些一起增加呢？很多設(shè)計抉擇可以影響系統(tǒng)的功耗，這些抉擇包括從顯見的器件選擇到細(xì)小的基于使用頻率的狀態(tài)機值的選擇等。　　為了更好地理解本文將要討論的設(shè)計技巧為什么能夠節(jié)省功耗，我們先對功耗做一個簡單介紹。　　功耗包含兩個因素：動態(tài)功耗和靜態(tài)功耗。動態(tài)功耗是指對器件內(nèi)的容性負(fù)載充放電所需的功耗。它很大程度上取決于頻率、電壓和負(fù)載
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具有硬件互斥的控制電路設(shè)計方法

　　在控制系統(tǒng)設(shè)計時，硬件互斥現(xiàn)象是很常見的，互斥電路功能可用硬件實現(xiàn)，也可以用系統(tǒng)加軟件實現(xiàn)。用硬件電路來實現(xiàn)指定的控制功能比用軟件來實現(xiàn)穩(wěn)定性好，處理速度更快得多。隨著大規(guī)模集成電路技術(shù)發(fā)展，用硬件來處理特定的功能的發(fā)展趨勢日趨明顯，隨著SOPC技術(shù)的發(fā)展，軟體的硬化已日益成為人們研究的熱點，專用功能的ASIC芯片越來越多。在進行計算機操作系統(tǒng)設(shè)計時，互斥理論用來處理并發(fā)過程對臨界資源的共享；在進行控制系統(tǒng)設(shè)計時，電路的不同邏輯狀態(tài)也常有互斥現(xiàn)象。如多個輸入信號共享一個處理電路而輸入信號同時作用于電路
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利用 Virtex-5 SXT 的高性能 DSP 解決方案

　　二十多年來，F(xiàn)PGA 為世人提供了最靈活、適應(yīng)性極強、快速的設(shè)計環(huán)境。早期的 DSP 設(shè)計人員發(fā)現(xiàn)，可將一種可再編程的門海用于數(shù)字信號處理。如果把內(nèi)置到 FPGA 架構(gòu)中的乘法器、加法器和累加單元結(jié)合起來，就可以利用大規(guī)模并行計算實現(xiàn)有效的濾波器算法。　　在未加工頻率性能方面的損失，通過并行計算得到了彌補，而且得遠大于失，可謂“失之東隅，收之桑榆”；由此獲得的 DSP 帶寬完全可與替代方案媲美。隨著時間的推移，乘法器和加法器的實施越來越高效。1998 年，Xilinx 順理成章推出了第一個集成于
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如何成功地完成ASIC原型驗證

　　原型驗證---用軟件的方法來發(fā)現(xiàn)硬件的問題　　在芯片tap-out之前，通常都會計算一下風(fēng)險，例如存在一些的嚴(yán)重錯誤可能性。通常要某個人簽字來確認(rèn)是否去生產(chǎn)。這是一個艱難的決定。ASIC的產(chǎn)品NRE的費用持續(xù)上升。一次失敗的ASIC流片將會推遲數(shù)個月的上市時間。誰愿意承擔(dān)簽字的責(zé)任呢? 一些BUG通過仿真和Emulation是抓不到的。傳統(tǒng)的驗證方法認(rèn)為設(shè)計的功能符合功能定義就是對的。但功能定義到底對不對呢？唯一的辦法就是建立一個真實的硬件：原型。　　基于FPGA的原型 --- 一個虛擬
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基于ARM智能家居控制器設(shè)計與實現(xiàn)

　　如何將家庭里相對獨立的設(shè)備連接成一個系統(tǒng)，從而方便進行本地和遠程控制？本文通過采用ARM構(gòu)成智能家居控制器來實現(xiàn)這個目標(biāo)。智能家居控制器使用S3C2410、SIM100-E等元件來組成硬件平臺，再將Linux系統(tǒng)移植到硬件平臺上，然后設(shè)計好相應(yīng)的驅(qū)動程序和應(yīng)用程序，最后將軟件下載到硬件平臺來對家電進行本地和遠程控制。　　隨著數(shù)字化家用電器的飛速發(fā)展，如何對家庭中相對獨立的家用電器進行智能化管理和操作？這是人們非常關(guān)心的一個問題。智能家居控制器能夠?qū)⒃S多相對獨立的家用電器構(gòu)成一個統(tǒng)一的系統(tǒng)，從而方
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Aerospace采用風(fēng)河Linux開發(fā)太空項目

　　風(fēng)河系統(tǒng)公司（Wind River）日前宣布，Honeywell Aerospace公司將風(fēng)河Linux產(chǎn)品用于開發(fā)美國國家航空和宇宙航行局（NASA）New Millennium Program Space Technology 8（ST8）可靠多處理器（Dependable Multiprocessor）項目。Honeywell Aerospace是NASA ST8 Dependable Multiprocessor項目的主要外包商，這是該公司首次購買采用Linux平臺用于太空任務(wù)項目開發(fā)。Win
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快速實現(xiàn)基于FPGA的脈動FIR濾波器

引言　　目前，用FPGA(現(xiàn)場可編程門陣列)實現(xiàn)FIR(有限沖擊響應(yīng))濾波器的方法大多利用FPGA中LUT(查找表)的特點采用DA(分布式算法)或CSD碼等方法，將乘加運算操作轉(zhuǎn)化為位與、加減和移位操作。這些結(jié)構(gòu)需要占用器件較多的LE(邏輯元件)資源，設(shè)計周期長，工作頻率低，實時性差。本文提出一種基于Stratix系列FPGA器件的新的實時高速脈動FIR濾波器的快速實現(xiàn)方法。利用FGPA集成的DSP(數(shù)字信號處理器)乘加模塊定制卷積運算單元，利用VHDL(甚高速集成電路硬件描述語言)元件例化語句快
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采用FPGA的圖像采集卡的設(shè)計

　　現(xiàn)代化生產(chǎn)和科學(xué)研究對視頻圖像采集系統(tǒng)的要求日益提高。傳統(tǒng)的圖像采集卡速度慢、處理功能簡單、采用分立元件、電路非常復(fù)雜；而且可靠性差、不易調(diào)試、不能很好地滿足特殊要求。FPGA(現(xiàn)場可編程門陣列)是專用集成電路中集成度最高的一種，用戶可對FPGA內(nèi)部的邏輯模塊和I／O模塊重新配置，以實現(xiàn)用戶所需邏輯功能。用戶對FPGA的編程數(shù)據(jù)放入芯片，通過上電加載到FPGA中，對其進行初始化；也可在線對其編程，實現(xiàn)系統(tǒng)在線重構(gòu)?；贔PGA技術(shù)的圖像采集主要是通過集成的FPGA開發(fā)板，使用軟件編程把圖像的采集控制程
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