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IAR編譯代碼執(zhí)行速度高3倍代碼少50%

在Atmel公司的AVR32內(nèi)核上，IAR Systems成熟的指令調(diào)度機(jī)制能夠充分利用Single-cycle Load/Store、SIMD和DSP指令，支持并行和Out-of-Order算法 IAR Systems®發(fā)布了支持Atmel公司全新的AVR®32嵌入式CPU內(nèi)核的IAR Embedded Workbench®。同日發(fā)布的AVR32架構(gòu)，結(jié)合IAR Embedded Workbench
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2006年2月15日，海爾IC選用ARM Artisan物理IP

　　2006年2月15日海爾IC選用ARM Artisan®物理IP開發(fā)消費(fèi)電子產(chǎn)品，全面的解決方案幫助中國工程師實(shí)現(xiàn)低功耗、高性能的IC設(shè)計(jì)。
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QuickLogic推出嵌入式SDIO IP和SDIO設(shè)計(jì)

QuickLogic公司近日宣布推出可嵌入QuickLogic 微瓦FPGA產(chǎn)品系列Eclipse II™的SDIO主控器IP核。為了進(jìn)一步縮短客戶產(chǎn)品設(shè)計(jì)的時(shí)間，QuickLogic同時(shí)還提供基于Eclipse II QL8325和QL8150 的SDIO參考設(shè)計(jì)。 QuickLogic所
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德州儀器推出IP質(zhì)量管理單元系統(tǒng)

　　日前，德州儀器 (TI) 宣布推出一套新型的 IP 質(zhì)量管理單元系統(tǒng)—PIQUA，該產(chǎn)品將使服務(wù)供應(yīng)商能夠在 VoIP、IP 視頻、IPTV 以及因特網(wǎng)音樂服務(wù)方面，為個(gè)人消費(fèi)者與企業(yè)用戶提供高級(jí)服務(wù)質(zhì)量。通過積極與 Motive 及 Viola Networks 的合作，融合了PIQUA 的TI IP 通信技術(shù)產(chǎn)品，可提供重要技術(shù)信息來正確管理各種新興
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QuickLogic推出SDIO IP和SDIO參考設(shè)計(jì)

QuickLogic公司近日宣布推出可嵌入QuickLogic 微瓦FPGA產(chǎn)品系列Eclipse II™的SDIO主控器IP核。為了進(jìn)一步縮短客戶產(chǎn)品設(shè)計(jì)的時(shí)間，QuickLogic同時(shí)還提供基于Eclipse II QL8325和QL8150 的SDIO參考設(shè)計(jì)。 Quick
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MIPS與Virage優(yōu)化內(nèi)核IP套件提高性能

MIPS 科技與 Virage Logic宣布聯(lián)合推出一個(gè)新系列的第一個(gè)內(nèi)核優(yōu)化 IP 套件（Core-Optimized IP Kit）。該套件由專門優(yōu)化 MIPS 處理器性能的Virage Logic Area 、Speed and Power (ASAP) Memory™
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ST無線IP家庭網(wǎng)絡(luò)多媒體流組合

多媒體/手機(jī)芯片領(lǐng)導(dǎo)廠商針對(duì)下一代家庭娛樂信息產(chǎn)品推出成套關(guān)鍵技術(shù) 意法半導(dǎo)體日前公布了該公司正在為無線家庭IP網(wǎng)絡(luò)的音視頻流應(yīng)用開發(fā)一套關(guān)鍵技術(shù)的細(xì)節(jié)，以實(shí)現(xiàn)新一代消費(fèi)電子產(chǎn)品。有了這些技術(shù)，不同的消費(fèi)產(chǎn)品（機(jī)頂盒、DVD影碟機(jī)、DVD錄放機(jī)、移動(dòng)終端）就可以通過無線連接來共享多媒體內(nèi)容。ST正在開發(fā)的關(guān)鍵技術(shù)包括視頻碼轉(zhuǎn)換、先進(jìn)的視頻編碼器和強(qiáng)固的解碼器 (H.264)、自適應(yīng)播放、802.11n WLAN和安全/DRM (數(shù)字權(quán)限管理)。這些技術(shù)的開發(fā)目標(biāo)是按照“隨時(shí)
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ADI發(fā)布《Embedded Media Processing》

美國模擬器件公司，今日發(fā)布由高級(jí)工程師David J. Katz和Rick Gentile編著的新書《Embedded Media Processing（嵌入式媒體處理）》出版。該書是為設(shè)計(jì)工程師開發(fā)嵌入式媒體處理系統(tǒng)撰寫的一本實(shí)用性指南，今日在波士頓市舉行的2005年嵌入式系統(tǒng)會(huì)議（ESC）上首次亮相。作者于2005年9月12日下午2:30至3:30在出版商Elsevier公司308號(hào)展位的特別簽售活動(dòng)中與到會(huì)者見面。 Katz先生和Gentile先生將
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2005年12月20日，宏力半導(dǎo)體采用ARM Artisan物理IP

　　2005年12月20日宏力半導(dǎo)體采用ARM Artisan物理IP擴(kuò)展其0.18微米和0.13微米流水線。該協(xié)議使ARM全球用戶可以通過ARM網(wǎng)站免費(fèi)獲得基于宏力技術(shù)的物理IP。
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用PowerPC實(shí)現(xiàn)高帶寬 TCP/IP 性能

用PowerPC實(shí)現(xiàn)高帶寬 TCP/IP 性能,今天，實(shí)現(xiàn)線速 TCP/IP 性能仍舊是一項(xiàng)重大設(shè)計(jì)挑戰(zhàn)。在本文中，我們將討論限制 TCP/IP 性能的單位字節(jié)和單位包的處理成本，并給出在基于嵌入式處理器的應(yīng)用中實(shí)現(xiàn)千兆位以太網(wǎng) TCP/IP 性能最大化的技術(shù)。
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11月23日，IAR技術(shù)研討會(huì)

—— UML在嵌入式產(chǎn)品開發(fā)中的應(yīng)用　　由于當(dāng)今的嵌入式應(yīng)用越來越復(fù)雜，人機(jī)界面也越來越豐富，很多公司在進(jìn)行產(chǎn)品開發(fā)時(shí)越來越多地會(huì)面臨以下問題：　　- 在需求分析、模塊劃分和接口討論上，耗費(fèi)了大量的會(huì)議時(shí)間與精力　　- 無論花費(fèi)多少時(shí)間做測試，總會(huì)有錯(cuò)誤的遺漏　　- 大量的時(shí)間用于代碼和文檔的編寫上，但往往無法及時(shí)地對(duì)應(yīng)需求的變化　　- 后續(xù)的工程師往往看不懂前任工程師的產(chǎn)品設(shè)計(jì)，產(chǎn)品的維護(hù)經(jīng)常出現(xiàn)問題　　傳統(tǒng)的畫流程圖、用編程語言的設(shè)計(jì)方法這種基于順序運(yùn)算結(jié)構(gòu)的設(shè)計(jì)邏
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IP業(yè)務(wù)網(wǎng)解決方案

當(dāng)前IP網(wǎng)所承擔(dān)的業(yè)務(wù)已經(jīng)不再是電子郵件和網(wǎng)頁瀏覽，除了基于IP網(wǎng)的寬帶業(yè)務(wù)，還逐步出現(xiàn)了VPN等高增值業(yè)務(wù)。這就要求IP網(wǎng)不僅有容量上，而且要在業(yè)務(wù)支持種類、服務(wù)質(zhì)量和可管理性上有所提高，最終發(fā)展到以IP/MPLS網(wǎng)實(shí)現(xiàn)統(tǒng)一的業(yè)務(wù)提供和業(yè)務(wù)承載。　　　　今天，IP/MPLS標(biāo)準(zhǔn)和技術(shù)正日益得到完善，其市場接受度正不斷提高，許多運(yùn)營商將在網(wǎng)絡(luò)中構(gòu)建具有業(yè)務(wù)提供能力的IP/MPLS業(yè)務(wù)層作為其重要戰(zhàn)略。傳統(tǒng)的路由器也具有一定的IP或MPLS隧道能力，但是它們并不是基于“面向服務(wù)”進(jìn)行設(shè)計(jì)的，只能以粗放的
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NexTone：為IP網(wǎng)絡(luò)實(shí)現(xiàn)會(huì)話管理

關(guān)鍵字：會(huì)話管理實(shí)現(xiàn) 網(wǎng)絡(luò) IP NexTone

IAR推出IAR Systems的開發(fā)工具

為什么要選擇IAR Embedded Workbench？　　我們?yōu)槭裁匆艞壥蛊渌鞣N用免費(fèi)的開發(fā)工具，而選擇需要支付費(fèi)用來購買IAR Systems的開發(fā)工具？主要包括一下幾點(diǎn)原因： 1. IAR Embedded Workbench可以生成節(jié)省空間并且穩(wěn)定可靠的可執(zhí)行代碼　　經(jīng)過反復(fù)實(shí)驗(yàn)證明，IAR Systems的C/C++編譯器可以生成高效可靠的可執(zhí)行代碼，并且應(yīng)用程序規(guī)模越大，效果明顯。與其他的工具開發(fā)廠商相比，系統(tǒng)同時(shí)使用全局和針對(duì)具體芯片的優(yōu)化技術(shù)。連接器提供的全局類型檢測
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自由IP Core資源的利用

摘要：本文介紹了與免費(fèi)IP Core運(yùn)作有關(guān)的問題以及免費(fèi)資源的若干來源，然后通過對(duì)兩個(gè)不同來源的、免費(fèi)的八位RISC CPU進(jìn)行比較和分析，給出了若干選用免費(fèi)核時(shí)應(yīng)考慮的問題。關(guān)鍵詞：IP Core； CPU引言隨著集成電路單位面積晶體管數(shù)量的激增和人們對(duì)縮短設(shè)計(jì)周期的追求，設(shè)計(jì)重用已經(jīng)成為有效的應(yīng)對(duì)方法，它不但適合于ASIC，也適合于CPLD/FPGA。在CPLD/FPGA的設(shè)計(jì)過程中，由于開發(fā)工具的通用性、設(shè)計(jì)語言的標(biāo)準(zhǔn)化，設(shè)計(jì)過程幾乎與所用器件的硬件結(jié)構(gòu)無關(guān)，
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