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            EEPW首頁 >> 主題列表 >> fsp:fpga-pcb

            PCB Matrix IPC-7351 LP軟件介紹及使用說明

            • [摘要] 本文對介紹IPC-7351 LP軟件進行了簡要地介紹,包括軟件的組成、原理和特點、軟件操作等方面,并得出使用該軟件可以快速、準確地設(shè)計出焊盤圖形的結(jié)論。[關(guān)鍵詞] IPC-7351 LP 焊盤圖形 1.軟件組成 IPC-7351
            • 關(guān)鍵字: Matrix  7351  PCB  IPC    

            Cadence PCB設(shè)計仿真技術(shù)

            • Cadence PCB設(shè)計仿真技術(shù)提供了一個全功能的模擬仿真器,并支持數(shù)字元件幫助解決幾乎所有的設(shè)計挑戰(zhàn),從高頻系統(tǒng)到低功耗IC設(shè)計,這個強大的仿真引擎可以容易地同各個Cadence PCB原理圖輸入工具結(jié)合,加速了上市時間
            • 關(guān)鍵字: Cadence  PCB  仿真技術(shù)    

            Mentor Graphics應(yīng)用之PCB設(shè)計復(fù)用

            • 引言
                隨PCB板趨向小型化、多層化與復(fù)雜化。特別是高速印制板,需要經(jīng)過很長時間的反復(fù)調(diào)試才可以定型。如果已有一個定型的設(shè)計(A),現(xiàn)需要一個部分電路與其相同或相似的設(shè)計(B),傳統(tǒng)設(shè)計流程如下: 圖1:傳
            • 關(guān)鍵字: Graphics  Mentor  PCB    

            德州儀器推出新型 FPGA 擴展板

            •   日前,德州儀器 (TI) 宣布推出專用于 DK-LM3S9B96 開發(fā)套件的新型 Stellaris FPGA 擴展板,可顯著加速開發(fā)低成本安全接入控制系統(tǒng)及其它需要高速外部處理單元接口的應(yīng)用。這款全新電路板使開發(fā)人員能夠輕松評估 Stellaris 微處理器 (MCU) 高靈活性外設(shè)接口 (EPI) 的高帶寬機器對機器 (M2M) 并行接口功能。EPI 的 M2M 模式可支持高達 32 位的數(shù)據(jù)寬度以及高達每秒 150 MB 的數(shù)據(jù)速率,專用于幫助低成本安全接入控制應(yīng)用的開發(fā)人員將攝像系統(tǒng)或低分辨率
            • 關(guān)鍵字: TI  FPGA  開發(fā)套件  

            DNLMS濾波器的FPGA實現(xiàn)

            • 自適應(yīng)濾波器的研究是近年來研究的熱門方向,在PFGA中實現(xiàn)高速的自適應(yīng)濾波器的設(shè)計更是一個熱點,在此采用DSP Builder系統(tǒng)建模的方法,在FPGA中實現(xiàn)了歸一化LMS算法,實驗結(jié)果表明:用DSPBuilder設(shè)計的8階DNLMS算法比用底層的VHDL代碼設(shè)計效率更高,靈活性更大,速度更快。同樣比通用的DSP芯片設(shè)計的8階NLMS濾波器處理速度快了20多倍。如果將8階NLMS濾波器擴展到512階或者1 024階,可以很好地應(yīng)用于自適應(yīng)回聲消除等很多自適應(yīng)濾波的領(lǐng)域。
            • 關(guān)鍵字: 實現(xiàn)  FPGA  濾波器  DNLMS  

            一種基于FPGA的NoC驗證平臺的構(gòu)建

            • 半導(dǎo)體工藝技術(shù)進入深亞微米時代后,基于總線系統(tǒng)芯片SoC(SvstemonChip)的體系結(jié)構(gòu)在物理設(shè)計、通信帶...
            • 關(guān)鍵字: FPGA  NoC  驗證平臺  

            一種基于FPGA的新型數(shù)字電壓表研究與設(shè)計

            • 數(shù)字電壓表是大學(xué)物理教學(xué)和實驗中的重要儀表,其數(shù)字化是指將連續(xù)的模擬電壓量轉(zhuǎn)換成不連續(xù)、離散的數(shù)字...
            • 關(guān)鍵字: FPGA  數(shù)字電壓表  A/D  

            S-Touch電容式觸摸控制器PCB布局指南

            •   PCB設(shè)計與布局   在結(jié)構(gòu)為兩層的PCB中,S-Touch觸摸控制器和其他部件被布設(shè)在PCB的底層, 傳感器電極被布設(shè)在PCB的頂層。   每個傳感器通道所需的調(diào)諧匹配電容器可以直接布設(shè)在該傳感器電極的底層。需要指出的是,S-Touch觸摸控制器布設(shè)在底層,應(yīng)該保證其對應(yīng)的頂層沒有布設(shè)任何傳感器電極。頂層和底層的空白區(qū)域可填充網(wǎng)狀接地銅箔。   設(shè)計規(guī)則   第1層(頂層)   ● 傳感器電極位于PCB的頂層(PCB的上端與覆層板固定在一起)。 為提高靈敏度,建議使用尺寸為10×
            • 關(guān)鍵字: S-Touch  觸摸控制器  PCB  

            基于FPGA的多路正弦波信號發(fā)生器專用芯片設(shè)計

            • 基于開源思想與SOPC技術(shù),采用32位開源軟核處理器OR1200和開源軟核DDS,在FPGA上實現(xiàn)了頻率、相位可預(yù)置并且可調(diào)的3路正弦波信號發(fā)生器專用芯片的設(shè)計。該專用芯片基于OR1200固化專用程序?qū)崿F(xiàn),通過UART傳輸控制數(shù)據(jù),可同時控制3路正弦波的產(chǎn)生,其頻率范圍為1 Hz~100 MHz,步進頻率為1 Hz,相位范圍為0°~359°。設(shè)計方案在DE2-70開發(fā)板上進行了實際驗證,證明了設(shè)計的正確性和可行性。
            • 關(guān)鍵字: FPGA  多路  正弦波信號  發(fā)生器    

            AES算法中S-box和列混合單元的優(yōu)化及FPGA技術(shù)實現(xiàn)

            • AES算法中S-box和列混合單元的優(yōu)化及FPGA技術(shù)實現(xiàn),1 S-box的優(yōu)化設(shè)計

              在AES標準算法中定義了兩個較大的列表。S-box和逆S-box。將S-box用于兩個應(yīng)用:字節(jié)替代和密鑰擴展。而逆S-box則用于逆字節(jié)替代。這兩個列表是不相同的,因此必須建立兩個不同的ROM(256×8 b),
            • 關(guān)鍵字: FPGA  技術(shù)  實現(xiàn)  優(yōu)化  單元  算法  S-box  混合  AES  

            Virtex-6 FPGA ML605開發(fā)評估技術(shù)方案

            • Virtex-6 FPGA ML605開發(fā)評估技術(shù)方案,Virtex-6 FPGA適合用有線通信,無線基礎(chǔ)設(shè)備和廣播設(shè)備等領(lǐng)域.本文介紹了Virtex-6 FPGA主要特性,以及骨干網(wǎng)OTU-4成幀與EFEC框圖, LTE 2x2無線電設(shè)計框圖和支持SD/HD/3G-SDI接口的新一代交換框圖, Virtex®-6 FPGA
            • 關(guān)鍵字: 技術(shù)  方案  評估  開發(fā)  FPGA  ML605  Virtex-6  

            基于CPLD的IEEE1149.1 USB下載電纜設(shè)計

            • 引言隨著片上系統(tǒng)(SoC,SystemonChip)時代的到來,包括復(fù)雜可編程邏輯器件(CPLD,ComplexProgrammab...
            • 關(guān)鍵字: FPGA  CPLD  USB下載電纜  IEEE1149.1  

            賽靈思ISE 12設(shè)計套件用智能時鐘門控技術(shù)降低動態(tài)功耗30%

            •   全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc.)日前推出 ISE 12軟件設(shè)計套件,實現(xiàn)了具有更高設(shè)計生產(chǎn)力的功耗和成本的突破性優(yōu)化。ISE 設(shè)計套件首次利用“智能”時鐘門控技術(shù),將動態(tài)功耗降低多達 30%。此外,該新型套件還提供了基于時序的高級設(shè)計保存功能、為即插即用設(shè)計提供符合 AMBA 4 AXI4 規(guī)范的IP支持,同時具備第四代部分重配置功能的直觀設(shè)計流程,可降低多種高性能應(yīng)用的系統(tǒng)成本。   在為所有 Xilinx Virtex-6 和 Spartan-
            • 關(guān)鍵字: Xilinx  FPGA  軟件設(shè)計套件  

            醫(yī)療電子市場成像設(shè)備占比重最大 FPGA廠商忙于開拓疆土

            •   中國國際醫(yī)療器械博覽會的熱度一年勝過一年,今年規(guī)模再創(chuàng)紀錄。而同期舉辦的第三屆中國國際醫(yī)療電子技術(shù)大會(CMET)則更是吸引了眾多國際半導(dǎo)體公司參加,會議也由以前的一天變?yōu)閮商臁?   “醫(yī)療電子市場的年復(fù)合增長率在所在領(lǐng)域中最高,達14.6%,超過目前也是很火的汽車電子、無線通信等領(lǐng)域,所以大家可以想象它為什么吸引眾多觀眾。”iSuppli資深分析師王仁震解釋,“而中國醫(yī)療電子市場占全球的比例也是逐年增長,2006年只占到4%,但2013年可達到9%的比重。&rd
            • 關(guān)鍵字: 醫(yī)療電子  FPGA  成像設(shè)備  

            基于FPGA的可調(diào)信號源設(shè)計

            • 針對航天檢測設(shè)備中信號源單一、不可調(diào)等缺點,提出并實現(xiàn)了一種以FPGA 、高速D/A、繼電器AQY210為核心,結(jié)構(gòu)簡單,控制靈活,信號質(zhì)量高的多功能信號源生成系統(tǒng)。該系統(tǒng)可提供各種頻率、幅值、偏置等參數(shù)可調(diào)的模擬信號,成功應(yīng)用于工業(yè)控制開關(guān)量輸出性能檢測。同時,上位機與硬件通信的接口使用了USB-單片機(CY7C68013)和USB-FIFO(FT245)兩種方案,并進行實際對比,提出其適用條件和范圍。
            • 關(guān)鍵字: FPGA  可調(diào)信號源    
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            fsp:fpga-pcb介紹

            您好,目前還沒有人創(chuàng)建詞條fsp:fpga-pcb!
            歡迎您創(chuàng)建該詞條,闡述對fsp:fpga-pcb的理解,并與今后在此搜索fsp:fpga-pcb的朋友們分享。    創(chuàng)建詞條

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