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            EEPW首頁 >> 主題列表 >> fsp:fpga-pcb

            基于FPGA的CCD驅(qū)動設(shè)計(jì)

            • 以Atmel公司的面陣CCD-TH7888A圖像傳感器為例,在研究了CCD結(jié)構(gòu)和驅(qū)動時(shí)序圖的基礎(chǔ)上提出基于FPGA的驅(qū)動脈沖設(shè)計(jì)方法和硬件電路實(shí)現(xiàn)。使用VHDL語言對驅(qū)動時(shí)序發(fā)生器進(jìn)行了硬件描述,并采用Quartus 5.O對設(shè)計(jì)的驅(qū)動時(shí)序發(fā)生器進(jìn)行仿真。試驗(yàn)結(jié)果表明,涉及的驅(qū)動電路可以滿足面陣CCD-TH7888A的各項(xiàng)驅(qū)動要求。
            • 關(guān)鍵字: FPGA  CCD  驅(qū)動設(shè)計(jì)    

            FPGA易測試性分析

            • FPGA易測試性分析,現(xiàn)代科技對系統(tǒng)的可靠性提出了更高的要求,而FPGA技術(shù)在電子系統(tǒng)中應(yīng)用已經(jīng)非常廣泛,因此FPGA易測試性就變得很重要。要獲得的FPGA內(nèi)部信號十分有限、FPGA封裝和印刷電路板(PCB)電氣噪聲,這一切使得設(shè)計(jì)調(diào)試和檢驗(yàn)變
            • 關(guān)鍵字: 分析  測試  FPGA  

            基于CPLD的壓電生物傳感器檢測電路設(shè)計(jì)

            • 介紹了一種基于復(fù)雜可編程邏輯器件(CPLD)的壓電生物傳感器檢測電路。該檢測電路以高性能CPLD(MAX7128)...
            • 關(guān)鍵字: FPGA  CPLD  生物傳感器  檢測電路  

            基于FPGA及DSP Builder的VGA接口設(shè)計(jì)

            • 基于FPGA及DSP Builder的VGA接口設(shè)計(jì),本文基于DSP Builder的VGA接口設(shè)計(jì)方法,對VGA接口時(shí)序和系統(tǒng)設(shè)計(jì)需求進(jìn)行了介紹,并在硬件平臺下實(shí)現(xiàn)一維與二維信號的顯示。

              VGA接口標(biāo)準(zhǔn)

              VGA顯像原理

              顯示器通過光柵掃描的方式,電子束在顯示屏幕上
            • 關(guān)鍵字: 接口  設(shè)計(jì)  VGA  Builder  FPGA  DSP  基于  

            基于SRAM工藝FPGA的保密性問題

            • 在現(xiàn)代電子系統(tǒng)設(shè)計(jì)中,由于可編程邏輯器件的卓越性能、靈活方便的可升級特性,而得到了廣泛的應(yīng)用。由于大規(guī)模高密度可編程邏輯器件多采用SRAM工藝,要求每次上電,對FPGA器件進(jìn)行重配置,這就使得可以通過監(jiān)視配置
            • 關(guān)鍵字: 保密性  問題  FPGA  工藝  SRAM  基于  

            基于FPGA的快速9/7整形離散小波變換系統(tǒng)

            • 美國空間數(shù)據(jù)系統(tǒng)咨詢委員會(簡稱CCSDS)于2005年推出一套適用于空間領(lǐng)域的圖像壓縮標(biāo)準(zhǔn),標(biāo)準(zhǔn)使用了離散...
            • 關(guān)鍵字: 小波變換  FPGA  CCSDS圖像壓縮  

            PCB板的翹曲度介紹

            • 首先說的是覆銅的時(shí)候是網(wǎng)格好還是全銅好,大的板子,網(wǎng)格銅好,因?yàn)槿~在受到外力的時(shí)候會保持翹曲情況,網(wǎng)格的就不會保持~會恢復(fù)到原來的平整情況,一般工藝邊也留銅目的就是要保障板子的翹曲度。IPC標(biāo)準(zhǔn)翹曲度小
            • 關(guān)鍵字: PCB  翹曲度    

            手機(jī)PCB設(shè)計(jì)時(shí)RF布局技巧

            • 手機(jī)功能的增加對PCB板的設(shè)計(jì)要求更高,伴隨著一輪藍(lán)牙設(shè)備、蜂窩電話和3G時(shí)代來臨,使得工程師越來越關(guān)注RF電路的設(shè)計(jì)技巧。射頻(RF)電路板設(shè)計(jì)由于在理論上還有很多不確定性,因此常被形容為一種“黑色藝術(shù)”,但這個(gè)
            • 關(guān)鍵字: PCB  手機(jī)  計(jì)時(shí)  RF布局    

            軟件無線電設(shè)計(jì)中ASIC、FPGA和DSP的選擇

            • ASIC、FPGA和DSP的應(yīng)用領(lǐng)域呈現(xiàn)相互覆蓋的趨勢,使設(shè)計(jì)人員必須在軟件無線電結(jié)構(gòu)設(shè)計(jì)中重新考慮器件選擇...
            • 關(guān)鍵字: FPGA  ASIC  DSP  軟件無線電  

            Modbus通信協(xié)議的FPGA實(shí)現(xiàn)

            • Modbus協(xié)議是一個(gè)應(yīng)用廣泛的工業(yè)現(xiàn)場總線協(xié)議,鑒于其簡單、開放、幀格式緊湊等優(yōu)點(diǎn),于2008年正式成為我國國家標(biāo)準(zhǔn)。介紹一種通過Cyclone系列FPGA實(shí)現(xiàn)Modbus RTU模式的方法,首先給出一個(gè)可以通用于Modbus主設(shè)備和從設(shè)備的協(xié)議接口單元,然后基于該接口設(shè)計(jì)了一個(gè)通用的Modbus從設(shè)備協(xié)處理器。實(shí)踐證明該方法能夠滿足工業(yè)環(huán)境的通訊要求,此外,該方法在其他FPGA上也具有一定通用性和推廣價(jià)值。
            • 關(guān)鍵字: 實(shí)現(xiàn)  FPGA  協(xié)議  通信  Modbus  功率模塊  

            Altera Stratix V FPGA提供RLDRAM 3存儲器支持

            •   Altera公司今天發(fā)布Stratix® V系列FPGA,適用于支持Micron技術(shù)公司的下一代低延時(shí)DRAM (RLDRAM® 3存儲器)。Stratix V FPGA采用新的存儲器體系結(jié)構(gòu),降低延時(shí),高效實(shí)現(xiàn)FPGA業(yè)界最好的系統(tǒng)性能。Stratix V FPGA為網(wǎng)絡(luò)設(shè)備生產(chǎn)商提供存儲器接口解決方案,支持在互聯(lián)網(wǎng)上迅速有效的傳送視頻、語音和數(shù)據(jù)。   Micron公司業(yè)務(wù)開發(fā)高級經(jīng)理Bruce Franklin表示:“Micron的下一代RLDRAM 3存儲器專門設(shè)
            • 關(guān)鍵字: Altera  FPGA  Stratix  

            ARM920T基于Linux平臺下的FPGA驅(qū)動開發(fā)

            • ARM920T基于Linux平臺下的FPGA驅(qū)動開發(fā),Linux操作系統(tǒng)的全稱是GNU/Linux,它是由GNU工程和Linux內(nèi)核兩個(gè)部分共同組成的一個(gè)操作系統(tǒng)。該系統(tǒng)中所有組件的源代碼都是自由的,可以有效保護(hù)學(xué)習(xí)成果,因而在嵌入式領(lǐng)域得到了廣泛的應(yīng)用。

              FPGA是英文Field
            • 關(guān)鍵字: 驅(qū)動  開發(fā)  FPGA  平臺  基于  Linux  ARM920T  

            在PowerPCB中打開你設(shè)計(jì)的PCB

            • tools/equalize net lengths這個(gè)命令就是在protel中手動布等長線的工具,

              這個(gè)就是讓不同的網(wǎng)絡(luò)布線等長.最后可以在REPORT中報(bào)告某一網(wǎng)絡(luò)名線的總長度!

              用這個(gè)命令之前要設(shè)等長規(guī)則還有要設(shè)一個(gè)net class,將n
            • 關(guān)鍵字: PowerPCB  PCB    

            基于FPGA的線性卷積的實(shí)時(shí)實(shí)現(xiàn)

            • 摘要:從實(shí)際工程應(yīng)用出發(fā),研究了在基于FPGA上快速傅里葉變換實(shí)現(xiàn)線性卷積的方法,并搭建了一個(gè)基于Altera的EP2S60硬件處理平臺,利用Altera提供的FFT IP核,在100 MHz系統(tǒng)時(shí)鐘下,數(shù)據(jù)吞吐率可達(dá)100 Ms/s,
              關(guān)鍵
            • 關(guān)鍵字: FPGA  線性卷積    
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            fsp:fpga-pcb介紹

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